fpga+dsp 文章最新資訊

高性能多DSP互連技術(shù)

　　前言　　由于現(xiàn)代數(shù)字信號(hào)處理器(DSP)設(shè)計(jì)、半導(dǎo)體工藝、并行處理和互連與傳輸技術(shù)的進(jìn)步，現(xiàn)代高性能DSP的處理能力得到極大發(fā)展。但在移動(dòng)通信、雷達(dá)信號(hào)處理和實(shí)時(shí)圖像處理等復(fù)雜電子系統(tǒng)中，單片DSP的性能仍可能無(wú)法滿足需求，通常需要使用多片DSP構(gòu)成并行信號(hào)處理系統(tǒng)。　　在多DSP系統(tǒng)中，互連技術(shù)連接DSP、接口及其他處理器，一起構(gòu)成系統(tǒng)的靜態(tài)體系結(jié)構(gòu)，是數(shù)據(jù)傳輸?shù)闹虚g介質(zhì)的總和。互連技術(shù)傳輸代表計(jì)算任務(wù)、中間數(shù)據(jù)、結(jié)果或狀態(tài)控制信息的數(shù)據(jù)流，使接口與DSP中的算法模塊通過(guò)數(shù)據(jù)流動(dòng)態(tài)地連接起來(lái)
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插值查找表：實(shí)現(xiàn)DSP功能的簡(jiǎn)便方法

　　如果數(shù)字信號(hào)處理器內(nèi)核沒(méi)有您需要的確切功能，可使用插值查找表(ILUT)來(lái)解決這一問(wèn)題。　　作為賽靈思的現(xiàn)場(chǎng)工程師，我常常問(wèn)這樣的問(wèn)題：我們是否能夠提供一款其功能可滿足客戶所有獨(dú)特設(shè)計(jì)要求的DSP內(nèi)核。有時(shí)候內(nèi)核會(huì)太大，太小或者不夠快。有時(shí)，我們會(huì)開(kāi)發(fā)一款能確切滿足客戶需求的內(nèi)核，并迅速以CORE Generator商標(biāo)推出。不過(guò)即便在這種情況下，客戶仍然想要一套特定的DSP功能，而且刻不容緩。在這些情況下，我常常建議他們使用我們器件中的插值查找表來(lái)定制他們的DSP功能。　　查找表(LUT)實(shí)
關(guān)鍵字： Xilinx DSP 插值查找表

NI宣布NI FlexRIO產(chǎn)品線增加新成員

　　美國(guó)國(guó)家儀器有限公司(National Instruments，簡(jiǎn)稱NI)于2010年2月15 日宣布NI FlexRIO產(chǎn)品線增加新成員，新增支持PXI Express的NI FlexRIO FPGA模塊和新的基帶收發(fā)適配器模塊。這些新產(chǎn)品為高速信號(hào)處理和其他自動(dòng)化測(cè)試測(cè)量應(yīng)用提供了優(yōu)化的解決方案，同時(shí)也是業(yè)界第一個(gè)商業(yè)現(xiàn)成可用(COTS)的兼具NI LabVIEW FPGA技術(shù)靈活性與高速可重配置I/O的PXI/PXI Express系統(tǒng)解決方案。利用新的PXI Express連接性和Peer-t
關(guān)鍵字： NI FlexRIO FPGA 基帶

直擴(kuò)導(dǎo)航系統(tǒng)中數(shù)字科思塔斯環(huán)的FPGA設(shè)計(jì)與實(shí)現(xiàn)

直擴(kuò)導(dǎo)航系統(tǒng)中數(shù)字科思塔斯環(huán)的FPGA設(shè)計(jì)與實(shí)現(xiàn),　引言　　擴(kuò)頻接收機(jī)載波的同步包括捕獲和跟蹤兩個(gè)過(guò)程，載波捕獲即多普勒頻移的粗略估計(jì)通常包含在偽碼同步過(guò)程中，而精確的載波相位及多普勒頻移則通過(guò)FLL（鎖頻環(huán)）和PLL（鎖相環(huán)）跟蹤來(lái)實(shí)現(xiàn)。鎖頻環(huán)直接跟蹤載
關(guān)鍵字：設(shè)計(jì) 實(shí)現(xiàn) FPGA 塔斯系統(tǒng) 數(shù)字導(dǎo)航

雙開(kāi)關(guān)正激轉(zhuǎn)換器及其應(yīng)用設(shè)計(jì)

　　中心議題：　　低功耗模式以及內(nèi)部時(shí)脈　　DSP: 降低功耗與提高效能　　解決方案：　　關(guān)閉無(wú)線電，將晶片切換至淺層或深層睡眠模式　　Casual不定時(shí)掃瞄　　功耗是決定可攜式裝置發(fā)展成敗的關(guān)鍵因素。由于這類裝置的趨勢(shì)朝向功能匯整的方向演進(jìn)，最明顯的跡象就是百萬(wàn)像素?cái)?shù)字相機(jī)整合至照相手機(jī)中，新型的多功能裝置必須持續(xù)迎合消費(fèi)者的需求，尤其是在功耗方面。　　雖然藍(lán)牙本身就已是低功耗技術(shù)，但為了進(jìn)一步延長(zhǎng)電池續(xù)航力，藍(lán)牙技術(shù)聯(lián)盟(Bluetooth SIG)仍持續(xù)整合許多新方法，以
關(guān)鍵字： DSP 轉(zhuǎn)換器藍(lán)牙

利用MSGQ模塊簡(jiǎn)化復(fù)雜DSP的應(yīng)用

利用MSGQ模塊簡(jiǎn)化復(fù)雜DSP的應(yīng)用, 電信基礎(chǔ)設(shè)備、視頻基礎(chǔ)設(shè)備以及影像應(yīng)用等對(duì)于帶寬的要求迅速提升,這些系統(tǒng)需要支持具有更高分辨率、更快幀速率以及更出色音質(zhì)的音視頻流。同時(shí)，上述系統(tǒng)還要提高信道密度，降低每信道的功耗。此外，該市場(chǎng)不僅要
關(guān)鍵字： DSP 應(yīng)用復(fù)雜簡(jiǎn)化 MSGQ 模塊利用

基于FPGA設(shè)計(jì)DSP的實(shí)踐與改進(jìn)

當(dāng)設(shè)計(jì)的系統(tǒng)需要對(duì)數(shù)字信號(hào)進(jìn)行處理時(shí)，常采用通用 DSP（Digital Signal Process）處理器，這樣的設(shè)計(jì)方案通用性好，且還有各種較為成熟的 DSP算法可以參考。但是，這類方案通常是雙核設(shè)計(jì)，即采用通用控制器（MCU）加上通用 DSP處理器實(shí)現(xiàn)，在實(shí)現(xiàn)系統(tǒng)時(shí)開(kāi)發(fā)的復(fù)雜程度、難度都較大，也難以滿足定制特殊處理的需要。為了解決這些問(wèn)題，人們開(kāi)始尋求新的設(shè)計(jì)方案，基于通用處理器加上FPGA（大規(guī)模可編門陣列）的架構(gòu)方案逐漸成為主流，在新的方案中通用控制器完成控制和管理功能，專用的數(shù)字信號(hào)處理和組
關(guān)鍵字： FPGA DSP 實(shí)踐

用FPGA實(shí)現(xiàn)音頻采樣率的轉(zhuǎn)換

如今，即使低成本FPGA也能提供遠(yuǎn)遠(yuǎn)大于DSP的計(jì)算能力。目前的FPGA包含專用乘法器甚至DSP乘法/累加(MAC)模塊，能以550MHz以上的時(shí)鐘速度處理信號(hào)。不過(guò)，直到現(xiàn)在，音頻信號(hào)處理中還很少需要用到這些功能。串行實(shí)現(xiàn)千
關(guān)鍵字： FPGA 音頻采樣率轉(zhuǎn)換

基于DSP的多頻帶混合信號(hào)測(cè)試系統(tǒng)的設(shè)計(jì)

隨著數(shù)字化浪潮的深入，具有混合信號(hào)功能的芯片越來(lái)越多地出現(xiàn)在人們的生活中。通訊領(lǐng)域的MODEM(如ADSL)，CODEC和飛速發(fā)展的手機(jī)芯片，視頻處理器領(lǐng)域的MPEG，DVD 芯片，都是具有混合信號(hào)功能的芯片，其特點(diǎn)是處理速度高、覆蓋的頻率范圍寬，芯片的升級(jí)換代周期日益縮短。這就要求測(cè)試系統(tǒng)具有更高的性能和更寬的頻帶范圍，而且需要靈活的架構(gòu)來(lái)應(yīng)對(duì)不斷升級(jí)的芯片測(cè)試需求，以便有效降低新器件的測(cè)試成本。此外，混合信號(hào)芯片種類繁多，各種具有混合信號(hào)的芯片已經(jīng)廣泛運(yùn)用到生產(chǎn)和生活的各個(gè)領(lǐng)域，而不同的應(yīng)用領(lǐng)域，其工
關(guān)鍵字：測(cè)試系統(tǒng) 設(shè)計(jì) 信號(hào) 混合 DSP 頻帶基于數(shù)字信號(hào)

用RapidIO提高DSP陣列的性能

“采用SERDES(串行/解串器)技術(shù)后只需少量引腳就能獲得很高的帶寬。由于硬件全部承擔(dān)了協(xié)議棧的處理，RapidIO減少了原來(lái)僅用于在系統(tǒng)中傳輸數(shù)據(jù)的寶貴DSP周期。”Shippen說(shuō)，“例如，多個(gè)飛思卡爾公司的StarCorebase
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軟件無(wú)線電技術(shù)與可重配置計(jì)算體系結(jié)構(gòu)

1．技術(shù)趨勢(shì)
　　現(xiàn)代無(wú)線通信的主體是移動(dòng)通信。參照ITU建議M1225，移動(dòng)通信是在復(fù)雜多變的移動(dòng)環(huán)境下工作的，因此必須考慮嚴(yán)重的時(shí)變和多徑傳播的影響。在現(xiàn)代無(wú)線通信系統(tǒng)中，特別是在碼分多址(CDMA)系統(tǒng)中，為了
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優(yōu)化FPGA功耗的設(shè)計(jì)技術(shù)

無(wú)論從微觀到宏觀、從延長(zhǎng)電池壽命到減少全球變暖的溫室效應(yīng)等等，各種不同因素都在迅速推動(dòng)系統(tǒng)設(shè)計(jì)人員關(guān)注節(jié)能問(wèn)題。一項(xiàng)有關(guān)設(shè)計(jì)優(yōu)先考慮事項(xiàng)的最新調(diào)查指出，大部分工程師已把功耗排在首位，或者是將其緊跟在
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多天線多載波的數(shù)字上下變頻的FPGA實(shí)現(xiàn)

本文的主要目的就是介紹多天線多載波數(shù)字上下變頻的FPGA實(shí)現(xiàn)方法,以及Altera提供的一種數(shù)字信號(hào)處理的工具,DSP BUILDER。
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海思將在網(wǎng)絡(luò)設(shè)備芯片中使用Tensilica的DPU和DSP內(nèi)核

　　Tensilica日前宣布，授權(quán)海思半導(dǎo)體Xtensa系列可配置數(shù)據(jù)處理器(DPU)及ConnX™ DSP(數(shù)據(jù)信號(hào)處理)IP核。海思將在網(wǎng)絡(luò)設(shè)備芯片的設(shè)計(jì)中使用Tensilica的DPU和DSP內(nèi)核。　　海思半導(dǎo)體副總裁Teresa He表示：“在選擇Tensilica之前我們對(duì)可授權(quán)的DSP IP核進(jìn)行了全面的考察和評(píng)估。Tensilica 公司的Xtensa系列DPU在提供世界一流DSP性能的同時(shí)又擁有卓越的靈活性和可配置性，給予海思半導(dǎo)體產(chǎn)品很強(qiáng)的差異化能力，帶給我
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Altera 40-nm Arria II GX FPGA轉(zhuǎn)入量產(chǎn)

　　Altera公司今天宣布，開(kāi)始量產(chǎn)發(fā)售40-nm Arria® II GX FPGA系列的第一款器件。Arria II GX器件系列專門針對(duì)3-Gbps收發(fā)器應(yīng)用，為用戶提供了低功耗、低成本和高性能FPGA解決方案。廣播、無(wú)線和固網(wǎng)市場(chǎng)等多種大批量應(yīng)用目前廣泛采用了Arria II GX FPGA。　　Arria II GX FPGA現(xiàn)在量產(chǎn)發(fā)售EP2AGX45和EP2AGX65，它們分別具有45K邏輯單元(LE)和65K LE。對(duì)于接入設(shè)備、遠(yuǎn)程射頻前端、HD視頻攝像機(jī)和保密設(shè)備等低成本
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