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基于FPGA的多路模擬信號(hào)源設(shè)計(jì)與實(shí)現(xiàn)

0引言隨著遙測(cè)系統(tǒng)的不斷發(fā)展，系統(tǒng)復(fù)雜程度也隨之提高，因此在終端設(shè)計(jì)中，對(duì)信號(hào)源的頻率穩(wěn)定度、幅...
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用FPGA技術(shù)實(shí)現(xiàn)模擬雷達(dá)信號(hào)

前言FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列）是由掩膜可編程門(mén)陣列和PLD（可編程邏輯器件）演變而來(lái)的，并將二者的特性結(jié)合在一起，使FPGA既有掩膜可編程門(mén)陣列的高邏輯密度和通用性，又有PLD的可編程特性。FPAG技術(shù)的發(fā)展使得單個(gè)
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基于FPGA的AES算法芯片設(shè)計(jì)實(shí)現(xiàn)

引言密碼模塊作為安全保密系統(tǒng)的重要組成部分，其核心任務(wù)就是加密數(shù)據(jù)。分組密碼算法AES以其高效率、低開(kāi)銷、實(shí)現(xiàn)簡(jiǎn)單等特點(diǎn)目前被廣泛應(yīng)用于密碼模塊的研制中。密碼模塊一般被設(shè)計(jì)成外接在主機(jī)串口或并口的一個(gè)硬件
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2009年8月20日，Altera與駿龍簽署6個(gè)東南亞國(guó)家分銷協(xié)議

　　Altera公司今天宣布，與駿龍環(huán)球有限公司簽署了6個(gè)東南亞國(guó)家的分銷協(xié)議。駿龍環(huán)球有限公司現(xiàn)在是Altera在新加坡、馬來(lái)西亞、泰國(guó)、菲律賓、印度尼西亞和越南的授權(quán)代理商。這一擴(kuò)展協(xié)議完善了Altera在亞太地區(qū)現(xiàn)有的分銷網(wǎng)絡(luò)。　　Altera公司亞太區(qū)副總裁兼董事總經(jīng)理Erhaan Shaikh表示：“我們看到東南亞地區(qū)有強(qiáng)勁的增長(zhǎng)，設(shè)計(jì)工作也越來(lái)越多，相信與駿龍公司簽署擴(kuò)展協(xié)議會(huì)進(jìn)一步增強(qiáng)對(duì)客戶的服務(wù)和技術(shù)支持。駿龍公司優(yōu)秀的銷售和現(xiàn)場(chǎng)應(yīng)用團(tuán)隊(duì)與Altera在中國(guó)合作了多年，我相
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溫總理調(diào)研國(guó)家IC設(shè)計(jì)無(wú)錫產(chǎn)業(yè)化基地

　　8月7日至9日，中共中央政治局常委、國(guó)務(wù)院總理溫家寶在江蘇就經(jīng)濟(jì)運(yùn)行情況進(jìn)行調(diào)查研究。他指出，在當(dāng)前我國(guó)經(jīng)濟(jì)發(fā)展企穩(wěn)向好的形勢(shì)下，中央強(qiáng)調(diào)要保持宏觀經(jīng)濟(jì)政策的連續(xù)性和穩(wěn)定性，堅(jiān)持實(shí)施積極的財(cái)政政策和適度寬松的貨幣政策不動(dòng)搖，要把保持經(jīng)濟(jì)平穩(wěn)較快發(fā)展與調(diào)整經(jīng)濟(jì)結(jié)構(gòu)結(jié)合起來(lái)，以平穩(wěn)較快的經(jīng)濟(jì)發(fā)展為結(jié)構(gòu)調(diào)整提供基礎(chǔ)，創(chuàng)造條件，通過(guò)轉(zhuǎn)變發(fā)展方式，調(diào)整經(jīng)濟(jì)結(jié)構(gòu)使經(jīng)濟(jì)發(fā)展更具有可持續(xù)性和競(jìng)爭(zhēng)力。　　8月7日下午，溫家寶一行來(lái)到國(guó)家集成電路設(shè)計(jì)無(wú)錫產(chǎn)業(yè)化基地考察調(diào)研。位于無(wú)錫國(guó)家高新區(qū)長(zhǎng)江路的無(wú)錫國(guó)家IC設(shè)計(jì)產(chǎn)
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FPGA：65nm器件上量低功耗市場(chǎng)興起

　　隨著65nm工藝的應(yīng)用以及更多低功耗技術(shù)的采用，F(xiàn)PGA擁有了更低的成本、更高的性能以及突破性的低耗電量，具備進(jìn)入更廣泛市場(chǎng)的條件。FPGA從業(yè)者表示，今年FPGA快速增長(zhǎng)，而預(yù)計(jì)明年仍將是一個(gè)增長(zhǎng)年。　　比拼65nm器件加快45nm研發(fā) 　　就像兩三年前，可編程邏輯器件領(lǐng)域的兩大廠商在90nm器件上進(jìn)行大比拼一樣，2007年，這兩家企業(yè)Xilinx和Altera又在新一代技術(shù)節(jié)點(diǎn)65nm器件上開(kāi)始了競(jìng)賽。一方面Xilinx宣稱他們比競(jìng)爭(zhēng)對(duì)手領(lǐng)先推出了65nm器件，另一方面Altera則在宣布推
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關(guān)于C64x+ DSP高速緩存一致性分析與維護(hù)

高速緩存(CACHE)作為內(nèi)核和低速存儲(chǔ)器之間的橋梁，基于代碼和數(shù)據(jù)的時(shí)間和空間相關(guān)性，以塊為單位由硬件控制器...
關(guān)鍵字： TI C64x+ DSP 高速緩存

ADI DSP生態(tài)系統(tǒng)：一個(gè)有關(guān)共贏共生的成功故事

　　就像狄更斯在《雙城記》中富有哲理的一段話：“這是最好的時(shí)代，這是最壞的時(shí)代……這是希望之春，這是失望之冬……”事情總是有它的兩面性，與其讓經(jīng)濟(jì)衰退、裁員浪潮、股市低迷等各種負(fù)面消息繼續(xù)影響你的情緒，不如收拾心情好好研究合作、創(chuàng)新之道，或者充電加油，以便為更慘烈的競(jìng)爭(zhēng)和下一輪復(fù)蘇做好準(zhǔn)備。　　如何更加高效并以更低的成本獲得創(chuàng)新、技術(shù)營(yíng)銷的啟發(fā)或培訓(xùn)的機(jī)會(huì)，IC供應(yīng)商或許是一個(gè)不錯(cuò)的選擇。除了日常與他們的銷售代表或技術(shù)支持
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流水線技術(shù)在基于FPGA的DSP運(yùn)算中的應(yīng)用研究

流水線技術(shù)是FPGA設(shè)計(jì)速度優(yōu)化的有效方法之一。通過(guò)不同流水線級(jí)數(shù)和不同位寬的加法器和乘法器綜合數(shù)據(jù)的對(duì)比，說(shuō)明在用FPGA實(shí)現(xiàn)數(shù)字信號(hào)處理硬件化運(yùn)算中流水線技術(shù)的有效性和選擇方法。對(duì)流水線應(yīng)用中設(shè)計(jì)方法的選擇、流水線首次延時(shí)和寄存器觸發(fā)時(shí)間、嵌入式存儲(chǔ)器塊的使用、控制流水線和數(shù)據(jù)流水線的劃分等需要注意的關(guān)鍵問(wèn)題進(jìn)行了簡(jiǎn)要分析。
關(guān)鍵字： FPGA DSP 流水線技術(shù) 運(yùn)算

基于W5100的DSP快速網(wǎng)絡(luò)接入解決方案

現(xiàn)代數(shù)據(jù)采集領(lǐng)域中，越來(lái)越多的現(xiàn)場(chǎng)采集設(shè)備需要擴(kuò)展網(wǎng)絡(luò)功能以實(shí)現(xiàn)遠(yuǎn)程控制和數(shù)據(jù)傳輸。以太網(wǎng)以其低成本，易于集成，傳輸距離遠(yuǎn)的優(yōu)勢(shì)使其得到了廣泛應(yīng)用。
關(guān)鍵字： W5100 DSP 網(wǎng)絡(luò)接入方案

基于DSP_C54X窄帶中頻抽樣的理論與實(shí)現(xiàn)

關(guān)鍵字： DSP 中頻窄帶抽樣帶通抽樣

TMS320F2812與DIP-IPM的通用電路設(shè)計(jì)

關(guān)鍵字： DSP DIP-IPM SPWM 變頻調(diào)速

基于EDA技術(shù)的FPGA設(shè)計(jì)計(jì)算機(jī)應(yīng)用

對(duì)傳統(tǒng)電子系統(tǒng)設(shè)計(jì)方法與現(xiàn)代電子系統(tǒng)設(shè)計(jì)方法進(jìn)行了比較,引出了基于EDA技術(shù)的現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)電路,提出現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA) 是近年來(lái)迅速發(fā)展的大規(guī)?？删幊虒Ｓ眉呻娐?ASIC),在數(shù)字系統(tǒng)設(shè)計(jì)和控制電路
關(guān)鍵字： FPGA EDA 計(jì)算機(jī)應(yīng)用

Altera在中國(guó)成立第66家聯(lián)合實(shí)驗(yàn)室和培訓(xùn)中心

　　Altera公司今天宣布，在北京大學(xué)軟件與微電子學(xué)院無(wú)錫產(chǎn)學(xué)院成立新的聯(lián)合實(shí)驗(yàn)室 (EDA/SOPC)。這是Altera與中國(guó)大學(xué)一起建立的第66家聯(lián)合實(shí)驗(yàn)室和培訓(xùn)中心。作為Altera全球大學(xué)計(jì)劃的一部分，該聯(lián)合實(shí)驗(yàn)室配備了最新的Altera? Quartus? II設(shè)計(jì)軟件和40套Altera DE2-70開(kāi)發(fā)套件，以幫助教師指導(dǎo)學(xué)生進(jìn)行實(shí)踐練習(xí)。　　學(xué)院將利用聯(lián)合實(shí)驗(yàn)室完成相關(guān)課程的培訓(xùn)，包括數(shù)字邏輯電路、HDL語(yǔ)言、計(jì)算機(jī)原理、電視原理以及Altera FPGA開(kāi)發(fā)環(huán)境下的
關(guān)鍵字： Altera Quartus 數(shù)字邏輯電路 HDL語(yǔ)言 FPGA

基于FPGA的多路模擬信號(hào)源設(shè)計(jì)

提出了一種基于FPGA的多路模擬量信號(hào)源設(shè)計(jì)方法。該系統(tǒng)以Altera公司的Cyclone系列EP2C8為核心。它包括多路數(shù)模轉(zhuǎn)換單元、電源隔離、穩(wěn)壓?jiǎn)卧斑\(yùn)算放大單元等，實(shí)現(xiàn)了電源獨(dú)立的不同頻率、不同波形的多路模擬量信號(hào)源。主要模塊采用VHDL實(shí)現(xiàn)，通過(guò)合理利用路選通信號(hào)對(duì)各路模擬量信號(hào)進(jìn)行鎖存，實(shí)現(xiàn)了各路數(shù)據(jù)的正確分路，各路模擬量波形輸出，并通過(guò)USB接口上傳數(shù)據(jù)并實(shí)時(shí)顯示，經(jīng)多次測(cè)試表明，該系統(tǒng)穩(wěn)定可靠，每路輸出電壓紋波小于30 mV。
關(guān)鍵字： FPGA 多路模擬信號(hào)源