球可編程平臺領導廠商賽靈思公司與Vanguard Software Solutions 公司 (VSofts) 在 IBC2010 大會上聯(lián)合演示了 VSofts H.264/AVC-I IP 核的強大功能：能實現超低延時，且其現場可編程門陣列 (FPGA) 實施方案不僅符合國際電信聯(lián)盟 (ITU) 和 Panasonic AVC-Intra 標準，而且還支持業(yè)界標準的編解碼器，能在實時視頻廣播應用中確保源視頻到編碼視頻的最小延遲。
VSofts 市場營銷副總裁 Felix Nemirovsky
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賽靈思 FPGA IP核
美國國家儀器有限公司(National Instruments，簡稱NI)近日發(fā)布NI 9157和NI 9159 MXI-Express RIO機箱，以及NI 9148以太網RIO機箱，這三款新產品在現有的NI 9144 EtherCAT機箱基礎上，進一步擴展了NI基于各種總線的高通道數擴展機箱系列產品。利用NI可重配置I/O(RIO)技術，這些機箱將基于現場可編程門陣列(FPGA)的硬件和C系列I/O應用到了需要數百甚至數千通道數的應用。每一個擴展機箱含有一個可用NI LabVIEW FPGA模塊編
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NI FPGA LabVIEW
針對DDS頻率轉換時間短，分辨率高等優(yōu)點，提出了基于FPGA芯片設計DDS系統(tǒng)的方案。該方案利用A1tera公司的QuartusⅡ開發(fā)軟件，完成DDS核心部分即相位累加器和ROM查找表的設計，可得到相位連續(xù)、頻率可變的信號，并通過單片機配置FPGA的E2PROM完成對DDS硬件的下載，最后完成每個模塊與系統(tǒng)的時序仿真。經過電路設計和模塊仿真，驗證了設計的正確性。由于FPGA的可編程性，使得修改和優(yōu)化DDS的功能非?？旖?。
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FPGA DDS
對于任何半導體廠商來講，低功耗永遠是其追求的目標，DSP廠商也是如此。ADI及TI兩大DSP主要供貨商日前先后推出了其最新的低功耗DSP處理器，瞄準滿足移動、工業(yè)等對于功耗及價格敏感的應用。
ADI公司處理器及DSP技術部市場總監(jiān)Colin Duggan表示，ADI BF592目標市場主要包括，條碼掃描儀、智能計算、音頻處理、手持式設備、自動外部除顫器及駕駛員輔助系統(tǒng)等，而尤其適用于目前的智能儀表中。
“由于不同國家有不同的要求，且軟件無線電標準正在制定之中，因此需要具備足夠的
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ADI DSP
愛特公司(Actel CorporaTIon) 宣布其多種FPGA產品現可搭配使用加密內核，對抗差分功率分析(differential Power analysis, DPA)攻擊。采用SmartFusion、Fusion、ProASIC3和 IGLOO的設計人員現可通過使用IP Cores公司(IP Cores, Inc.)的AES、GCM或ECC IP內核，保護其密鑰不受DPA攻擊。IP Cores是專業(yè)提供主要用于安全和加密領域的半導體用IP內核的供應商，而這些內核則是首次商業(yè)化地用于FPGA的
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Actel FPGA
ADI)，全球領先的高性能信號處理解決方案供應商，最近推出800MMAC/400MHz性能的Blackfin ADSP-BF592，萬片訂量售價僅3美元/片。Blackfin BF592的活動功耗低至88 mW，采用小型9 mm x 9 mm 64引腳LFCSP封裝，該產品的問世使得許多具有功耗限制的小尺寸應用也能集成高性能DSP(數字信號處理器)，充分滿足工業(yè)、醫(yī)療、視頻、音頻和通用市場的需求。
ADI公司DSP處理器核心技術部門業(yè)務開發(fā)經理Richard Murphy表示：“低成
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ADI Blackfin DSP
空分復用 (SDM) MIMO 處理可顯著提高頻譜效率，進而大幅增加無線通信系統(tǒng)的容量?？辗謴陀?MIMO 通信系統(tǒng)作為一種能夠大幅提升無線系統(tǒng)容量和連接可靠性的手段，近來吸引了人們的廣泛關注。 MIMO 無線系統(tǒng)最
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系統(tǒng) 應用 FPGA 實現 通信 MIMO 檢測 空分 復用 球形
基于Java的FPGA可編程嵌入式系統(tǒng), 傳統(tǒng)的嵌入式產品只能實現某種特定的功能，不能滿足用戶可變的豐富多彩的應用需求。為解決這個問題，本文設計并實現了一種使用Java作為軟件平臺的基于FPGA的可編程嵌入式系統(tǒng)，以實現系統(tǒng)對多種本地應用和網絡的
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嵌入式 系統(tǒng) 可編程 FPGA Java 基于
FPGA/CPLD狀態(tài)機的穩(wěn)定性設計, 隨著大規(guī)模和超大規(guī)模FPGA/CPLD器件的誕生和發(fā)展,以HDL(硬件描述語言)為工具、FPGA/CPLD器件為載體的EDA技術的應用越來越廣泛.從小型電子系統(tǒng)到大規(guī)模SOC(Systemonachip)設計,已經無處不在.在FPGA/CPLD設計中,狀
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設計 穩(wěn)定性 狀態(tài) FPGA/CPLD
FPGA全局時鐘資源相關原語及使用, FPGA全局時鐘資源一般使用全銅層工藝實現，并設計了專用時鐘緩沖與驅動結構，從而使全局時鐘到達芯片內部的所有可配置單元(CLB)、I/O單元(IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應復雜
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相關 使用 資源 時鐘 全局 FPGA
PXI總線是NI公司在計算機外設總線PCI的基礎上實現的新一代儀器總線，已經成為業(yè)界開放式總線的標準，基于PX...
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PXI LVDS 數字化儀模塊 FPGA
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