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fpga+dsp 文章 最新資訊

基于FPGA的高速卷積的硬件設(shè)計(jì)實(shí)現(xiàn)

  • 基于FPGA的高速卷積的硬件設(shè)計(jì)實(shí)現(xiàn),　在數(shù)字信號(hào)處理領(lǐng)域，離散時(shí)間系統(tǒng)的輸出響應(yīng)，可以直接由輸入信號(hào)與系統(tǒng)單位沖激響應(yīng)的離散卷積得到。離散卷積在電子通信領(lǐng)域應(yīng)用廣泛，是工程應(yīng)用的基礎(chǔ)。如果直接在時(shí)域進(jìn)行卷積，卷積過(guò)程中所必須的大量乘法和
  • 關(guān)鍵字： 設(shè)計(jì)  實(shí)現(xiàn)  硬件  高速  FPGA  基于  

基于單片機(jī)和FPGA的位移測(cè)量裝置的設(shè)計(jì)

  • 摘要：基于電感式傳感器測(cè)量磁芯位移的原理，以單片機(jī)和FPGA為控制中心，由DDS產(chǎn)生的正弦信號(hào)經(jīng)差分放大，并經(jīng)過(guò)差動(dòng)變壓器的差分耦合，對(duì)兩路輸出信號(hào)放大整流后，采集數(shù)據(jù)，對(duì)所得的數(shù)據(jù)進(jìn)行處理，實(shí)現(xiàn)了磁芯位
  • 關(guān)鍵字： 傳感器  LCD  單片機(jī)  FPGA  

基于TMS320DM642 的X264 視頻編碼器的優(yōu)化

  • 【摘要】簡(jiǎn)單介紹了TMS320DM642 數(shù)字信號(hào)處理器的硬件構(gòu)成， 簡(jiǎn)要給出了DSP 平臺(tái)的程序優(yōu)化一般流程。著重研究了TMS320DM642 平臺(tái)優(yōu)化X264 視頻編碼器，包括算法與系統(tǒng)結(jié)構(gòu)優(yōu)化，乒乓緩存優(yōu)化，循環(huán)體的優(yōu)化以及D
  • 關(guān)鍵字： 視頻  DSP  

用CPLD實(shí)現(xiàn)嵌入式平臺(tái)上的實(shí)時(shí)圖像增強(qiáng)

  • 用CPLD實(shí)現(xiàn)嵌入式平臺(tái)上的實(shí)時(shí)圖像增強(qiáng), 提出了在嵌入式平臺(tái)上用CPLD實(shí)現(xiàn)實(shí)時(shí)圖像增強(qiáng)算法的解決方案,并加以實(shí)現(xiàn)#65377;重點(diǎn)討論了經(jīng)過(guò)改進(jìn)的圖像增強(qiáng)算法以及使用CPLD實(shí)現(xiàn)的具體方法,介紹了所采用的嵌入式平臺(tái)的總體結(jié)構(gòu)#65377;

    通常,在擁有DSP或
  • 關(guān)鍵字： DSP  CPLD  FPGA  

基于DSP的單兵背負(fù)式短波數(shù)字通信系統(tǒng)

  • 基于DSP的單兵背負(fù)式短波數(shù)字通信系統(tǒng),二十一世紀(jì)的戰(zhàn)爭(zhēng)將以數(shù)字化戰(zhàn)場(chǎng)為背景,而數(shù)字化戰(zhàn)場(chǎng)的一個(gè)重要特點(diǎn)是信息可以直達(dá)單個(gè)士兵。采用基于軟件無(wú)線(xiàn)電的思想,應(yīng)用第三代數(shù)字信號(hào)處理器 TMS320C31和數(shù)模轉(zhuǎn)換芯片TLC32044等器件構(gòu)成短波自適應(yīng)調(diào)制解調(diào)器的
  • 關(guān)鍵字： DSP  通信  A/D  存儲(chǔ)器  電池  

實(shí)時(shí)視頻數(shù)據(jù)采集的FPGA實(shí)現(xiàn)

  • 摘 要： 介紹一種在工礦監(jiān)視系統(tǒng)中采用FPGA實(shí)現(xiàn)視頻數(shù)據(jù)實(shí)時(shí)采集和顯示的設(shè)計(jì)方案。系統(tǒng)中采用FPGA和視頻解碼器實(shí)現(xiàn)了高速連續(xù)的視頻數(shù)據(jù)采集與處理。處理后的視頻信號(hào)通過(guò)VGA格式轉(zhuǎn)換，可以在現(xiàn)場(chǎng)VGA顯示器
  • 關(guān)鍵字： FPGA  實(shí)時(shí)視頻  數(shù)據(jù)采集    

一種多光譜可見(jiàn)光遙感圖像壓縮系統(tǒng)設(shè)計(jì)

  • 摘要：為了實(shí)現(xiàn)多光譜可見(jiàn)光遙感圖像高質(zhì)量壓縮的要求，提出以JPEG2000壓縮標(biāo)準(zhǔn)為理論，將FPGA與專(zhuān)用壓縮芯片...
  • 關(guān)鍵字： 遙感圖像  JPEG2000  ADV212  FPGA  

基于ADSP-TS201S的多DSP并行系統(tǒng)設(shè)計(jì)

  • 基于ADSP-TS201S的多DSP并行系統(tǒng)設(shè)計(jì),摘要：為滿(mǎn)足寬帶雷達(dá)信號(hào)處理對(duì)處理速度和實(shí)時(shí)性的要求，提出一種基于4片ADSP-TS201S的DSP并行系統(tǒng)設(shè)計(jì)。通過(guò)分析比較3種ADSP-TS2 01S的并行處理結(jié)構(gòu)，結(jié)合實(shí)際需求，采用外部總線(xiàn)共享與鏈路口混合耦合的多DSP并
  • 關(guān)鍵字： DSP  FPGA  

基于DSP的OQPSK調(diào)制器設(shè)計(jì)與實(shí)現(xiàn)

  • 針對(duì)OQPSK(偏移正交相移鍵控)調(diào)制原理，提出了在C54系列DSP處理器上實(shí)現(xiàn)OQPSK調(diào)制器的一種新方案，給出了其在CCS(C5000)開(kāi)發(fā)環(huán)境下的仿真波形并在硬件平臺(tái)上進(jìn)行了實(shí)驗(yàn)驗(yàn)證。實(shí)驗(yàn)表明，所設(shè)計(jì)的調(diào)制器具有體積小、功耗低及穩(wěn)定可靠等優(yōu)點(diǎn)。
  • 關(guān)鍵字： 設(shè)計(jì)  實(shí)現(xiàn)  調(diào)制器  OQPSK  DSP  基于  

DDS原理及基于FPGA的實(shí)現(xiàn)

  • 本文主要介紹了DDS的原理及通過(guò)FPGA來(lái)實(shí)現(xiàn)。
  • 關(guān)鍵字： FPGA  DDS  原理    

基于FPGA的卷積碼的編/譯碼器設(shè)計(jì)

嵌入式系統(tǒng)設(shè)計(jì)與應(yīng)用 使用SBC和DSP

  • 嵌入式系統(tǒng)設(shè)計(jì)與應(yīng)用 使用SBC和DSP,1 引言

    嵌入式系統(tǒng)是以應(yīng)用為中心、以計(jì)算機(jī)技術(shù)為基礎(chǔ)、軟硬件可裁剪、適應(yīng)應(yīng)用系統(tǒng)對(duì) 功能、可靠性、成本、體積、功耗等有嚴(yán)格要求的專(zhuān)用計(jì)算機(jī)系統(tǒng)。其主要由嵌入式處理器、 相關(guān)支撐硬件、嵌入式操作系統(tǒng)及應(yīng)
  • 關(guān)鍵字： DSP  

多光譜可見(jiàn)光遙感圖像壓縮系統(tǒng)設(shè)計(jì)

  • 摘要：為了實(shí)現(xiàn)多光譜可見(jiàn)光遙感圖像高質(zhì)量壓縮的要求，提出以JPEG2000壓縮標(biāo)準(zhǔn)為理論，將FPGA與專(zhuān)用壓縮芯片ADV212相結(jié) 合的空間遙感圖像壓縮方法。該系統(tǒng)設(shè)計(jì)采用ADV212，通過(guò)小波變換及熵編碼實(shí)現(xiàn)對(duì)大數(shù)據(jù)量的空間
  • 關(guān)鍵字： RAM  FPGA  AD  
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