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Altera發(fā)布業(yè)界首款40nmFPGA

　　Altera公司近日發(fā)布了業(yè)界首款40nmFPGA(現(xiàn)場(chǎng)可編程門陣列)和HardCopyASIC(專用集成電路)。兩者都提供收發(fā)器，在密度、性能和低功耗上遙遙領(lǐng)先。　　StratixIV系列有680K邏輯單元，比Altera的StratixIII系列高兩倍，是目前市場(chǎng)上密度最大的FPGA。器件滿足了眾多市場(chǎng)對(duì)各種高端應(yīng)用的需求，例如無(wú)線和有線通信、廣播和ASIC原型開發(fā)等。
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基于DSP和USB技術(shù)的數(shù)據(jù)采集與處理系統(tǒng)

采用DSP(數(shù)字信號(hào)處理器)作為控制器，而采用USB(通用串行總線)和上位機(jī)相連接將是數(shù)據(jù)采集處理系統(tǒng)的一種可能的發(fā)展趨勢(shì)。
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IPTV生態(tài)系統(tǒng)和基于DSP的IP機(jī)頂盒設(shè)計(jì)

　　隨著IPTV市場(chǎng)準(zhǔn)備起飛，競(jìng)爭(zhēng)生態(tài)系統(tǒng)數(shù)量的增加意味著STB開發(fā)商必須保持他們的實(shí)現(xiàn)方案選項(xiàng)具備開放性。　　未來(lái)幾年，由電信業(yè)務(wù)提供商推動(dòng)的IPTV市場(chǎng)(利用互聯(lián)網(wǎng)協(xié)議傳輸數(shù)字電視)有望形成規(guī)模。然而，目前該市場(chǎng)陷入了各種硬件和軟件解決方案的競(jìng)爭(zhēng)之中，不同種類的壓縮技術(shù)非常復(fù)雜，并與家庭網(wǎng)絡(luò)應(yīng)用存在潛在的融合。這些因素使工程師在設(shè)計(jì)IP機(jī)頂盒的時(shí)候面臨決策困難，所以原始設(shè)備制造商(OEM)需要選擇處理技術(shù)，以使他們保持實(shí)現(xiàn)方案選項(xiàng)的開放性。　　作為傳輸方案的焦點(diǎn)，STB必須能夠適應(yīng)它要部署的特
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基于FPGA的PCB測(cè)試機(jī)硬件電路設(shè)計(jì)

　　引言　　PCB 光板測(cè)試機(jī)基本的測(cè)試原理是歐姆定律，其測(cè)試方法是將待測(cè)試點(diǎn)間加一定的測(cè)試電壓，用譯碼電路選中PCB 板上待測(cè)試的兩點(diǎn)，獲得兩點(diǎn)間電阻值對(duì)應(yīng)的電壓信號(hào)，通過電壓比較電路，測(cè)試出兩點(diǎn)間的電阻或通斷情況。重復(fù)以上步驟多次，即可實(shí)現(xiàn)對(duì)整個(gè)電路板的測(cè)試。　　由于被測(cè)試的點(diǎn)數(shù)比較多，一般測(cè)試機(jī)都在2048點(diǎn)以上，測(cè)試控制電路比較復(fù)雜，測(cè)試點(diǎn)的查找方法以及切換方法直接影響測(cè)試機(jī)的測(cè)試速度，本文研究了基于FPGA的硬件控制系統(tǒng)設(shè)計(jì)。　　硬件控制系統(tǒng) 　　測(cè)試過程是在上位計(jì)算機(jī)的控制下
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基于最佳接收的UART的設(shè)計(jì)與實(shí)現(xiàn)

　　在嵌入式系統(tǒng)設(shè)計(jì)中常使用通用異步接收和發(fā)送器UART(Universal Asynchronous Receiver/Transmitter)實(shí)現(xiàn)系統(tǒng)控制信息或低速數(shù)據(jù)信息的傳輸，而UART所采用的奇偶校驗(yàn)方式不具備前向糾錯(cuò)能力，檢錯(cuò)能力也有限，所以在設(shè)計(jì)UART時(shí)要盡可能提高其抗干擾能力，以加強(qiáng)系統(tǒng)的可靠性。　　1 基于最佳接收的UART 　　目前UART中的接收器多采用如圖1所示的設(shè)計(jì)。　　同步模塊
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用雙端口RAM實(shí)現(xiàn)與PCI總線接口的數(shù)據(jù)通訊

　　采用雙端口RAM實(shí)現(xiàn)DSP與PCI總線芯片之間的數(shù)據(jù)交換接口電路。　　提出了一種使用CPLD解決雙端口RAM地址譯碼和PCI接口芯片局部總線仲裁的的硬件設(shè)計(jì)方案，并給出了PCI總線接口芯片寄存器配置實(shí)例，介紹了軟件包WinDriver開發(fā)設(shè)備驅(qū)動(dòng)程序的具體過程。　　隨著計(jì)算機(jī)技術(shù)的不斷發(fā)展，為滿足外設(shè)間以及外設(shè)與主機(jī)間的高速數(shù)據(jù)傳輸，Intel公司于1991年提出了PCI總線概念。PCI總線是一種能為主CPU及外設(shè)提供高性能數(shù)據(jù)通訊的總線，其局部總線在33MHz總線時(shí)鐘、32位數(shù)據(jù)通路時(shí)，數(shù)據(jù)
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FPGA競(jìng)爭(zhēng)好像在演戲（下）

　　你是否有過這樣的經(jīng)歷：見到一個(gè)人后，整個(gè)世界一下子明亮起來(lái)。所謂的“華堂升輝”、人們所說的“光彩照人”，連又聾又瞎的海倫?凱勒都說“點(diǎn)亮了我心中的明燈”。　　如果你還沒有這樣的經(jīng)歷，建議你去接觸一下FPGA界的人士吧！在半導(dǎo)體業(yè)的星光大道上，F(xiàn)PGA行業(yè)絕對(duì)是個(gè)群星燦爛的領(lǐng)域。激發(fā)你獲得靈感。　　筆者多年前去美國(guó)參加一個(gè)會(huì)議，整日浸泡在英語(yǔ)的海洋中，非常boring。因此當(dāng)采訪了A公司和Q公司的市場(chǎng)人員，深受震撼。他們都是高大健美，高高的鼻梁，深邃的眼睛，年齡三、四十，你隨便提
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基于DSP和USB的高速數(shù)據(jù)采集與處理系統(tǒng)設(shè)計(jì)

介紹了一種基于DSP與USB的高速數(shù)據(jù)采集與處理系統(tǒng)，包括整個(gè)系統(tǒng)的硬件設(shè)計(jì)與軟件設(shè)計(jì)。DSP控制整個(gè)系統(tǒng)完成CCD信號(hào)采集并進(jìn)行小波變換去噪處理，F(xiàn)PGA協(xié)同DSP實(shí)現(xiàn)整個(gè)系統(tǒng)的地址譯碼和邏輯控制。主機(jī)應(yīng)用程序通過USB完成與DSP的數(shù)據(jù)通信，實(shí)現(xiàn)整個(gè)采集的控制和數(shù)據(jù)顯示。這種高速的數(shù)據(jù)采集與處理系統(tǒng)，可廣泛地應(yīng)用于各種智能儀表、自動(dòng)化控制設(shè)備中，有著非常好的市場(chǎng)應(yīng)用前景。
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基于DSP的DGPS導(dǎo)航定位系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

介紹了DCPS導(dǎo)航定位系統(tǒng)的工作原理，提出了一種基于DSP的DGPS系統(tǒng)設(shè)計(jì)方案。通過開發(fā)以DSP為核心的軟硬件系統(tǒng)，與GPS接收機(jī)和無(wú)線數(shù)據(jù)收發(fā)設(shè)備共同組建了DGPS精確定位系統(tǒng)。
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基于MCU+DSP的運(yùn)動(dòng)控制硬件平臺(tái)設(shè)計(jì)

　 ? 　　引言　　開放式控制器體系結(jié)構(gòu)源于“開放式”的PC(個(gè)人計(jì)算機(jī)) 技術(shù), 目前的開放式運(yùn)動(dòng)控制器多為PC+運(yùn)動(dòng)控制卡結(jié)構(gòu), 隨著MCU(微控制器) 和DSP(數(shù)字信號(hào)處理器)性能的增強(qiáng), MUC和DSP取代PC的趨勢(shì)日趨明顯, 而這種嵌入式的緊湊結(jié)構(gòu)較PC有更廣泛的環(huán)境適應(yīng)性。MCU、DSP和PC差異較大, PC環(huán)境中的運(yùn)動(dòng)控制技術(shù)不可能直接向MCU和DSP系統(tǒng)中轉(zhuǎn)移, 基于MCU和DSP硬件平臺(tái)的運(yùn)動(dòng)控制技術(shù)的研究十分必要。　　設(shè)計(jì)目標(biāo)與需求分析
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FPGA競(jìng)爭(zhēng)好像在演戲（中）

　　辭職頻繁　　一個(gè)月前，X公司的VP來(lái)京和記者朋友們親切交談、共進(jìn)午餐，大談X公司的發(fā)展前途，由于出差在外而沒有機(jī)會(huì)赴此盛宴的媒體人都十分惋惜。可沒想到幾周后，他卻悄然辭職了。　　兩年前，A公司負(fù)責(zé)中國(guó)業(yè)務(wù)的B總來(lái)京慷慨激昂地講演，展望FPGA美好的未來(lái)，回去后記者賣力地寫稿稱頌。但是令人費(fèi)解的是，幾個(gè)月后在處理另一篇邀請(qǐng)函時(shí)，發(fā)現(xiàn)B總怎么成了另一家新公司的老總？打電話一問，才知道B君已辭職，自己創(chuàng)辦了這家公司。　　“投敵叛變” 　　最令人難以理解的是，互相跳到競(jìng)爭(zhēng)
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一種基于分層級(jí)連DSP陣列技術(shù)的電子浮標(biāo)設(shè)計(jì)

　　和其他水下目標(biāo)探測(cè)裝備（如艇殼聲納、拖線陣聲納等）相比，電子浮標(biāo)由于沒有本艦噪聲的影響，對(duì)水下目標(biāo)的探測(cè)靈敏度高；此外它可通過飛機(jī)布放和回收，具有搜索面積大、偵察效率高、使用方便等優(yōu)點(diǎn)，已成為偵察、反潛領(lǐng)域的重要裝備。而將多個(gè)浮標(biāo)組成網(wǎng)絡(luò)，就可對(duì)大范圍海域進(jìn)行監(jiān)視。目前，作為數(shù)字化海洋的重要組成部分，電子浮標(biāo)已成世界海洋國(guó)家不惜巨資進(jìn)行開發(fā)的水下目標(biāo)監(jiān)測(cè)裝備。　　本文介紹了一種基于分層級(jí)連DSP陣列技術(shù)的電子浮標(biāo)設(shè)計(jì)方案，該方案通過微弱信號(hào)檢測(cè)技術(shù)來(lái)提取水下目標(biāo)的聲信號(hào)；通過差分GPS技術(shù)來(lái)給浮
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NI推出4種用于PXI平臺(tái)的新型R系列I/O模塊

　　2008年5月，美國(guó)國(guó)家儀器有限公司（簡(jiǎn)稱NI）推出4種用于PXI平臺(tái)的新型R系列 I/O模塊，這些模塊都配備了高性能的Xilinx Virtex-5現(xiàn)場(chǎng)可編程門陣列(FPGA)芯片。NI PXI-7841R, PXI-7842R, PXI-7851R 和PXI-7852R模塊具有8個(gè)模擬輸入、8個(gè)模擬輸出和96個(gè)數(shù)字I/O通道，而且模擬輸入的速率比以前版本的R系列設(shè)備快3.5倍以上。這些新型模塊為工程師和科學(xué)家們提供了即時(shí)可用的硬件；不僅如此，這些硬件還可通過NI LabVIEW FPGA軟件進(jìn)行圖
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Altera發(fā)布業(yè)界首款40-nm FPGA和HardCopy ASIC

? 　為幫助設(shè)計(jì)人員提高集成度，進(jìn)一步創(chuàng)新，Altera公司今天發(fā)布了業(yè)界的首款40-nm FPGA和HardCopy? ASIC。Stratix? IV FPGA和HardCopy IV ASIC都提供收發(fā)器，在密度、性能和低功耗上遙遙領(lǐng)先。Stratix IV系列有680K邏輯單元(LE)，比Altera的Stratix III系列高2倍，是目前市場(chǎng)上密度最大的FPGA。HardCopy IV ASIC系列在密度上和Stratix IV器件等價(jià)，具有1330萬(wàn)邏輯門。Alte
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德州儀器：2020年半導(dǎo)體發(fā)展趨勢(shì)

　　德州儀器(TI)開發(fā)商大會(huì)(TI Developer Conference)5月26日起在中國(guó)召開。本次大會(huì)依次在深圳、上海和北京舉辦，在深圳的首場(chǎng)報(bào)告中，TI 首席科學(xué)家方進(jìn) (Gene Frantz) 和與會(huì)者分享了2020年半導(dǎo)體產(chǎn)業(yè)發(fā)展趨勢(shì)，闡述科技將如何改變未來(lái)生活，并展示了一系列極富創(chuàng)意和前瞻性的嶄新思想，將大眾帶入2020年的未來(lái)科技世界。這是半導(dǎo)體科技界讓人充滿期望的一次盛宴。　　方進(jìn)指出，隨著對(duì)視訊影像、車用電子、通訊設(shè)備、工業(yè)應(yīng)用及醫(yī)療電子等相關(guān)應(yīng)用的需求提升，全球 DS
關(guān)鍵字：德州儀器 DSP 集成電路低功耗節(jié)能 SiP 機(jī)器人醫(yī)療電子