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cpld／fpga 文章 最新資訊

采用DSP與CPLD的三相五電平變頻器PWM脈沖發(fā)生器

  • 采用DSP與CPLD的三相五電平變頻器PWM脈沖發(fā)生器,1 引言　　近年來,多電平變換器成為電力電子研究的熱點(diǎn)之一,它主要面向中壓大功率的應(yīng)用場合。目前,有三種基本的多電平變換器拓?fù)浣Y(jié)構(gòu)[1]：①二極管箝位型;②飛跨電容型;③級聯(lián)型?！　追N拓?fù)浣Y(jié)構(gòu)各有其優(yōu)缺點(diǎn),但相
  • 關(guān)鍵字： PWM  脈沖  發(fā)生器  變頻器  電平  DSP  CPLD  三相五  采用  

基于單片機(jī)與FPGA可調(diào)延時(shí)模塊的設(shè)計(jì)

  • 系統(tǒng)結(jié)構(gòu)框圖如圖1。其硬件結(jié)構(gòu)比較簡單，主要由單片機(jī)P89C51RD、RS-232/TTL接口電路MAX232和可編程邏輯器件FPGA三部分組成。單片機(jī)P89C51RD2是上位PC機(jī)和FPGA的連接紐帶，它通過并口發(fā)送數(shù)據(jù)給FPGA，另一邊通過RS-2
  • 關(guān)鍵字： FPGA  單片機(jī)  可調(diào)延時(shí)模塊    

FPGA驅(qū)動LED靜態(tài)顯示和動態(tài)顯示的VHDL程序

  • 例1：FPGA驅(qū)動LED靜態(tài)顯示　　--文件名：decoder.vhd　　--功能：譯碼輸出模塊，LED為共陽接法　　--最后修改日期：2004.3.24　　library IEEE;　　use IEEE.STD_LOGIC_1164.ALL;　　use IEEE.STD_LOGIC_ARITH.ALL;　
  • 關(guān)鍵字： FPGA  VHDL  LED  驅(qū)動    

一種基于FPGA的UART 電路實(shí)現(xiàn)

  • 1 引 言　　UART 即通用異步收發(fā)器，他廣泛使用串行數(shù)據(jù)傳輸協(xié)議。UART 功能包括微處理器接口、用于數(shù)據(jù)傳輸?shù)木彌_器（Buffer）、幀產(chǎn)生、奇偶校驗(yàn)、并串轉(zhuǎn)換，用于數(shù)據(jù)接收的緩沖器、幀產(chǎn)生、奇偶校驗(yàn)、串并轉(zhuǎn)換等。
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基于FPGA開發(fā)靜態(tài)無功補(bǔ)償控制器

  • “我們在NI CompactRIO平臺上開發(fā)的SVC全數(shù)字控制系統(tǒng)，大大縮短了產(chǎn)品上市的時(shí)間又保證了系統(tǒng)的穩(wěn)定性。”挑戰(zhàn)：電弧爐、軋鋼機(jī)等大型工業(yè)設(shè)備在為企業(yè)創(chuàng)造產(chǎn)值的同時(shí)也帶來了無功分量和高次諧波等危害，
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汽車電子中的DSP和FPGA應(yīng)用概況

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： DSP  FPGA  汽車電子  

激光微加工系統(tǒng)及基于DSP+FPGA的控制單元設(shè)計(jì)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于FPGA的可編程衰減器設(shè)計(jì)

  • 引言可編程衰減器位于基站和終端之間，通過對射頻信號的衰減控制，實(shí)現(xiàn)對無線信號的模擬，從而實(shí)現(xiàn)對測試場景的模擬。可編程衰減器提供多個(gè)數(shù)控接口，從小到大可以構(gòu)建各個(gè)層次的測試網(wǎng)絡(luò)。所構(gòu)成的衰減矩陣通過模擬
  • 關(guān)鍵字： FPGA  可編程  衰減器    

基于ARM＋FPGA的重構(gòu)控制器設(shè)計(jì)

  • 基于ARM＋FPGA的重構(gòu)控制器設(shè)計(jì), 可重構(gòu)技術(shù)是指利用可重用的軟硬件資源，根據(jù)不同的應(yīng)用需求，靈活地改變自身體系結(jié)構(gòu)的設(shè)計(jì)方法。常規(guī)SRAM工藝的FPGA都可以實(shí)現(xiàn)重構(gòu)，利用硬件復(fù)用原理，本文設(shè)計(jì)的可重構(gòu)控制器采用ARM核微控制器作為主控制器
  • 關(guān)鍵字： 控制器  重構(gòu)  設(shè)計(jì)  需求  不同  作為  FPGA  可以  靈活  系統(tǒng)  

Linux下CPLD驅(qū)動程序

  • Linux下CPLD驅(qū)動程序,========================================================================== */
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    /* Filename.c
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X-fest研討會將于7月登陸亞洲

  • 安富利公司 (NYSE: AVT) 旗下安富利電子元件亞洲 (Avnet Electronics Marketing Asia)與賽靈思公司 (NASDAQ: XLX) 日前宣布啟動亞洲區(qū)X-fest 研討會注冊。X-fest 是深受 FPGA、DSP 和嵌入式系統(tǒng)開發(fā)人員歡迎的、為期一天的培訓(xùn)活動。
  • 關(guān)鍵字： 賽靈思  FPGA  X-fest  

基于DSP的CPLD軟件更新方案研究

  • 基于DSP的CPLD軟件更新方案研究, 0引言　　在現(xiàn)代導(dǎo)航計(jì)算機(jī)系統(tǒng)朝著微型化發(fā)展的過程中，采用高性能數(shù)字信號處理器和可編程邏輯器件方案實(shí)現(xiàn)的導(dǎo)航計(jì)算機(jī)系統(tǒng)有著很高的性能優(yōu)勢。在本課題組研制的基于浮點(diǎn)型DSP和復(fù)雜可編程邏輯器件(CPLD)結(jié)構(gòu)的嵌
  • 關(guān)鍵字： 方案  研究  更新  軟件  DSP  CPLD  基于  

基于FPGA技術(shù)的存儲器設(shè)計(jì)及其應(yīng)用

  • 基于FPGA技術(shù)的存儲器設(shè)計(jì)及其應(yīng)用,復(fù)雜可編程邏輯器件—FPGA技術(shù)在近幾年的電子設(shè)計(jì)中應(yīng)用越來越廣泛。FPGA具有的硬件邏輯可編程性、大容量、高速、內(nèi)嵌存儲陣列等特點(diǎn)使其特別適合于高速數(shù)據(jù)采集、復(fù)雜控制邏輯、精確時(shí)序邏輯等場合的應(yīng)用。而應(yīng)
  • 關(guān)鍵字： 及其  應(yīng)用  設(shè)計(jì)  存儲器  FPGA  技術(shù)  基于  

基于FPGA的圖像采集模塊設(shè)計(jì)

  • 基于FPGA的圖像采集模塊設(shè)計(jì),1 引言　　圖像采集是圖像處理的前提。圖像采集卡是常用的圖像輸入設(shè)備，通常占用PC機(jī)總線的一個(gè)插槽。它主要包括圖像存儲器單元、CCD或CMOS攝像頭接口、PC機(jī)總線接口等。傳統(tǒng)的圖像采集卡大多數(shù)采用 PCI接口，這種圖
  • 關(guān)鍵字： 模塊  設(shè)計(jì)  采集  圖像  FPGA  基于  

基于FPGA的LVDS高速數(shù)據(jù)通信卡設(shè)計(jì)

  • 摘要 基于FPGA、PCI9054、SDRAM和DDS設(shè)計(jì)了用于某遙測信號模擬源的專用板卡。PCI9054實(shí)現(xiàn)與上位機(jī)的數(shù)據(jù)交互，F(xiàn)PGA實(shí)現(xiàn)PCI本地接口轉(zhuǎn)換、數(shù)據(jù)接收發(fā)送控制及DDS芯片的配置。通過WDM驅(qū)動程序設(shè)計(jì)及MFC交互界面設(shè)計(jì)，最
  • 關(guān)鍵字： 數(shù)據(jù)通信  設(shè)計(jì)  高速  LVDS  FPGA  
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