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fsp:fpga-pcb 文章 最新資訊

基于FPGA的猝發(fā)式直擴載波同步技術(shù)研究與實現(xiàn)

  • 　　在高動態(tài)環(huán)境中，由于載波多普勒頻移和收發(fā)端時鐘漂移等因素的存在，直擴接收機必須通過載波同步才能在接收端消除頻差并重構(gòu)載波相位，以實現(xiàn)相干解調(diào)。在傳統(tǒng)的載波同步技術(shù)中，鎖頻環(huán)具有較大的捕獲帶寬但頻率跟蹤精度相對較低;鎖相環(huán)雖然具有較高的跟蹤精度卻受到捕獲帶寬的限制。在同步時間要求不高的通信系統(tǒng)中，可以采用鎖頻環(huán)與鎖相環(huán)級聯(lián)的載波同步方法，使接收機既能承受環(huán)路帶寬與動態(tài)性能之間的折中，又同時滿足跟蹤精度和一定動態(tài)性能。但本文所涉及的短時猝發(fā)式擴頻通信系統(tǒng)要求更大的捕獲帶寬(±30kHz)，且導(dǎo)頻符號僅為2
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2017國際線路板及電子組裝華南展覽會

  • 　　2017國際線路板及電子組裝華南展覽會(2017 HKPCA & IPC Show)將于2017年12月6至8日再次在中國深圳會展中心舉行。今年展會以“智慧大匯，實地創(chuàng)成”為主題，體現(xiàn)展會的愿景——匯聚全球智慧，幫助業(yè)內(nèi)企業(yè)將全球的高端技術(shù)應(yīng)用于當?shù)貙嶋H生產(chǎn)，從而有效提升業(yè)務(wù)發(fā)展?！　≌股谭错憻崃?，展會規(guī)模創(chuàng)歷史新高　　2017年展商對展位的需求非常熱烈。截至7月份，今年展會97%的展位已銷售一空，而且還有眾多展商報名參展，反響十分熱烈。截至目前，本屆展
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非隔離式開關(guān)電源的PCB布局全攻略

  • 　　1.引言　　一個良好的布局設(shè)計可優(yōu)化效率，減緩熱應(yīng)力并盡量小走線與元件之間噪聲作用。這切都 源于設(shè)計人員對電中流傳導(dǎo)路徑以及信號的理解。　　當一塊原型電源板首次加時，最好的情況 是它不僅能工作而且還安靜、發(fā)熱低。然這種并不多見。　　開關(guān)電源的一個常見問題是 “不穩(wěn)定 ”的開關(guān)波形。有些時候，抖動處于聲段磁性元件會產(chǎn)生 出音頻噪聲。如果問題在印刷電路板的布局上， 要找原因可能會很困難此開關(guān)電源 設(shè)計初期的 正確 P
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聊一聊PCB規(guī)劃、布局和布線方面的設(shè)計技巧

  • 　　在開始布線之前應(yīng)該對設(shè)計進行認真的分析以及對工具軟件進行認真的設(shè)置，這會使設(shè)計更加符合要求?！　? 確定PCB的層數(shù)　　電路板尺寸和布線層數(shù)需要在設(shè)計初期確定。布線層的數(shù)量以及層疊(STack-up)方式會直接影響到印制線的布線和阻抗。板的大小有助于確定層疊方式和印制線寬度，實現(xiàn)期望的設(shè)計效果。目前多層板之間的成本差別很小，在開始設(shè)計時最好采用較多的電路層并使敷銅均勻分布?！　? 設(shè)計規(guī)則和限制　　要順利完成布線任務(wù)，布線工具需要在正確的規(guī)則和限制條件下工作。要對所有特殊要求的信號
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FPGA設(shè)計經(jīng)驗之邊沿檢測

  • 　　在同步電路設(shè)計中，邊沿檢測是必不可少的!　　例如：在一個時鐘頻率16MHz的同步串行總線接收電路里，串行總線波特率為1Mbps。在串行總線的發(fā)送端是在同步時鐘(1MHz)的上升沿輸出數(shù)據(jù)，在接收端在同步時鐘的下降沿對輸入數(shù)據(jù)進行接收采樣。在這個接收電路里檢測同步時鐘的下降沿是必不可少的。假設(shè)主時鐘-clk，同步時鐘-rck，同步數(shù)據(jù)-data。　　有些人在邊沿檢測的時候就喜歡這樣做：　　    　　但是大家忽略了一種情況，就是clk與rck之間比沒有必然的同步關(guān)系，當r
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硬件工程師談高速PCB信號走線規(guī)則TOP9

  • 　　規(guī)則一：高速信號走線屏蔽規(guī)則　　在高速的PCB設(shè)計中，時鐘等關(guān)鍵的高速信號線，走線需要進行屏蔽處理，如果沒有屏蔽或只屏蔽了部分，都會造成EMI的泄漏。建議屏蔽線，每1000mil，打孔接地?！　D1 高速信號線　　規(guī)則二：高速信號的走線閉環(huán)規(guī)則　　由于PCB板的密度越來越高，很多PCB LAYOUT工程師在走線的過程中，很容易出現(xiàn)一種失誤，即時鐘信號等高速信號網(wǎng)絡(luò)，在多層的PCB走線的時候產(chǎn)生了閉環(huán)的結(jié)果，這樣的閉環(huán)結(jié)果將產(chǎn)生環(huán)形天線，增加EMI的輻射強度?！　D2 閉環(huán)
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【E問E答】PCB布局時如何擺放及安裝去耦電容？

  • 　　尖峰電流的形成：　　數(shù)字電路輸出高電平時從電源拉出的電流Ioh和低電平輸出時灌入的電流Iol的大小一般是不同的，即：Iol>Ioh。以下圖的TTL與非門為例說明尖峰電流的形成：　　   　　圖1 TTL與非門　　輸出電壓如右圖(a)所示，理論上電源電流的波形如右圖(b)，而實際的電源電流保險如右圖(c)。由圖(c)可以看出在輸出由低電平轉(zhuǎn)換到高電平時電源電流有一個短暫而幅度很大的尖峰。尖峰電源電流的波形隨所用器件的類型和輸出端所接的電容負載而異?！　‘a(chǎn)生尖峰電流的
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EDA技術(shù)在電路設(shè)計中的地位和作用

  • 　　20世紀后半期，隨著集成電路和計算機技術(shù)的發(fā)展，數(shù)字系統(tǒng)也得到了飛速發(fā)展，其實現(xiàn)方法經(jīng)歷了由分立元件、SSI、MSI到LSI、VLSI以及UVLSI的過程。同時為了提高系統(tǒng)的可靠性與通用性，微處理器和專用集成電路(ASIC)逐漸取代了通用集成硬件LSI電路，而在這兩者之間，ASIC以其體積小、重量輕、功耗低、速度快、成本低、保密性好而脫穎而出?？偟膩碚f，ASIC的制作可粗略地分為掩膜式方法和現(xiàn)場可編程方法兩大類。目前，業(yè)界大量可編程器件(PLD)，尤其是現(xiàn)場可編程邏輯器件(CPLD/FPGA)被大量地
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Achronix開設(shè)上海代表處以支持大中華地區(qū)對其FPGA產(chǎn)品的強勁需求

  • 　　Achronix今日宣布其已在上海開設(shè)新的辦公室，以組建由工程與技術(shù)支持專業(yè)人員組成的本地團隊。新辦公室的這支團隊將與Achronix在全球其他地點的團隊密切合作，為大中華地區(qū)的客戶提供支持。該辦公室位于上海張江高科技園區(qū)長泰廣場，所在區(qū)域為我國集成電路產(chǎn)業(yè)中心之一?！　chronix在2017年的營業(yè)收入將比上年增長700%，使其成為2017年成長最快的半導(dǎo)體公司之一;其快速增長的營業(yè)收入得益于客戶對最高性能、低功耗、可編程的基于FPGA的硬件加速解決方案的強勁需求。這些需求來自于諸如軟件定義網(wǎng)絡(luò)
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具有劃時代意義的芯片匯總，賽靈思FPGA和東芝NAND閃存在列

  • 　　對大多數(shù)人來說，微芯片是一些長著小小的金屬針，標著看似隨機的字母或數(shù)字的字符串的黑盒子。但是對那些懂的人來說，有些芯片就像名人一樣站在紅毯上。有許多這樣的集成電路直接或間接地為改變世界的產(chǎn)品賦能，從而得到榮耀，也有一些芯片對整個計算環(huán)境造成了長期的影響。也有一些，它們的雄心壯志失敗后成為警世的故事?！　榱思o念這些偉大的芯片，并講述它們背后的人和故事，IEEE Spectrum 制作了這個“芯片名人堂”(Chip Hall of Fame)。登堂的是7
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基于Verilog語言的等精度頻率計設(shè)計

  •  　　引言　　傳統(tǒng)測量頻率的方法主要有直接測量法、分頻測量法、測周法等，這些方法往往只適用于測量一段頻率，當被測信號的頻率發(fā)生變化時，測量的精度就會下降。本文提出一種基于等精度原理的測量頻率的方法，在整個頻率測量過程中都能達到相同的測量精度，而與被測信號的頻率變化無關(guān)。本文利用FPGA(現(xiàn)場可編程門陣列)的高速數(shù)據(jù)處理能力，實現(xiàn)對被測信號的測量計數(shù);利用單片機的運算和控制能力，實現(xiàn)對頻率、周期、脈沖寬度的計算及顯示?！　〉染葴y量原理等精度測量的一個最大特點是測量的實際門控時間不是一個固定值，而
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基于FPGA自適應(yīng)數(shù)字頻率計的設(shè)計

  • 　　在電子工程，資源勘探，儀器儀表等相關(guān)應(yīng)用中，頻率計是工程技術(shù)人員必不可少的測量工具。頻率測量也是電子測量技術(shù)中最基本最常見的測量之一。不少物理量的測量，如轉(zhuǎn)速、振動頻率等的測量都涉及到或可以轉(zhuǎn)化為頻率的測量。目前，市場上有各種多功能、高精度、高頻率的數(shù)字頻率計，但價格不菲。為適應(yīng)實際工作的需要，本文在簡述頻率測量的基本原理和方法的基礎(chǔ)上，提供一種基于FPGA的數(shù)字頻率計的設(shè)計和實現(xiàn)過程，本方案不但切實可行，而且具有成本低廉、小巧輕便、便于攜帶等特點。　　1 數(shù)字頻率測量原理和方法及本系統(tǒng)硬件
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基于Verilog FPGA 流水燈設(shè)計

  • 　　1 功能概述　　流水廣告燈主要應(yīng)用于LED燈光控制。通過程序控制LED的亮和滅， 多個LED燈組成一個陣列，依次逐個點亮的時候像流水一樣，所以叫流水燈。由于其形成美觀大方的視覺效果，因此廣泛應(yīng)用于店鋪招牌、廣告、大型建筑夜間裝飾、景觀裝飾等?！　≡贔PGA電路設(shè)計中，盡管流水燈的設(shè)計屬于比較簡單的入門級應(yīng)用，但是其運用到的方法，是FPGA設(shè)計中最核心和最常用部分之一，是FPGA設(shè)計必須牢固掌握的基礎(chǔ)知識。從這一步開始，形成良好的設(shè)計習(xí)慣，寫出整潔簡潔的代碼，對于FPGA設(shè)計師來說至
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電子產(chǎn)品的無形敵人竟然是它

  • 　　半個世紀以來，靜電在電子行業(yè)引起的著火、爆炸等事故不勝枚舉。僅美國電子行業(yè)每年因靜電造成的損失就高達幾百億美元，因此，靜電防護在減少損失、提升品質(zhì)和消費效率方面具有重要的意義。 　　隨著集成電路行業(yè)的迅速發(fā)展，體積小、集成度高的器件越發(fā)受市場歡迎，這種需求也導(dǎo)致導(dǎo)線間間距越來越小，內(nèi)部氧化膜逐漸變薄，以至于制造過程中一些微小電壓就可能擊穿這些電子器件。而電子產(chǎn)品在生產(chǎn)、運輸、儲存和轉(zhuǎn)運等一系列過程中所產(chǎn)生的靜電電壓卻遠遠超過其耐壓值，這就可能造成器件的擊穿或失效，影響產(chǎn)品的可靠性。所以必須要重視靜電
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EMC問題－接地技巧及PCB工程師注意事項

  • 　　EMC問題　　在布板的時候還應(yīng)該注意EMC的抑制哦!!這很不好把握，分布電容隨時存在!!　　如何接地　　PCB設(shè)計原本就要考慮很多的因素,不同的環(huán)境需要考慮不同的因素.另外,我不是PCB工程師,經(jīng)驗并不豐富　　地的分割與匯接　　接地是抑制電磁干擾、提高電子設(shè)備EMC性能的重要手段之一。正確的接地既能提高產(chǎn)品抑制電磁干擾的能力，又能減少產(chǎn)品對外的EMI發(fā)射。　　接地的含義　　電子設(shè)備的“地”通常有兩種含義：一種是“大地”(安全地)，另一種是“系統(tǒng)基準地”(信號地)。接地就是指在系統(tǒng)與某個電位基準面之間建
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