fsp:fpga-pcb 文章最新資訊

Cadence為PCB設(shè)計(jì)制訂新標(biāo)準(zhǔn)Global Route Environment

　　Cadence設(shè)計(jì)系統(tǒng)公司今日發(fā)布了面向Cadence® Allegro® PCB設(shè)計(jì)的Global Route Environment技術(shù)。這一革命性的技術(shù)結(jié)合了圖形化的互連流規(guī)劃架構(gòu)和層次化全局布線(xiàn)引擎，為PCB設(shè)計(jì)人員提供了自動(dòng)、智能的規(guī)劃和布線(xiàn)環(huán)境。作為首個(gè)將智能自動(dòng)化引入前所未有領(lǐng)域的自動(dòng)布線(xiàn)解決方案，Global Route Environment 技術(shù)代表了一次意義重大的飛躍，并建立了一種全新的PCB設(shè)計(jì)規(guī)范。　　該技術(shù)問(wèn)世之前，PCB設(shè)計(jì)人員要花費(fèi)幾周或幾個(gè)月的時(shí)間
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基于FPGA的雷達(dá)脈沖壓縮系統(tǒng)設(shè)計(jì)

脈沖壓縮技術(shù)是指對(duì)雷達(dá)發(fā)射的寬脈沖信號(hào)進(jìn)行調(diào)制(如線(xiàn)性調(diào)頻、非線(xiàn)性調(diào)頻、相位編碼)，并在接收端對(duì)回波寬脈沖信號(hào)進(jìn)行脈沖壓縮處理后得到窄脈沖的實(shí)現(xiàn)過(guò)程。脈沖壓縮有效地解決了雷達(dá)作用距離與距離分辨率之間的矛盾，可以在保證雷達(dá)在一定作用距離下提高距離分辨率。線(xiàn)性調(diào)頻信號(hào)的脈沖壓縮脈沖壓縮的過(guò)程是通過(guò)對(duì)接收信號(hào)s(t)與匹配濾波器的脈沖響應(yīng)h(t)求卷積的方法實(shí)現(xiàn)的。而處理數(shù)字信號(hào)時(shí)，脈壓過(guò)程是通過(guò)對(duì)回波序列s(n)與匹配濾波器的脈沖響應(yīng)序列h(n)求卷積來(lái)實(shí)現(xiàn)的。匹配濾波器的輸出為： &nbs
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設(shè)計(jì)靈活、高性能的嵌入式系統(tǒng)

您的下一個(gè)嵌入式系統(tǒng)設(shè)計(jì)項(xiàng)目需要的是什么：是可以讓您輕松地定制設(shè)計(jì)的靈活的系統(tǒng)元件，還是額外的性能空間，以便您在設(shè)計(jì)周期中加入更多的功能？為什么要讓自己承受過(guò)度的開(kāi)發(fā)壓力，并且只能舍此取彼呢？軟處理和IP定制能夠?yàn)橥瑫r(shí)確保靈活性和高性能提供了最佳的解決方案，將定制設(shè)計(jì)的概念和協(xié)處理帶來(lái)的性能加速結(jié)合起來(lái)。分立處理器只能提供固定的外設(shè)選擇，并且一些性能受到時(shí)鐘頻率的限制。在嵌入式 FPGA所提供的平臺(tái)上，您可以創(chuàng)建一個(gè)具有大量定制處理器核、靈活的外設(shè)、甚至協(xié)處理減負(fù)引擎的系統(tǒng)?，F(xiàn)在，您能設(shè)計(jì)出一個(gè)不折
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Altera發(fā)布Quartus II設(shè)計(jì)軟件7.0支持Cyclone III FPGA

　　Altera公司推出了Quartus® II軟件7.0，其訂購(gòu)版和免費(fèi)的網(wǎng)絡(luò)版均支持65nm Cyclone® III FPGA全系列產(chǎn)品。網(wǎng)絡(luò)版軟件對(duì)Cyclone III器件的支持表明，在所有FPGA供應(yīng)商免費(fèi)軟件包中，該軟件能夠支持密度最大的器件。與前一系列相比，Quartus II軟件的先進(jìn)技術(shù)和效能特性使設(shè)計(jì)人員能夠充分挖掘Cyclone III系列的潛能，器件功耗降低了50％，比最相近的低成本FPGA競(jìng)爭(zhēng)
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基于DSP的高速PCB抗干擾設(shè)計(jì)

引言隨著DSP(數(shù)字信號(hào)處理器)的廣泛應(yīng)用，基于DSP的高速信號(hào)處理PCB板的設(shè)計(jì)顯得尤為重要。在一個(gè)DSP系統(tǒng)中，DSP微處理器的工作頻率可高達(dá)數(shù)百M(fèi)Hz，其復(fù)位線(xiàn)、中斷線(xiàn)和控制線(xiàn)、集成電路開(kāi)關(guān)、高精度A／D轉(zhuǎn)換電路，以及含有微弱模擬信號(hào)的電路都非常容易受到干擾；所以設(shè)計(jì)開(kāi)發(fā)一個(gè)穩(wěn)定的、可靠的DSP系統(tǒng)，抗干擾設(shè)計(jì)非常重要。干擾即干擾能量使接收器處在不希望的狀態(tài)。干擾的產(chǎn)生分兩種：直接的(通過(guò)導(dǎo)體、公共阻抗耦合等)和間接的(通過(guò)串?dāng)_或輻射耦合)。很多電器發(fā)射源，如光照、電機(jī)和日光
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Actel和ARM聯(lián)合開(kāi)發(fā)專(zhuān)為FPGA應(yīng)用而優(yōu)化的高性能32位處理器

Actel公司進(jìn)一步擴(kuò)展其工業(yè)標(biāo)準(zhǔn)處理器系列，宣布推出ARM Cortex-M1處理器，這是與ARM公司聯(lián)合開(kāi)發(fā)的小型高性能32位軟件微處理器核，專(zhuān)為在FPGA中的實(shí)施而優(yōu)化。不象許多業(yè)界領(lǐng)先的處理器核通常需要支付授權(quán)費(fèi)用和權(quán)益金，Actel的客戶(hù)能夠免費(fèi)獲得先進(jìn)的ARM處理器技術(shù)如Cortex-M1，適用于廣闊的市場(chǎng)領(lǐng)域。免費(fèi)提供的Cortex-M1可與Actel以Flash為基礎(chǔ)且可運(yùn)行M1核的Actel Fusion FPGA和ProASIC3 FPGA同用，為設(shè)計(jì)人員提供編程靈活性和系統(tǒng)級(jí)集成，
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Altera Announces Quartus II Design Software Version 7.0 With Support for Cyclone III FPGAs

Web Edition Offers Free Design Support for Industry’s Highest-Density Low-Cost FPGAsBeijing, March 20, 2007—Altera Corporation (NASDAQ:ALTR) today introduced Quartus II software version 7.0 with support for the entire 65-nm Cyclone? III FPGA family in bot
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SYNPLICITY為ALTERA的CYCLONE III FPGA提供低成本優(yōu)勢(shì)

領(lǐng)先的半導(dǎo)體設(shè)計(jì)與驗(yàn)證軟件供應(yīng)商 Synplicity 公司日前宣布即將為 Altera 公司的低成本 Cyclone III FPGA 提供支持。Synplicity 對(duì)其 Synplify Pro? FPGA 綜合軟件進(jìn)行了優(yōu)化，從而提供了更為快速而簡(jiǎn)便易用的解決方案，使 Cyclone III 客戶(hù)能夠迅速實(shí)現(xiàn)時(shí)序目標(biāo)，并通過(guò)優(yōu)化面積利用來(lái)節(jié)約成本。這兩家公司保持長(zhǎng)期的合作伙伴關(guān)系，并在產(chǎn)品開(kāi)發(fā)過(guò)程中密切配合，從而快速實(shí)現(xiàn)了Synplify Pro 軟件的優(yōu)化。根據(jù)雙方合作，Altera 在產(chǎn)品公開(kāi)
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Altera發(fā)售業(yè)界首款65nm低成本FPGA

Cyclone III FPGA前所未有地同時(shí)實(shí)現(xiàn)了低功耗、低成本和高性能，適合無(wú)線(xiàn)通信、視頻、顯示等其他對(duì)成本敏感的應(yīng)用。 2007年3月20號(hào)，北京——Altera公司今天宣布，開(kāi)始發(fā)售業(yè)界的首款65nm低成本FPGA——Cyclone III系列。Cyclone III FPGA比競(jìng)爭(zhēng)FPGA的功耗低75％，含有5K至120K邏輯單元(LE)，288個(gè)數(shù)字信號(hào)處理(DSP)乘法器，存儲(chǔ)器達(dá)到4Mbits。Cyclone III系列比前一代產(chǎn)品每邏輯單元成本降低20％，使設(shè)計(jì)人員能夠更多地在成本敏感
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ARM發(fā)布首款專(zhuān)門(mén)針對(duì)FPGA而優(yōu)化的處理器，擴(kuò)展Cortex系列

日前，ARM公司今天發(fā)布了第一款專(zhuān)門(mén)針對(duì)FPGA應(yīng)用而優(yōu)化的ARM? Cortex?-M1處理器。ARM Cortex-M1處理器擴(kuò)展了ARM Cortex處理器系列，可幫助OEM廠(chǎng)商在一個(gè)通用架構(gòu)下對(duì)不同性能需求進(jìn)行標(biāo)準(zhǔn)化。Actel作為一家核心合作伙伴已與ARM緊密合作，并成為首個(gè)獲得授權(quán)可為其FPGA客戶(hù)提供Cortex-M1處理器的公司。 2007年4月2日至5日在美國(guó)加利福尼亞州圣何塞舉行的嵌入式系統(tǒng)大會(huì)（Embedded Systems Conference）上， ARM和Actel將共同展
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為何要將PCB文件轉(zhuǎn)換為GERBER文件和鉆孔數(shù)據(jù)后交PCB廠(chǎng)制板

　　大多數(shù)工程師都習(xí)慣于將PCB文件設(shè)計(jì)好后直接送PCB廠(chǎng)加工，而國(guó)際上比較流行的做法是將PCB文件轉(zhuǎn)換為GERBER文件和鉆孔數(shù)據(jù)后交PCB廠(chǎng)，為何要“多此一舉”呢？　　因?yàn)殡娮庸こ處熀蚉CB工程師對(duì)PCB的理解不一樣，由PCB工廠(chǎng)轉(zhuǎn)換出來(lái)的GERBER文件可能不是您所要的，如您在設(shè)計(jì)時(shí)將元件的參數(shù)都定義在PCB文件中，您又不想讓這些參數(shù)顯示在 PCB成品上，您未作說(shuō)明，PCB廠(chǎng)依葫蘆畫(huà)瓢將這些參數(shù)都留在了PCB成品上。這只是一個(gè)例子。若您自己將PCB文件轉(zhuǎn)換成GERBER文件就可避免此類(lèi)事件發(fā)生?！　?/li>
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PCB前處理導(dǎo)致之制程問(wèn)題發(fā)生原因討論

1. PCB制程上發(fā)生的問(wèn)題千奇百怪, 而制程工程師往往擔(dān)任起法醫(yī)-驗(yàn)尸責(zé)任(不良成因分析與解決對(duì)策). 故發(fā)起此討論題, 主要目的為以設(shè)備區(qū)逐一討論分上包含人, 機(jī), 物, 料, 條件上可能會(huì)導(dǎo)致產(chǎn)生的問(wèn)題, 希望大家一起參與提出自己意見(jiàn)及看法.　　　　2. 會(huì)使用到前處理設(shè)備的制程, 例如:內(nèi)層前處理線(xiàn), 電鍍一銅前處理線(xiàn), D/F, 防焊(阻焊)...等等.　　　　3. 以硬板PCB 防焊(阻焊)前處理線(xiàn)為例(各廠(chǎng)商不同而有差異): 刷磨*2組->水洗->酸洗->水洗->冷風(fēng)
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電磁場(chǎng)高速自動(dòng)掃描技術(shù)在高速PCB設(shè)計(jì)中的應(yīng)用

　　電磁兼容測(cè)試對(duì)即將進(jìn)入市場(chǎng)的電子產(chǎn)品是非常重要的一項(xiàng)測(cè)試，但以往的測(cè)試只能得出能否通過(guò)的結(jié)果，不能提供更多有用信息。本文介紹利用高速自動(dòng)掃描技術(shù)測(cè)量電磁輻射，檢測(cè)PCB板上電磁場(chǎng)的變化情況，使工程技術(shù)人員在進(jìn)行電磁兼容性標(biāo)準(zhǔn)測(cè)試前就能發(fā)現(xiàn)相關(guān)問(wèn)題并及時(shí)予以糾正。　　　　　　隨著當(dāng)今電子產(chǎn)品主頻提高、布線(xiàn)密度增加以及大量BGA封裝器件和高速邏輯器件的使用，設(shè)計(jì)人員不得不通過(guò)增加PCB板的層數(shù)來(lái)減少信號(hào)與信號(hào)間的相互影響。同時(shí)在大量便攜式終端設(shè)備中，為了降低系統(tǒng)功耗必須采用多電平方案，而這些設(shè)備還有模擬
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賽靈思公司新推VIRTEX-5協(xié)議包

　　賽靈思公司（Xilinx, Inc.）宣布推出用于其65nm Virtex-5系列 FPGA的PCI Express®、千兆以太網(wǎng)和XAUI協(xié)議包。同時(shí)，賽靈思公司還發(fā)布了針對(duì)SONET OC-48/SDH STM-16 和 CPRI（通用公共無(wú)線(xiàn)電接口）的特定協(xié)議特性描述報(bào)告。每一項(xiàng)標(biāo)準(zhǔn)協(xié)議包都包括針對(duì)特定協(xié)議物理層的特性描述報(bào)告、互操作性和兼容性報(bào)告、IP內(nèi)核以及技術(shù)文檔，支持用戶(hù)高效且低風(fēng)險(xiǎn)地在Virtex™-5 FPGA中實(shí)現(xiàn)標(biāo)準(zhǔn)的高速串行協(xié)議。　　“賽靈思公司不僅僅提
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電源完整性與地彈噪聲的高速PCB仿真

使用基于電磁場(chǎng)分析的設(shè)計(jì)軟件來(lái)選擇退耦電容的大小及其放置位置可將電源平面與地平面的開(kāi)關(guān)噪聲減至最小。隨著信號(hào)的沿變化速度越來(lái)越快，今天的高速數(shù)字電路板設(shè)計(jì)者所遇到的問(wèn)題在幾年前看來(lái)是不可想象的。對(duì)于小于1納秒的信號(hào)沿變化，PCB板上電源層與地層間的電壓在電路板的各處都不盡相同，從而影響到IC芯片的供電，導(dǎo)致芯片的邏輯錯(cuò)誤。為了保證高速器件的正確動(dòng)作，設(shè)計(jì)者應(yīng)該消除這種電壓的波動(dòng)，保持低阻抗的電源分配路徑。為此，你需要在電路板上增加退耦電容來(lái)將高速信號(hào)在電源層和地層上產(chǎn)生的噪聲降至最低
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