fsp:fpga-pcb 文章 最新資訊
詳解PCB板的ESD
- 最近在做電子產(chǎn)品的ESD測試，從不同的產(chǎn)品的測試結(jié)果發(fā)現(xiàn)，這個ESD是一項很重要的測試：如果電路板設(shè)計的不好，當引入靜電后，會引起產(chǎn)品的死機甚至是元器件的損壞。以前只注意到ESD會損壞元器件，沒有想到，對于電子產(chǎn)品也要引起足夠的重視。 ESD,也就是我們常說的靜電釋放(Electro-Static discharge)。從學習過的知識中可以知道，靜電是一種自然現(xiàn)象，通常通過接觸、摩擦、電器間感應(yīng)等方式產(chǎn)生，其特點是長時間積聚、高電壓(可以產(chǎn)生幾千伏甚至上萬伏的靜電)、低電量、小電流和作用時間
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混合信號IC──復雜電源管理組件的設(shè)計挑戰(zhàn)及解決方案
- 隨著系統(tǒng)內(nèi)電源數(shù)量的增多，為了確保其安全、經(jīng)濟、持續(xù)和正常的工作，對電源軌進行監(jiān)測和控制變得非常重要，特別是在使用微處理器時。確定電壓軌是否處于工作范圍內(nèi)，以及該電壓相對于其它電壓軌是否按照正確的時序上電或斷電，這些對于系統(tǒng)執(zhí)行的可靠性和安全性來說都是至關(guān)重要的。例如FPGA，在向組件提供5V I/O(輸入/輸出)電壓之前，必須先施加3.3V的核心電壓，并持續(xù)至少20ms，以避免組件上電時受到損壞。對于系統(tǒng)的可靠性來說，滿足這樣的時序要求就像要保證組件在規(guī)定的電源電壓和溫度范圍內(nèi)工作一樣至關(guān)重要。
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混合信號FPGA實現(xiàn)真正單芯片SOC
- 要實現(xiàn)能夠?qū)⑺兄匾δ芗稍趩我黄骷脑O(shè)計理由很簡單，因為這樣就能將材料成本、部件庫存及電路板面積減至最低。另外，相較于多芯片解決方案，單芯片方案的功耗也較低，同時也有助于提高對知識產(chǎn)權(quán)的保護。如果一項設(shè)計功能的精髓能夠深植于單一芯片上，將會大大增加第三方取得這項設(shè)計的困難度。 單芯片系統(tǒng)對嵌入式系統(tǒng)設(shè)計師來說，往往會隨著其面對的不同的系統(tǒng)設(shè)計而各有不同。例如，在龐大的娛樂或通信消費產(chǎn)品市場中，SoC意味著一顆具有數(shù)百萬邏輯門的集成電路(IC)，其中包含許多大型定制邏輯模塊，并有將芯片的數(shù)字處
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Mentor Graphics 宣布推出旨在提升測試平臺效率的 EZ-VIP 包
- Mentor Graphics公司今天宣布即時推出 EZ-VIP 效率包。該效率包面向使用 Questa® Verification IP (QVIP) 的 ASIC 和 FPGA 驗證團隊，可將創(chuàng)建、實例化、配置和連接 QVIP 測試平臺的時間縮短 5 倍以上，從而顯著提高效率。這就意味著，驗證團隊可以將更多的時間花在 QVIP 上，以驗證他們的設(shè)計在功能上是否正確。 EZ-VIP 包由 QVIP 配置軟件、一個 VIP 調(diào)通服務(wù)包和一個全新的 EZ-VIP API 組成。其中，QVI
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【從零開始走進FPGA】 玩轉(zhuǎn)VGA
- 一、VGA的誘惑 首先，VGA的驅(qū)動，這事，一般的單片機是辦不到的;由于FPGA的速度，以及并行的優(yōu)勢，加上可現(xiàn)場配置的優(yōu)勢，VGA的配置，只有俺們FPGA可以勝任，也只有FPGA可以隨心所欲地配置(當然ARM也可以，應(yīng)用比較高吧)。 初學者就是喜歡看炫的效果，往往會忍不住想玩。尤其玩FPGA的，沒玩VGA就感到跟單片機沒啥提升，因此VGA的驅(qū)動也不得不講。Bingo當年也是如此。擋不住VGA的誘惑，初學者問Bingo VGA問題的人也是灰常的多，也許一般教科書理論太強，實際應(yīng)用不是很身后
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中國PCB產(chǎn)業(yè)“大而不強”困境如何破？
- 這兩年，受全球經(jīng)濟變化多端的影響，全球印制板2013年度增幅“基本持平”(CPCA)、“增長非常緩慢”，“增幅僅0.9%”(Prismark)。2014年度，全球PCB“持續(xù)仍有增長，實在是不太容易”、“同比增幅2.3%”(Prismark)。 但是，中國PCB行業(yè)一直在穩(wěn)步發(fā)展，在全球PCB領(lǐng)域影響越來越大。2014年，中國PCB產(chǎn)值占全球比例從上年(2013)的43.8%增
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Altera宣布Stratix 10的創(chuàng)新全面刷新高端FPGA和SoC業(yè)界性能指標記錄
- Altera公司今天發(fā)布其Stratix® 10 FPGA和SoC體系結(jié)構(gòu)和產(chǎn)品細節(jié)，這一下一代高端可編程邏輯器件在性能、集成度、密度和安全特性方面實現(xiàn)全面突破，勢必將云時代的網(wǎng)絡(luò)通信技術(shù)推向又一個巔峰。 Stratix 10 FPGA和SoC采用了Altera革命性的HyperFlex™ FPGA架構(gòu)，由Intel® 14 nm三柵極工藝技術(shù)制造，內(nèi)核性能是前一代FPGA的2倍。業(yè)界性能最好、密度最高、具有先進的嵌入式處理功能的FPGA與GPU級別浮點計算性能和異構(gòu)
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FPGA開發(fā)外設(shè)子板模塊電路設(shè)計詳解
- FPGA(Field-Programmable Gate Array)，即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。FPGA的開發(fā)相對于傳統(tǒng)PC、單片機的開發(fā)有很大不同。FPGA以并行運算為主，以硬件描述語言來實現(xiàn);相比于PC或單片機(無論是馮諾依曼結(jié)構(gòu)還是哈佛結(jié)構(gòu))的順序操作有很大區(qū)別，也造成了FPGA開發(fā)入門較難。目前國內(nèi)有專
- 關(guān)鍵字： FPGA A/D
基于FPGA的915MHz射頻讀卡器設(shè)計
- 射頻識別(RFID)技術(shù)是一種非接觸式的自動識別技術(shù)，通過射頻信號自動識別目標對象并獲取相關(guān)信息。通常RFID系統(tǒng)主要由應(yīng)用軟件、射頻卡以及讀卡器三部分構(gòu)成[1]。相對于低頻段的RFID系統(tǒng)，工作在860 MHz～960 MHz的超高頻段(UHF)RFID系統(tǒng)有著讀取距離遠、閱讀速度快等優(yōu)點，是目前國際上RFID技術(shù)發(fā)展的熱點[2]。讀卡器的設(shè)計是RFID系統(tǒng)設(shè)計中的關(guān)鍵部分，設(shè)計方案有很多種。FPGA[3]具有開發(fā)簡單、靜態(tài)可重復編程和動態(tài)在線編程的特點，已經(jīng)成為當今應(yīng)用最廣泛的可編程專用集成電路。
- 關(guān)鍵字： FPGA 讀卡器
FPGA的系統(tǒng)架構(gòu)組成和器件互聯(lián)問題
- 通常來講，“一個好漢三個幫”，一個完整的嵌入式系統(tǒng)中由單獨一個FPGA使用的情況較少。通常由多個器件組合完成，例如由一個FPGA+CPU來構(gòu)成。通常為一個FPGA+ARM，ARM負責軟件配置管理，界面輸入外設(shè)操作等操作，F(xiàn)PGA負責大數(shù)據(jù)量運算，可以看做CPU的專用協(xié)處理器來使用，也常會用于擴展外部接口。常用的有ARM+FPGA，DSP+FPGA，或者網(wǎng)絡(luò)處理器+FPGA等種種架構(gòu)形式，這些架構(gòu)形式構(gòu)成整個高速嵌入式設(shè)備的處理形態(tài)。 不得不說的是，隨著技術(shù)的進步，現(xiàn)在CP
- 關(guān)鍵字： ARM FPGA
電路也是路，看得懂的PCB布線
- PCB設(shè)計，在不少人眼中是體力活，然而一直以來，一個方案的前期，我都是親自布局布線，只有到了定型之后的一些修改才交給同事負責，但也會一一跟他們講解為什么要這樣布線。同事設(shè)計的PCB板，我也經(jīng)常點評一番，指出缺失的地方，這樣同事在PCB設(shè)計上都有較大的提高。 年前同事負責布的一塊步進電機驅(qū)動板，性能指標老是達不到文檔提到的性能，雖然能用，大電流丟步，高速上不去，波形差，在深入分析之后發(fā)現(xiàn)違背了一些PCB布線的基本原則，修改之后性能就非常好，這讓我再一次的感受到PCB布線的重要性，尤其是我們經(jīng)常做大
- 關(guān)鍵字： PCB
搭積木式的產(chǎn)品開發(fā)，創(chuàng)客者的福音
- 摘要： 積木式結(jié)構(gòu)：建筑用的積木式組件(預制件)是構(gòu)成整座建筑物質(zhì)單元，它按標準規(guī)格成批制造，可降低造價，并便于設(shè)計和施工。施工時，就像搭積木玩具一樣，將預制件組裝在相應(yīng)的位置上。產(chǎn)品開發(fā)也可以像搭積木玩具一樣，你知道嗎? 第一座完全采用積木式結(jié)構(gòu)、并大量使用預制件的大型建筑，是1851年為倫敦“萬國”博覽會建造的“水晶宮”，它是由原德溫公爵的園丁領(lǐng)班帕克斯頓主持設(shè)計建造的。 圖1 “積木式&rd
- 關(guān)鍵字： PCB
從數(shù)字PWM信號獲得準確、快速穩(wěn)定的模擬電壓
- 引言 脈寬調(diào)制(PWM)是從微控制器或FPGA等數(shù)字器件產(chǎn)生模擬電壓的一種常用方法。大多數(shù)微控制器都具有內(nèi)置的專用PWM產(chǎn)生外設(shè)，而且其僅需幾行RTL代碼即可從FPGA產(chǎn)生一個PWM信號。如果模擬信號的性能要求不是太嚴格，那么這就是一種簡單和實用的方法，因為它只需要一個輸出引腳，而且與具有一個SPI或I2C接口的數(shù)模轉(zhuǎn)換器(DAC)相比，其代碼開銷是非常低。圖1示出了一款典型應(yīng)用，其采用一個經(jīng)濾波的數(shù)字輸出引腳來產(chǎn)生一個模擬電壓。 該方案的諸多不足之處您不必深究就能發(fā)現(xiàn)。理想情況下，一個1
- 關(guān)鍵字： PWM FPGA
FPGA和DDS在信號源中的應(yīng)用
- 1引言 DDS同DSP(數(shù)字信號處理)一樣，是一項關(guān)鍵的數(shù)字化技術(shù)。DDS是直接數(shù)字式頻率合成器(DirectDigitalSynthesizer)的英文縮寫。與傳統(tǒng)的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉(zhuǎn)換時間等優(yōu)點，廣泛使用在電信與電子儀器領(lǐng)域，是實現(xiàn)設(shè)備全數(shù)字化的一個關(guān)鍵技術(shù)。在各行各業(yè)的測試應(yīng)用中，信號源扮演著極為重要的作用。但信號源具有許多不同的類型，不同類型的信號源在功能和特性上各不相同，分別適用于許多不同的應(yīng)用。目前，最常見的信號源類型包括任意波形發(fā)生器，函數(shù)發(fā)
- 關(guān)鍵字： FPGA DDS
fsp:fpga-pcb介紹
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