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fpga+dsp 文章 最新資訊

基于DSP的SPWM直接面積等效算法分析

  • 基于DSP的SPWM直接面積等效算法分析,開始的SPWM生成技術(shù)是采用模擬電路構(gòu)成三角波和正弦波發(fā)生電路,用比較器來確定他們的交點(diǎn)。這種方法電路復(fù)雜,精度較差,早已淘汰。后來人們采用單片機(jī)和微機(jī)生成SPWM波,但受硬件計(jì)算速度和算法計(jì)算量的影響,往往
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一種DSP與PCI總線的接口設(shè)計(jì)

  • 一種DSP與PCI總線的接口設(shè)計(jì),1 引言  DSP+PCI數(shù)字信號(hào)處理方案可利用PC的強(qiáng)大功能實(shí)現(xiàn)對(duì)DSP的操作控制、數(shù)據(jù)分析和操作監(jiān)視等。DSP+PCI方案能充分滿足數(shù)字圖像、語音處理、高速實(shí)時(shí)數(shù)據(jù)處理等領(lǐng)域的應(yīng)用,為DSP系統(tǒng)的低成本實(shí)現(xiàn)提供了解決方案
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一種高速DSP的圖像處理應(yīng)用平臺(tái)的設(shè)計(jì)

  • 一種高速DSP的圖像處理應(yīng)用平臺(tái)的設(shè)計(jì),1 引言  完成某一特定任務(wù)的圖像處理系統(tǒng),其硬件方案大體上有三種:使用通用計(jì)算機(jī)、使用ASIC和使用DSP。使用通用計(jì)算機(jī)的方案優(yōu)點(diǎn)在于開發(fā)周期短,費(fèi)用較低,而且產(chǎn)品易于維護(hù)和升級(jí);缺點(diǎn)是運(yùn)算速度受到限制,對(duì)
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基于DSP雙路音頻信號(hào)實(shí)時(shí)處理系統(tǒng)設(shè)計(jì)

  • 基于DSP雙路音頻信號(hào)實(shí)時(shí)處理系統(tǒng)設(shè)計(jì),摘要 采用TMS320C5509A作為核心處理器,給出了一種利用DMA結(jié)合多通道緩沖串口McBSP組成的語音信號(hào)采集系統(tǒng)的實(shí)現(xiàn)方法。合理分配了數(shù)據(jù)緩沖空間,可靠穩(wěn)定地實(shí)現(xiàn)數(shù)據(jù)的實(shí)時(shí)更新,完成雙路立體聲信號(hào)的實(shí)時(shí)采集、處理和
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基于FPGA直接序列擴(kuò)頻系統(tǒng)的設(shè)計(jì)

  • 摘要 針對(duì)一般無線通信系統(tǒng)抗干擾、抗噪聲以及抗多徑性能力差的缺點(diǎn),提出了一種基于FPGA的直接序列擴(kuò)頻系統(tǒng)設(shè)計(jì)。該設(shè)計(jì)采用63位的pn碼作為擴(kuò)頻調(diào)制的碼序列,在發(fā)送端,對(duì)信息碼進(jìn)行擴(kuò)頻調(diào)制;在接收端,對(duì)收到的擴(kuò)
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運(yùn)用SAD算法降低FPGA資源利用率

  • 介紹如何從比RTL更高層次的抽象層分析資源共享,讓資源占用率比依賴RTL設(shè)計(jì)中的互斥任務(wù)的方法更低。
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基于FPGA的高速串行傳輸系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要:作為高傳輸速率和低設(shè)計(jì)成本的傳輸技術(shù),串行傳輸技術(shù)被廣泛應(yīng)用于高速通信領(lǐng)域,并已成為業(yè)界首選。在此基于對(duì)高速串行傳輸系統(tǒng)的分析,對(duì)實(shí)例進(jìn)行了總體設(shè)計(jì)驗(yàn)證,最終達(dá)到高速傳輸?shù)哪康摹?br />關(guān)鍵詞:FPGA;
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基于FPGA的通用異步收發(fā)器設(shè)計(jì)

  • 摘要:采用Verilog HDL語言作為硬件功能的描述,運(yùn)用模塊化設(shè)計(jì)方法分別設(shè)計(jì)了通用異步收發(fā)器(UART)的發(fā)送模塊、接收模塊和波特率發(fā)生器,并結(jié)合現(xiàn)場(chǎng)可編程門陣列(FPGA)的特點(diǎn),實(shí)現(xiàn)了一個(gè)可移植的UART模塊。該設(shè)計(jì)不
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基于FPGA多通道同步數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

  •  引言  數(shù)據(jù)采集在工業(yè)測(cè)控領(lǐng)域里有廣泛的應(yīng)用,它已成為計(jì)算機(jī)測(cè)控系統(tǒng)的一個(gè)重要的環(huán)節(jié),尤其在設(shè)備故障監(jiān)測(cè)系統(tǒng)中,由于各種設(shè)備的結(jié)構(gòu)復(fù)雜,運(yùn)動(dòng)形式多種多樣,發(fā)生故障的可能部位很難確定,因此我們需要從設(shè)
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NEXYS3 FPGA 開發(fā)平臺(tái)

  • Digilent公司推出了一款新型的基于FPGA的硬件開發(fā)平臺(tái),NEXYSTM3開發(fā)板。此開發(fā)板采用了Xilinx公司最先進(jìn)的Spartan6 FPGA芯片,擁有48M字節(jié)大小的外部存儲(chǔ)器(包括2個(gè)由Micron公司生產(chǎn)的非易失性的相變存儲(chǔ)器)、USB以及以太網(wǎng)接口,還有其他通用的I/O器件。
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單一DSP控制兩套三相逆變器的實(shí)現(xiàn)

  • 迄今為止的設(shè)計(jì)經(jīng)驗(yàn)主張每臺(tái)逆變器和電機(jī)都擁有專門隸屬于自己的DSP控制器。最近,DSP的處理能力和外圍資源已提升到足以輕松控制兩臺(tái)電機(jī)的程度,甚至還有潛力處理更多電機(jī)。采用單一DSP控制器控  制兩套三相逆變器
  • 關(guān)鍵字: 逆變器  實(shí)現(xiàn)  三相  控制  DSP  單一  

基于DSP的聲雷達(dá)信號(hào)采集系統(tǒng)

  • 基于DSP的聲雷達(dá)信號(hào)采集系統(tǒng),在聲雷達(dá)系統(tǒng)中,發(fā)射機(jī)定向發(fā)出不同頻率的聲信號(hào),隨后接收不同距離上的回波信號(hào),利用回波中頻率的偏離可以測(cè)定風(fēng)速、風(fēng)向隨高度的變化。本文介紹的基于美國模擬器件公司的DSP ADSP-TS201S和ADC AD7864的信號(hào)采集系
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DSP實(shí)現(xiàn)EAS掃頻信號(hào)源設(shè)計(jì)

  • DSP實(shí)現(xiàn)EAS掃頻信號(hào)源設(shè)計(jì),1 引言
      商品防竊監(jiān)視器(Electronic Article Surveillance)簡稱EAS,是目前超市普遍使用的安檢防竊設(shè)備。其原理是由發(fā)射電路產(chǎn)生7.8MHz~8.8MHz的掃頻信號(hào),該信號(hào)由近場(chǎng)天線發(fā)射,當(dāng)天線附近有標(biāo)簽存在時(shí)(標(biāo)簽為
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指紋識(shí)別的DSP實(shí)現(xiàn)方案

  • 指紋識(shí)別的DSP實(shí)現(xiàn)方案,1 引言
      指紋識(shí)別技術(shù)通過分析指紋的局部特征,從中抽取詳盡的特征點(diǎn),從而可靠地確認(rèn)個(gè)人身份。指紋識(shí)別不僅具有許多獨(dú)到的信息安全優(yōu)點(diǎn),更重要的是具有很高的實(shí)用性、可行性。
      目前多數(shù)指紋識(shí)別系統(tǒng)是將
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用可編程DSP實(shí)現(xiàn)802.16 PHY信號(hào)處理

  • 用可編程DSP實(shí)現(xiàn)802.16 PHY信號(hào)處理, IEEE802.16標(biāo)準(zhǔn)的各個(gè)版本都規(guī)定了PHY(物理層)的多種選項(xiàng),包括調(diào)制、信道編碼和天線分集技術(shù)。物理信道帶寬可以在1.25 MHz~20 MHz之間變化。上述所有選項(xiàng)都會(huì)影響基站的性能和信號(hào)處理復(fù)雜度?! ≡S多客戶希望提
  • 關(guān)鍵字: PHY  信號(hào)處理  802.16  實(shí)現(xiàn)  DSP  可編程  
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