fpga soc 文章 最新資訊
FPGA研發(fā)之道(21)-雞肋?
- 通常認(rèn)為，SOPC是FPGA設(shè)計中的雞肋，“棄之可惜，食之無味”。誠然，SOPC一直不是FPGA的主流應(yīng)用設(shè)計，制約主要因素則是性能，因?yàn)樽鳛樘幚砥魇褂脮r，處理器主頻是其應(yīng)用范圍的瓶頸(SOPC的軟核處理器一般運(yùn)行幾十兆到百兆，而一般的嵌入式處理器系統(tǒng)在幾百兆到Ghz的主頻)。但是若因此說成“雞肋”，也確實(shí)夸張。廠家推出SOPC的設(shè)計，其優(yōu)點(diǎn)主要有一下幾點(diǎn)，其一：是差異化競爭的需要。其二，擴(kuò)大應(yīng)用范圍，爭取更多的軟件工程師能夠從事FPGA設(shè)計。其三，可以
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FPGA研發(fā)之道(20)-片上系統(tǒng)
- 從最初的占地170平方的第一代ENIAC計算機(jī)開始，計算機(jī)開始了不斷集成化、小型化的發(fā)展之旅?，F(xiàn)今在單一芯片內(nèi)部已經(jīng)能夠集處理器，存儲，各型協(xié)處理器等，從而形成的強(qiáng)大的單芯片的片上系統(tǒng)(SOC)，而這些片上系統(tǒng)已存在于生活的方方面面。因此FPGA內(nèi)部支持片上系統(tǒng)，也算不上是新奇的事情了。ALTERA和XILINX已各自推出了各自應(yīng)用片上系統(tǒng)(FPGA領(lǐng)域稱之為SOPC，因此其片上系統(tǒng)可以根據(jù)業(yè)務(wù)需求來定義)。 只需幾K的資源，就能實(shí)現(xiàn)一個SOC的最小系統(tǒng)，對于FPGA工程師來說，沒什么比這個更有
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FPGA研發(fā)之道(19)- “背靠大樹好乘涼”--總線(下)
- 如果說在PC時代，壟斷PC江湖的是WINTEL(微軟和英特爾)，那么在移動互聯(lián)網(wǎng)時代，最具有這個潛質(zhì)的就是谷歌的andriod操作系統(tǒng)和ARM芯片?；贏RM公司授權(quán)的各型ARM處理器，基本上在各型嵌入式終端設(shè)備占據(jù)了壟斷地位?！氨晨看髽浜贸藳觥保虼?，用于作為ARM處理做片上系統(tǒng)互聯(lián)的AMBA總線標(biāo)準(zhǔn)亦成為業(yè)界應(yīng)用最廣泛的標(biāo)準(zhǔn)。 AMBA總線事實(shí)上為三個總線標(biāo)準(zhǔn)的合集，分別是AHB、ASB、APB。ASB已逐漸被AHB所取代，現(xiàn)在使用最廣泛的為AHB和APB總線，以及最
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Plunify的InTime設(shè)計優(yōu)化軟件可支持Altera 的FPGA和SoC
- 開創(chuàng)性FPGA軟件供應(yīng)商Plunify® Pte. Ltd.今日發(fā)布其支持Altera 的FPGA和SoC的InTimeTM設(shè)計優(yōu)化軟件。 Plunify的InTime軟件借助于運(yùn)算資源和機(jī)器學(xué)習(xí)技術(shù)，快速地生成解決設(shè)計問題的優(yōu)化策略。 Altera軟件和IP市場總監(jiān)Alex Grbic說，“我們很高興Plunify能成為我們的合作伙伴。與Plunify這樣的公司合作使我們可以向客戶提供更多相互支持的解決方案。” Plunify的InTime軟件能為A
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基于FPGA的軟件無線電平臺設(shè)計
- 軟件無線電的出現(xiàn)，是無線電通信從模擬到數(shù)字、從固定到移動后，由硬件到軟件的第三次變革。簡單地說，軟件無線電就是一種基于通用硬件平臺，并通 過軟件可提供多種服務(wù)的、適應(yīng)多種標(biāo)準(zhǔn)的、多頻帶多模式的、可重構(gòu)可編程的無線電系統(tǒng)。軟件無線電的關(guān)鍵思想是，將AD(DA)盡可能靠近天線和用軟件來 完成盡可能多的無線電功能。 蜂窩移動通信系統(tǒng)已經(jīng)發(fā)展到第三代，3G系統(tǒng)進(jìn)入商業(yè)運(yùn)行一方面需要解決不同標(biāo)準(zhǔn)的系統(tǒng)間的兼容性;另一方 面要求系統(tǒng)具有高度的靈活性和擴(kuò)展升級能力，軟件無線電技術(shù)無疑是最好的解決方案。用ASI
- 關(guān)鍵字： FPGA ASIC
Imagination 的新款 Codescape 工具可為 MIPS 軟件提供完整的生命周期開發(fā)環(huán)境
- Imagination Technologies 宣布，推出專為滿足 MIPS 軟件開發(fā)所需的新款工具，可適用于從 SoC 設(shè)計與集成、到 SoC 啟用到終端產(chǎn)品的整個產(chǎn)品生命周期。新的 Codescape MIPS SDK Essentials (MIPS SDK) 和 Codescape MIPS SDK Professional (MIPS proSDK) 可為針對從入門級MIPS 開發(fā)板到高端多核 SoC 系統(tǒng)等任何一種 MIPS-based 平臺的開發(fā)人員帶來強(qiáng)大的功能。 Imagin
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合攻低價智能手機(jī) 瑞芯微/Intel推整合型3G SoC
- 大陸手機(jī)晶片市場殺出程咬金。瑞芯微電子和英特爾(Intel)針對入門款A(yù)ndroid裝置，聯(lián)手推出3G手機(jī)晶片處理器--XMM 6321。該元件整合基頻處理器和應(yīng)用處理器成一顆系統(tǒng)單晶片(SoC)，是一款低價且可快速切入市場的產(chǎn)品，將為大陸3G手機(jī)晶片市場競局增添變數(shù)。 瑞芯微品牌經(jīng)理邢燕燕表示，該產(chǎn)品低功耗、低價格的優(yōu)勢可以大幅降低3G產(chǎn)品成本和上市時間，未來會是擴(kuò)大3G產(chǎn)品普及率的推手。 XMM 6321內(nèi)含XG632和AG620兩顆晶片;其中XG632采用安謀國際(ARM)雙核心中央
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基于FPGA的LCD顯示遠(yuǎn)程更新
- LED顯示屏的廣泛應(yīng)用使用戶迫切需要實(shí)現(xiàn)對其遠(yuǎn)程控制，本文詳細(xì)的介紹了LCD顯示的遠(yuǎn)程更新，想要了解全面的信息請參照文章。
- 關(guān)鍵字： FPGA LCD 遠(yuǎn)程更新 TCP/IP協(xié)議
Altera和IBM發(fā)布具有一致性共享存儲器的FPGA加速POWER系統(tǒng)
- Altera公司和IBM今天發(fā)布了業(yè)界第一款基于FPGA的加速平臺，通過IBM的一致性加速器處理器接口(CAPI)，實(shí)現(xiàn)FPGA與POWER8 CPU順暢的連接。這一可重新配置的硬件加速器在FPGA和處理器之間有共享虛擬存儲器，顯著提高了高性能計算(HPC)和數(shù)據(jù)中心應(yīng)用的系統(tǒng)性能、效率和靈活性。在超級計算2014年度大會上，Altera和IBM展示的幾種POWER8系統(tǒng)能夠使用FPGA實(shí)現(xiàn)連續(xù)加速。 通過與OpenPOWER基金會一起工作，Altera和IBM開發(fā)了非常靈活的異構(gòu)計算解決方案，
- 關(guān)鍵字： Altera IBM FPGA
ADI推出最新快速原型制作套件AD-FMCDAQ2-EB
- Analog Devices, Inc. (ADI: NASDAQ) 最近推出一款快速原型制作套件，其可簡化寬動態(tài)范圍 GSPA 數(shù)據(jù)轉(zhuǎn)換器到 FPGA(現(xiàn)場可編程門陣列)的連接。 數(shù)字和模擬設(shè)計人員可以采用快速原型制作套件 AD-FMCDAQ2-EBZ ，在主要的 FPGA 平臺(包括 Xilinx 的 UltraScale FPGA，以及 Zynq 用于雷達(dá)、儀器儀表、無線電和其它數(shù)據(jù)采集應(yīng)用的所有可編程 SoC 器件)上快速地對高速 JEDEC JESD204B SerDes(串行器/解串器)G
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聯(lián)發(fā)科技芯片獨(dú)辟蹊徑 引發(fā)廉價智能手機(jī)熱潮
- 十年前，諾基亞和摩托羅拉等手機(jī)巨擘基本上不會理睬臺灣聯(lián)發(fā)科技生產(chǎn)的芯片，而是雇用大量工程師對電子部件和電路系統(tǒng)進(jìn)行評估。 快速前進(jìn)到智能手機(jī)時代。 智能機(jī)市場中充斥著中國手機(jī)制商，他們推出廉價手機(jī)與蘋果和三星電子爭奪市場份額。臺灣的聯(lián)發(fā)科技是廉價智能手機(jī)興起的推動者。奉行薄利多銷策略的手機(jī)制造商對聯(lián)發(fā)科技的芯片青睞有加。 聯(lián)發(fā)科技最先將鏡頭和揚(yáng)聲器等硬件與低成本芯片進(jìn)行功能集成。這種系統(tǒng)級芯片(SoC)讓手機(jī)制造商不再需要自己花錢尋找和測試能夠與其采購的芯片相匹配的部件。這反過來有助
- 關(guān)鍵字： 聯(lián)發(fā)科 SoC 智能手機(jī)
FPGA研發(fā)之道(18)-設(shè)計不是湊波形(八)總線（上）
- 如果設(shè)計中有多個模塊，每個模塊內(nèi)部有許多寄存器或者存儲塊需要配置或者提供讀出那么實(shí)現(xiàn)方式有多種，主要如下： 實(shí)現(xiàn)方式一：可以在模塊頂部將所有寄存器引出，提供統(tǒng)一的模塊進(jìn)行配置和讀出。這種方式簡單是簡單，但是頂層連接工作量較大，并且如果配置個數(shù)較多，導(dǎo)致頂層中寄存器的數(shù)目也會較多。 實(shí)現(xiàn)方式二：通過總線進(jìn)行連接，為每個模塊分配一個地址范圍。這樣寄存器等擴(kuò)展就可以在模塊內(nèi)部進(jìn)行擴(kuò)展，而不用再頂層進(jìn)行過多的頂層互聯(lián)。如下圖所示： ? 那如果進(jìn)行總線的選擇，那么有一種
- 關(guān)鍵字： FPGA AVALON
FPGA研發(fā)之道(17)-化繁為簡
- 有個笑話說，有個病人感冒了，于是去看醫(yī)生，醫(yī)生診斷后說，你得了感冒，但是我只會治療肺炎，不如你回家再澆點(diǎn)涼水，把病惡化成肺炎，那我能治了。這個笑話展示了庸醫(yī)誤人。但是另一方面，從邏輯上來講，醫(yī)生則是一個把未知問題轉(zhuǎn)化成已知問題的高手。 不說笑話，下面出兩個題目，其分別是 問題1：運(yùn)用數(shù)字電路，如何將一個時鐘域的上升沿，轉(zhuǎn)換成另一個時鐘域的脈沖信號(單周期信號)。 問題2：運(yùn)用數(shù)字電路，如何將一個時鐘域的脈沖信號(單周期信號)，轉(zhuǎn)換成另一個時鐘域的上升沿。 可能乍一看，這兩個題目
- 關(guān)鍵字： FPGA 數(shù)字電路
FPGA研發(fā)之道(16)-可測性設(shè)計—從大數(shù)據(jù)開始說起
- 當(dāng)下，最火的學(xué)問莫過于《大數(shù)據(jù)》，大數(shù)據(jù)的核心思想就是通過科學(xué)統(tǒng)計，實(shí)現(xiàn)對于社會、企業(yè)、個人的看似無規(guī)律可循的行為進(jìn)行更深入和直觀的了解。FPGA的可測性也可以對FPGA內(nèi)部“小數(shù)據(jù)”的統(tǒng)計查詢，來實(shí)現(xiàn)對FPGA內(nèi)部BUG的探查。 可測性設(shè)計對于FPGA設(shè)計來說，并不是什么高神莫測的學(xué)問。FPGA的可測性設(shè)計的目的在設(shè)計一開始，就考慮后續(xù)問題調(diào)試，問題定位等問題。要了解FPGA可測性設(shè)計，只不過要回答幾個問題，那就是： (1) 設(shè)計完成如何進(jìn)行測試? (2)
- 關(guān)鍵字： FPGA JTAG
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