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dsp＋fpga 文章 最新資訊

SOPC技術(shù)在視覺(jué)測(cè)量中的設(shè)計(jì)方案與應(yīng)用

  • 1引言視覺(jué)測(cè)量技術(shù)是以機(jī)器視覺(jué)技術(shù)為基礎(chǔ)，融合電子技術(shù)、計(jì)算機(jī)技術(shù)、近景攝影測(cè)量技術(shù)、圖像處理...
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基于FPGA的兩路視頻同步播放系統(tǒng)的設(shè)計(jì)

  • 1、引言
    如圖 1所示，兩臺(tái)攝像機(jī)C1、C2分別對(duì)具有部分重疊區(qū)域的景物進(jìn)行拍攝。在 t1時(shí)刻拍攝，得到了圖像A1、B1；在下一時(shí)刻t2，得到了圖像A2、B2。
    在同一屏幕上重現(xiàn)原圖像時(shí)，必須保證兩個(gè)播放器依次同時(shí)播放圖
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米波段DBF體制雷達(dá)數(shù)字接收機(jī)的實(shí)現(xiàn)

  • 引言
    米波雷達(dá)作用距離遠(yuǎn)、成本低，并且具有較好的反隱身和抗反輻射導(dǎo)彈的能力，是對(duì)空情報(bào)雷達(dá)重點(diǎn)發(fā)展的方向之一[1]。采用DBF體制的雷達(dá)，引入空間信號(hào)處理技術(shù)，易于實(shí)現(xiàn)低副瓣波束和自適應(yīng)零點(diǎn)，能夠改善傳統(tǒng)體
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基于FPGA的DES加密算法的高性能實(shí)現(xiàn)

  • 在分析DES算法原理的基礎(chǔ)上，詳細(xì)闡述一種基于VHDL描述、FPGA實(shí)現(xiàn)的DES加密算法系統(tǒng)的設(shè)計(jì)和仿真結(jié)果。該系統(tǒng)采用了一種基于子密鑰預(yù)先計(jì)算的新型流水線設(shè)計(jì)方案，克服了傳統(tǒng)DES流水線實(shí)現(xiàn)方式的缺點(diǎn)，使系統(tǒng)的密鑰可動(dòng)態(tài)刷新．并在硬件資源消耗有所降低的情況下，進(jìn)一步提高系統(tǒng)的處理速度，系統(tǒng)最高時(shí)鐘頻率為222．77 MHz．信息加密的速度為14．26 Gb／s，是最快軟件實(shí)現(xiàn)方式的112倍。同時(shí)系統(tǒng)還具有設(shè)計(jì)靈活，可靠性高，可重用性強(qiáng)．升級(jí)方便等特點(diǎn)。
  • 關(guān)鍵字： FPGA  DES  加密算法  性能    

基于DSP的太陽(yáng)光線自動(dòng)跟蹤系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

  • 基于DSP的太陽(yáng)光線自動(dòng)跟蹤系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn),1 引言
    精確捕捉太陽(yáng)光線可提高太陽(yáng)能裝置，尤其是聚光類太陽(yáng)能裝置的太陽(yáng)能利用率?，F(xiàn)有的聚光類太陽(yáng)能發(fā)電系統(tǒng)主要采用程序控制、傳感器控制、程序與傳感器聯(lián)合控制的方法。程序控制方法是計(jì)算出太陽(yáng)在一天中
  • 關(guān)鍵字： 系統(tǒng)  設(shè)計(jì)  實(shí)現(xiàn)  跟蹤  自動(dòng)  DSP  太陽(yáng)  光線  基于  DSP  

基于單片機(jī)和FPGA的多功能計(jì)數(shù)器的設(shè)計(jì)

  • 1 引言
    頻率、周期、相位是交流信號(hào)的3大要素。一般情況下，分析交流信號(hào)需研究其頻率與相位，而周期可直接由頻率計(jì)算。對(duì)于正弦信號(hào)的頻率、相位測(cè)量準(zhǔn)確度的要求不斷提高，而隨著電子技術(shù)的發(fā)展，對(duì)其測(cè)量方法
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基于FPGA技術(shù)的模擬雷達(dá)信號(hào)的設(shè)計(jì)與實(shí)現(xiàn)

  • 前言FPGA（現(xiàn)場(chǎng)可編程門陣列）是由掩膜可編程門陣列和PLD（可編程邏輯器件）演變而來(lái)的，并將二者的特性結(jié)合...
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流水線技術(shù)在基于FPGA的DSP運(yùn)算中的應(yīng)用

  • 在數(shù)字信號(hào)處理(DSP)領(lǐng)域，需要處理的數(shù)據(jù)量很大，并且實(shí)時(shí)性要求很高。傳統(tǒng)的DSP設(shè)計(jì)方法主要有采用固定功...
  • 關(guān)鍵字： 流水線技術(shù)  FPGA  DSP  運(yùn)算  

基于FPGA和SC16C554實(shí)現(xiàn)多串口通信的方法

  • 0引言隨著電子技術(shù)的飛躍發(fā)展，通用數(shù)字信號(hào)處理器(DSP)的性能價(jià)格比不斷提高，數(shù)據(jù)處理能力不斷加...
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基于DSP的混合信號(hào)解決方案解決高級(jí)音頻處理難題

  • 從20世紀(jì)70年代產(chǎn)生構(gòu)想以來(lái)，特別是在過(guò)去十年間，數(shù)據(jù)信號(hào)處理(DSP)在媒體應(yīng)用激增的推動(dòng)下，已經(jīng)成為了一項(xiàng)耳熟能詳?shù)募夹g(shù)。從用于軍事的語(yǔ)音和圖像處理開始，這項(xiàng)技術(shù)首先發(fā)展進(jìn)入音頻和視頻的應(yīng)用環(huán)境，
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基于CPLD譯碼的DSP二次Bootloader方法

  • 基于CPLD譯碼的DSP二次Bootloader方法,隨著數(shù)字信號(hào)處理技術(shù)的快速發(fā)展，數(shù)字信號(hào)處理器(DSP)越來(lái)越廣泛地應(yīng)用于各種實(shí)時(shí)嵌入式系統(tǒng)中。當(dāng)系統(tǒng)調(diào)試完畢，想脫離仿真環(huán)境并在上電復(fù)位后自動(dòng)啟動(dòng)程序代碼運(yùn)行時(shí)，必須將程序代碼存儲(chǔ)在非易失性存儲(chǔ)器中。Fla
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滿足RF處理需求的嵌入式儀器設(shè)計(jì)

  • 無(wú)線市場(chǎng)就像是我們的一個(gè)新生的領(lǐng)域。新的射頻(RF)技術(shù)的爆炸性增長(zhǎng)為解決老問(wèn)題創(chuàng)造了新機(jī)會(huì)。靈活的高分辨率波形生成，數(shù)字化以及分析子系統(tǒng)能夠利用射頻信號(hào)配合下變頻, 并且調(diào)整多個(gè)關(guān)心點(diǎn)也是必需的。在并發(fā)，
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基于FPGA的數(shù)字下變頻設(shè)計(jì)與實(shí)現(xiàn)

  • 在擴(kuò)頻通信中，數(shù)字下變頻（DDC）是一種很重要的技術(shù)，它包括數(shù)字混頻器、數(shù)控振蕩器以及數(shù)字濾波器三部分。而傳統(tǒng)的DDC大多采用專用芯片，雖然其外圍電路簡(jiǎn)單、功能實(shí)現(xiàn)容易控制，但其大部分功能已經(jīng)固化，存在兼容
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基于FPGA的正交數(shù)字混頻器中數(shù)控振蕩器的設(shè)計(jì)與實(shí)

  • 要CORDIC(COordination Rotation DIgital Computer)算法實(shí)現(xiàn)正交數(shù)字混頻器中的數(shù)控振蕩器的方法。首先推導(dǎo)了算法產(chǎn)生正余弦信號(hào)的實(shí)現(xiàn)過(guò)程,然后給出了在中設(shè)計(jì)數(shù)控振蕩器的頂層電路結(jié)構(gòu),并根據(jù)算法特點(diǎn)在設(shè)計(jì)中引入
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TMS32OF2812與DIP-IPM的通用電路設(shè)計(jì)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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