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dsp＋fpga 文章 最新資訊

模塊化FPGA設(shè)計(jì)在某雷達(dá)接收機(jī)中的應(yīng)用

  • 0 引言
    目前基于FPGA和DSP結(jié)構(gòu)的軟件無(wú)線電技術(shù)被廣泛應(yīng)用在數(shù)字接收機(jī)設(shè)計(jì)中，雷達(dá)接收機(jī)領(lǐng)域的數(shù)字化技術(shù)也在日趨發(fā)展，如何借助數(shù)字化的軟硬件優(yōu)勢(shì)設(shè)計(jì)出易實(shí)現(xiàn)、靈活，并滿足不同性能指標(biāo)和目的的數(shù)字接收
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使用NI LabVIEW FPGA 與智能 DAQ的自動(dòng)高電壓電擊

  • Author(s):
    David Hakey - Medtronic, Inc.
    Patrick J. Ryan - Medtronic, Inc.
    Johnny Maynes - Medtronic, Inc. Industry:
    Electronics, Biotechnology Products:
    NI-VISA, LabVIEW, FPGA Module, PXI-7811R
  • 關(guān)鍵字： LabVIEW  FPGA  DAQ  自動(dòng)    

基于DSP仿人機(jī)器人關(guān)節(jié)控制器設(shè)計(jì)

  • 在具有32自由度仿人機(jī)器人中，為了每一個(gè)關(guān)節(jié)動(dòng)作準(zhǔn)確，可以采用分布式控制的體系結(jié)構(gòu)。這里采用基于RS 485總線的TMS320F240DSP作為分布式關(guān)節(jié)控制器，非常適合于在機(jī)械臂內(nèi)的狹小空間內(nèi)安裝，并進(jìn)行增量碼盤(pán)和速度檢測(cè)電路的設(shè)計(jì)以及相應(yīng)的軟件設(shè)計(jì)等，完成了6個(gè)自由度機(jī)械臂分布式關(guān)節(jié)控制器設(shè)計(jì)，能夠滿足仿人機(jī)器人技術(shù)與系統(tǒng)的運(yùn)動(dòng)軌跡的要求。
  • 關(guān)鍵字： 控制器  設(shè)計(jì)  關(guān)節(jié)  機(jī)器人  DSP  基于  

無(wú)人值守地面?zhèn)鞲衅飨到y(tǒng)設(shè)計(jì)

  • 1 設(shè)計(jì)任務(wù)及采用的器件
    1．1 設(shè)計(jì)任務(wù)
    (1)設(shè)計(jì)出小型化的地面?zhèn)鞲衅飨到y(tǒng)，可在一定范圍內(nèi)識(shí)別人員、輪式和履帶車(chē)輛目標(biāo)，并發(fā)送識(shí)別結(jié)果到接收顯示子系統(tǒng)。探測(cè)范圍200－400米。
    (2)技術(shù)參數(shù)：額定輸入
  • 關(guān)鍵字： 系統(tǒng)  設(shè)計(jì)  傳感器  地面  值守  無(wú)人  DSP  

基于FPGA的軟件無(wú)線電平臺(tái)設(shè)計(jì)　

  • 軟件無(wú)線電的出現(xiàn)，是無(wú)線電通信從模擬到數(shù)字、從固定到移動(dòng)后，由硬件到軟件的第三次變革。簡(jiǎn)單地說(shuō)，軟件無(wú)...
  • 關(guān)鍵字： FPGA  軟件無(wú)線電平臺(tái)  

基于DSP的實(shí)時(shí)圖像處理系統(tǒng)

  • 基于DSP的實(shí)時(shí)圖像處理系統(tǒng),引言 本文設(shè)計(jì)了基于TMS320C6000系列DSP的MPEG-4編碼器。將攝像頭獲取的圖像以MPEG-4標(biāo)準(zhǔn)進(jìn)行實(shí)時(shí)壓縮并通過(guò)VGA實(shí)時(shí)顯示，同時(shí)把壓縮好的數(shù)據(jù)通過(guò)PCI總線傳輸給ARM控制器，經(jīng)由ARM根據(jù)實(shí)際的需要進(jìn)行視頻數(shù)據(jù)的網(wǎng)
  • 關(guān)鍵字： 處理  理系  圖像  實(shí)時(shí)  DSP  基于  DSP  

基于FPGA的QPSK及OQPSK信號(hào)調(diào)制解調(diào)電路

  • 0引言調(diào)制識(shí)別技術(shù)在軍事、民用領(lǐng)域都有十分廣泛的應(yīng)用價(jià)值，近年來(lái)一直受到人們的關(guān)注。隨著更多...
  • 關(guān)鍵字： FPGA  QPSK  OQPSK  調(diào)制  解調(diào)  

以FPGA為橋梁的FIFO設(shè)計(jì)方案及其應(yīng)用

  • 引言在利用DSP實(shí)現(xiàn)視頻實(shí)時(shí)跟蹤時(shí)，需要進(jìn)行大量高速的圖像采集。而DSP本身自帶的FIFO并不足以支持...
  • 關(guān)鍵字： FPGA  FIFO  SDRAM  DSP  

基于CPLD/FPGA的多功能分頻器的設(shè)計(jì)與實(shí)現(xiàn)

  • 引言 分頻器在CPLD/FPGA設(shè)計(jì)中使用頻率比較高,盡管目前大部分設(shè)計(jì)中采用芯片廠家集成的鎖相環(huán)資源 ,但是對(duì)于要求奇數(shù)倍分頻（如3、5等）、小數(shù)倍（如2.5、3.5等）分頻、占空比50%的應(yīng)用場(chǎng)合卻往往不能滿足要求。
  • 關(guān)鍵字： CPLD  FPGA  多功能  分頻器    

基于DSP TMS320LF2407的PWM整流技術(shù)研究

  • 引 言 整流器作為一種AC／DC變換裝置，其發(fā)展經(jīng)歷了由不可控整流器(二極管整流)、相控整流器(晶閘管整流)到PWM整流器(門(mén)極可關(guān)斷功率開(kāi)關(guān)管)的發(fā)展歷程。晶閘管相控整流和二極管不可控整流對(duì)電網(wǎng)諧波污染嚴(yán)重，且
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基于DSP和FPGA的調(diào)幅廣播信號(hào)監(jiān)測(cè)系統(tǒng)

  • 基于DSP和FPGA的調(diào)幅廣播信號(hào)監(jiān)測(cè)系統(tǒng),　引言　　隨著通信與廣播電視業(yè)務(wù)的發(fā)展，無(wú)線電頻譜迅速、大量的被占用，頻道擁擠和相互間干擾日趨嚴(yán)重，為了能有效地利用無(wú)線電頻譜，減少相互間的干擾，信號(hào)監(jiān)測(cè)業(yè)務(wù)隨之成為必要。調(diào)幅廣播信號(hào)監(jiān)測(cè)系統(tǒng)是用于實(shí)
  • 關(guān)鍵字： 信號(hào)  監(jiān)測(cè)  系統(tǒng)  廣播  調(diào)幅  DSP  FPGA  基于  DSP  FPGA  

基于數(shù)字化控制的開(kāi)關(guān)電源的研究

  • 0 引言
    開(kāi)關(guān)電源被譽(yù)為高效節(jié)能型電源。傳統(tǒng)的開(kāi)關(guān)電源采用模擬控制技術(shù)，使用比較器、誤差放大器和模擬調(diào)變器等元器件來(lái)調(diào)整電源輸出電壓。模擬控制方法只適用于頻率高、電力小、功能少的開(kāi)關(guān)電源，且存在控制
  • 關(guān)鍵字： 研究  開(kāi)關(guān)電源  控制  數(shù)字化  基于  電源  DSP  

Altera 推出業(yè)界首款串行 RapidIO 2.1 IP 解決方案

  • 　　Altera 公司 (NASDAQ: ALTR) 今天宣布推出業(yè)界首款支持 RapidIO® 2.1 規(guī)范的知識(shí)產(chǎn)權(quán) (IP) 內(nèi)核。Altera 的串行 RapidIO IP 內(nèi)核可支持多達(dá)四條通道，每條通道速率為 5.0 GBaud，從而滿足了無(wú)線市場(chǎng)日益增長(zhǎng)的帶寬和可靠性需求。該 IP 內(nèi)核專(zhuān)門(mén)針對(duì)擁有多個(gè)嵌入式收發(fā)器的 Stratix® IV FPGA 而優(yōu)化，并得到了Quartus® II 軟件 v9.1 的支持。 　　RapidIO 2.1 規(guī)范在許多應(yīng)用中均可實(shí)
  • 關(guān)鍵字： Altera  RapidIO  FPGA  Quartus  

擴(kuò)大嵌入式領(lǐng)域勢(shì)力范圍 FPGA廠商積極備戰(zhàn)

  • 　　隨著經(jīng)濟(jì)情勢(shì)與市場(chǎng)環(huán)境的改變,歷經(jīng)長(zhǎng)足發(fā)展的可編程邏輯組件(PLD)正憑借著成熟的技術(shù)將觸角深入量產(chǎn)型的消費(fèi)及嵌入式市場(chǎng),并以更加經(jīng)濟(jì)的開(kāi)發(fā)成本持續(xù)搶占傳統(tǒng)ASIC/ASSP市場(chǎng). 　　"ASIC/ASSP的商業(yè)模式愈來(lái)愈難以為繼,"愛(ài)特(Actel)公司應(yīng)用工程師陳冠志指出.巨額的芯片制造成本是首先面臨的關(guān)卡."300mm晶圓廠的成本以驚人的速度增長(zhǎng),在45nm節(jié)點(diǎn)約需30億美元;而到了32nm節(jié)點(diǎn),估計(jì)會(huì)達(dá)到100億美元."另一方面,全球市場(chǎng)的動(dòng)蕩情況,也
  • 關(guān)鍵字： Altera  FPGA  40nm  
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