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dsp＋fpga 文章 最新資訊

基于FPGA的高速自適應(yīng)格型濾波器的實(shí)現(xiàn)

  • 摘要：針對(duì)高速高靈敏度數(shù)字信號(hào)處理時(shí)對(duì)于自適應(yīng)濾波器的數(shù)值特性和實(shí)時(shí)性的要求，在一種自適應(yīng)格型聯(lián)合濾波器的基礎(chǔ)上提出算法改進(jìn)，采用馳豫超前流水線技術(shù)和時(shí)序重構(gòu)技術(shù)，在損失較小濾波性能的情況下，在FPGA中
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cpld fpga 區(qū)別

  • 系統(tǒng)的比較,與大家共享：盡管ＦＰＧＡ和ＣＰＬＤ都是可編程ＡＳＩＣ器件,有很多共同特點(diǎn),但由于ＣＰＬＤ和ＦＰＧＡ結(jié)構(gòu)上的差異,具有各自的特點(diǎn):①ＣＰＬＤ更適 ...
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用一個(gè)時(shí)鐘在FPGA中計(jì)算直方圖

  • 直方圖對(duì)數(shù)字?jǐn)?shù)據(jù)的分析通常是一種有用的工具。不過，要從一個(gè)直方圖獲得可靠的結(jié)果，必須獲得大量數(shù)據(jù)，通常是要...
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數(shù)字控制的開關(guān)電源設(shè)計(jì)方案

  • 引言在高功率因數(shù)校正AC/DC電路中廣泛采用UC3842、UC3855A等專用控制芯片來實(shí)現(xiàn)功率因數(shù)校正，而在...
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基于DSP和PCI總線的通信數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

  • 隨著數(shù)字信號(hào)處理器性能的不斷提高及其成本與售價(jià)的大幅下降，數(shù)字信號(hào)處理應(yīng)用領(lǐng)域飛速擴(kuò)展，信號(hào)處理進(jìn)入...
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基于FPGA的UART接口開發(fā)方案

  • 由于FPGA的功能日益強(qiáng)大，開發(fā)周期短、可重復(fù)編程等優(yōu)點(diǎn)也越來越明顯，可以在FPGA芯片上集成UART功能模塊，從...
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基于DSP的安全無線多媒體數(shù)字終端

  • 基于DSP的安全無線多媒體數(shù)字終端,1 系統(tǒng)概述
    　　本設(shè)計(jì)利用DSP開發(fā)板的強(qiáng)大運(yùn)算能力，實(shí)現(xiàn)了多種需要進(jìn)行大量運(yùn)算的信息安全算法。實(shí)現(xiàn)了開機(jī)用戶認(rèn)證、語音保密通信[1][2]、文字信息加密傳輸、信息隱藏傳輸[3]、跳頻通信[4]、信息安全存儲(chǔ)備份、
  • 關(guān)鍵字： 數(shù)字  終端  多媒體  無線  DSP  安全  基于  

基于TMS320VC5509 DSP的有源噪聲控制系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

  • 基于TMS320VC5509 DSP的有源噪聲控制系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn),摘要：介紹了有源噪聲控制技術(shù)的理論基礎(chǔ)和算法，以自適應(yīng)有源噪聲前饋控制系統(tǒng)為研究核心，選用TMS320VC5509 DSP作為控制器，給出了系統(tǒng)的硬件解決方案，并用C語言編程在硬件系統(tǒng)上實(shí)現(xiàn)了基于FX-LMS算法的有源噪聲實(shí)
  • 關(guān)鍵字： 控制系統(tǒng)  設(shè)計(jì)  實(shí)現(xiàn)  噪聲  有源  TMS320VC5509  DSP  基于  

基于FPGA的UART接口模塊設(shè)計(jì)

  • 基于FPGA的UART接口模塊設(shè)計(jì),UART（UniversalAnynchronousReceiverTransmitter,通用異步接收發(fā)送器）是廣泛應(yīng)用的串行數(shù)據(jù)傳輸協(xié)議之一，其應(yīng)用范圍遍及計(jì)算機(jī)外設(shè)、工控自動(dòng)化等場合。雖然USB傳輸協(xié)議比UART協(xié)議有更高的性能，但電路復(fù)雜開發(fā)難
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一種基于FPGA的高速誤碼測試儀的設(shè)計(jì)

  • 摘要：誤碼測試儀是檢測通信系統(tǒng)可靠性的重要設(shè)備。傳統(tǒng)的誤碼測試儀基于CPLD和CPU協(xié)同工作，不僅結(jié)構(gòu)復(fù)雜，價(jià)格昂貴，而且不方便攜帶。基于FPGA的高速誤碼測試儀，采用FPGA來完成控制和測試模塊的一體化設(shè)計(jì)，提高了
  • 關(guān)鍵字： FPGA  誤碼測試  儀的設(shè)計(jì)    

基于FPGA的FIR濾波器的性能研究

  • 摘要：目前FIR濾波器的一般設(shè)計(jì)方法比較繁瑣，開發(fā)周期長，如果采用設(shè)計(jì)好的FIR濾波器的IP核，則開發(fā)效率大為提高。本方案基于Altera公司的CycloneⅡ系列芯片EP2C8Q208C8N，首先利用MATLAB中的濾波器函數(shù)fir2得出需產(chǎn)
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基于FPGA的幅值可調(diào)信號(hào)發(fā)生器設(shè)計(jì)

  • 摘要：針對(duì)信號(hào)發(fā)生器時(shí)輸出頻率精度高和幅值可調(diào)的要求，采用直接數(shù)字頻率合成(DDS)技術(shù)，提出一種基于FPGA的幅值、頻率均可調(diào)的、高分辨率、高穩(wěn)定度的信號(hào)發(fā)生器設(shè)計(jì)方案。采用AT89S52單片機(jī)為控制器，控制FPGA產(chǎn)
  • 關(guān)鍵字： FPGA  幅值  信號(hào)發(fā)生器    

基于FPGA的QDPSK調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：介紹了QDPSK信號(hào)的優(yōu)點(diǎn)，并分析了其實(shí)現(xiàn)原理，提出一種QDPSK高性能數(shù)字調(diào)制器的FPGA實(shí)現(xiàn)方案。采用自頂向下的設(shè)計(jì)思想，將系統(tǒng)分成串／并變換器、差分編碼器、邏輯選相電路、四相載波發(fā)生器等4大模塊，用原理圖
  • 關(guān)鍵字： QDPSK  FPGA  調(diào)制器    

一種DSP通信接口的設(shè)計(jì)和實(shí)現(xiàn)

  • 1.概述隨著科學(xué)技術(shù)的快速發(fā)展，過程控制領(lǐng)域在過去的兩個(gè)世紀(jì)里發(fā)生了巨大的變革。微處理器的普遍應(yīng)用...
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紅外目標(biāo)識(shí)別跟蹤系統(tǒng)的DSP+FPGA實(shí)現(xiàn)

  • 紅外目標(biāo)識(shí)別跟蹤系統(tǒng)的DSP+FPGA實(shí)現(xiàn),現(xiàn)場可編程門陣列(FPGA)是在專用ASIC的基礎(chǔ)上發(fā)展出來的，它克服了專用ASIC不夠靈活的缺點(diǎn)。與其他中小規(guī)模集成電路相比，其優(yōu)點(diǎn)主要在于它有很強(qiáng)的靈活性，即其內(nèi)部的具體邏輯功能可以根據(jù)需要配置，對(duì)電路的修改和
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