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cpld／fpga 文章 最新資訊

FPGA易測試性分析

  • FPGA易測試性分析,現(xiàn)代科技對系統(tǒng)的可靠性提出了更高的要求，而FPGA技術(shù)在電子系統(tǒng)中應(yīng)用已經(jīng)非常廣泛，因此FPGA易測試性就變得很重要。要獲得的FPGA內(nèi)部信號十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲，這一切使得設(shè)計調(diào)試和檢驗變
  • 關(guān)鍵字： 分析  測試  FPGA  

基于CPLD的壓電生物傳感器檢測電路設(shè)計

  • 介紹了一種基于復(fù)雜可編程邏輯器件(CPLD)的壓電生物傳感器檢測電路。該檢測電路以高性能CPLD(MAX7128)...
  • 關(guān)鍵字： FPGA  CPLD  生物傳感器  檢測電路  

基于FPGA及DSP Builder的VGA接口設(shè)計

  • 基于FPGA及DSP Builder的VGA接口設(shè)計,本文基于DSP Builder的VGA接口設(shè)計方法，對VGA接口時序和系統(tǒng)設(shè)計需求進(jìn)行了介紹，并在硬件平臺下實現(xiàn)一維與二維信號的顯示。

    VGA接口標(biāo)準(zhǔn)

    VGA顯像原理

    顯示器通過光柵掃描的方式，電子束在顯示屏幕上
  • 關(guān)鍵字： 接口  設(shè)計  VGA  Builder  FPGA  DSP  基于  

基于SRAM工藝FPGA的保密性問題

  • 在現(xiàn)代電子系統(tǒng)設(shè)計中，由于可編程邏輯器件的卓越性能、靈活方便的可升級特性，而得到了廣泛的應(yīng)用。由于大規(guī)模高密度可編程邏輯器件多采用SRAM工藝，要求每次上電，對FPGA器件進(jìn)行重配置，這就使得可以通過監(jiān)視配置
  • 關(guān)鍵字： 保密性  問題  FPGA  工藝  SRAM  基于  

基于FPGA的快速9／7整形離散小波變換系統(tǒng)

  • 美國空間數(shù)據(jù)系統(tǒng)咨詢委員會(簡稱CCSDS)于2005年推出一套適用于空間領(lǐng)域的圖像壓縮標(biāo)準(zhǔn)，標(biāo)準(zhǔn)使用了離散...
  • 關(guān)鍵字： 小波變換  FPGA  CCSDS圖像壓縮  

軟件無線電設(shè)計中ASIC、FPGA和DSP的選擇

  • ASIC、FPGA和DSP的應(yīng)用領(lǐng)域呈現(xiàn)相互覆蓋的趨勢，使設(shè)計人員必須在軟件無線電結(jié)構(gòu)設(shè)計中重新考慮器件選擇...
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Modbus通信協(xié)議的FPGA實現(xiàn)

  • Modbus協(xié)議是一個應(yīng)用廣泛的工業(yè)現(xiàn)場總線協(xié)議，鑒于其簡單、開放、幀格式緊湊等優(yōu)點，于2008年正式成為我國國家標(biāo)準(zhǔn)。介紹一種通過Cyclone系列FPGA實現(xiàn)Modbus RTU模式的方法，首先給出一個可以通用于Modbus主設(shè)備和從設(shè)備的協(xié)議接口單元，然后基于該接口設(shè)計了一個通用的Modbus從設(shè)備協(xié)處理器。實踐證明該方法能夠滿足工業(yè)環(huán)境的通訊要求，此外，該方法在其他FPGA上也具有一定通用性和推廣價值。
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Altera Stratix V FPGA提供RLDRAM 3存儲器支持

  • 　　Altera公司今天發(fā)布Stratix® V系列FPGA，適用于支持Micron技術(shù)公司的下一代低延時DRAM (RLDRAM® 3存儲器)。Stratix V FPGA采用新的存儲器體系結(jié)構(gòu)，降低延時，高效實現(xiàn)FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網(wǎng)絡(luò)設(shè)備生產(chǎn)商提供存儲器接口解決方案，支持在互聯(lián)網(wǎng)上迅速有效的傳送視頻、語音和數(shù)據(jù)。 　　Micron公司業(yè)務(wù)開發(fā)高級經(jīng)理Bruce Franklin表示：“Micron的下一代RLDRAM 3存儲器專門設(shè)
  • 關(guān)鍵字： Altera  FPGA  Stratix  

基于 CPLD EPM570T100C5的通用直流調(diào)速模塊設(shè)計

  • 基于 CPLD EPM570T100C5的通用直流調(diào)速模塊設(shè)計,本文針對常見調(diào)速應(yīng)用，采用可控硅做為調(diào)速元件，采用EPM570T100C5設(shè)計和實現(xiàn)了一個通用直流調(diào)速模塊，為實現(xiàn)遠(yuǎn)距離控制內(nèi)置了RS 485通信和簡單通信協(xié)議。采用EPM570T100C5作為控制核心，電路簡潔，輸出控制脈沖精確
  • 關(guān)鍵字： 調(diào)速  模塊  設(shè)計  直流  通用  CPLD  EPM570T100C5  基于  

基于CPLD器件設(shè)計的單穩(wěn)態(tài)電路

  • 基于CPLD器件設(shè)計的單穩(wěn)態(tài)電路,隨著電子技術(shù)特別是數(shù)字集成電路技術(shù)的迅猛發(fā)展，市面上出現(xiàn)了FPGA、CPLD等大規(guī)模數(shù)字集成電路，并且其工作速度和產(chǎn)品質(zhì)量不斷提高。利用大規(guī)模數(shù)字集成電路實現(xiàn)常規(guī)的單穩(wěn)態(tài)集成電路所實現(xiàn)的功能，容易滿足寬度、精
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基于CPLD的水下沖擊波記錄儀的設(shè)計

  • 基于CPLD的水下沖擊波記錄儀的設(shè)計,1.引言
    　　
    隨著大規(guī)模集成電路和單片機的迅速發(fā)展，復(fù)雜可編程邏輯器件（CPLD）具有使用靈活、可靠性高、功能強大的優(yōu)點，在電子產(chǎn)品設(shè)計中得到了廣泛的應(yīng)用。CPLD可實現(xiàn)在系統(tǒng)編程，重復(fù)多次，而且還兼容IEEE1
  • 關(guān)鍵字： 記錄儀  設(shè)計  沖擊波  水下  CPLD  基于  

節(jié)省電池能量的系統(tǒng)斷電電路CPLD

  • 節(jié)省電池能量的系統(tǒng)斷電電路CPLD,今天，大多數(shù)的CPLD（復(fù)雜可編程邏輯器件）都采用可減少功耗的工作模式，但當(dāng)系統(tǒng)未使用時，應(yīng)完全切斷電源以保存電池能量，從而實現(xiàn)很多設(shè)計者的終極節(jié)能目標(biāo)。圖1描述了如何在一片CPLD 上增加幾只分立元件，實現(xiàn)一
  • 關(guān)鍵字： 電路  CPLD  斷電  系統(tǒng)  電池  能量  節(jié)省  

基于CPLD的專用鍵盤接口芯片的方案設(shè)計

  • 基于CPLD的專用鍵盤接口芯片的方案設(shè)計,在單片機應(yīng)用系統(tǒng)中，存在多種形式的外部數(shù)據(jù)輸入接口界面，例如RS-232C串行通信、鍵盤輸入等[1,4] 。其中利用鍵盤接口輸入數(shù)據(jù)，是實現(xiàn)現(xiàn)場實時調(diào)試、數(shù)據(jù)調(diào)整和控制最常用的方法。單片機的外圍鍵盤擴展電路有多種實
  • 關(guān)鍵字： 芯片  方案設(shè)計  接口  鍵盤  CPLD  專用  基于  

ARM920T基于Linux平臺下的FPGA驅(qū)動開發(fā)

  • ARM920T基于Linux平臺下的FPGA驅(qū)動開發(fā),Linux操作系統(tǒng)的全稱是GNU／Linux，它是由GNU工程和Linux內(nèi)核兩個部分共同組成的一個操作系統(tǒng)。該系統(tǒng)中所有組件的源代碼都是自由的，可以有效保護(hù)學(xué)習(xí)成果，因而在嵌入式領(lǐng)域得到了廣泛的應(yīng)用。

    FPGA是英文Field
  • 關(guān)鍵字： 驅(qū)動  開發(fā)  FPGA  平臺  基于  Linux  ARM920T  
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