將近一半的嵌入式設計用到FPGA，僅次于微控制器。FPGA可用于執(zhí)行任何膠合邏輯、自定義IP 、計算密集型算法加速器。通過采取一些處理任務， FPGA可以幫助提高系統(tǒng)性能，從而使單片機從周期密集的任務中騰出部分時間
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接口 設計 FPGA 控制器 實現(xiàn) 如何
賽靈思公司(Xilinx)宣布推出其首批用于加速28nm7系列FPGA系統(tǒng)開發(fā)與集成能力提升的目標設計平臺。賽靈思針對 FPGA 系統(tǒng)設計和集成的目標設計平臺方法提供了業(yè)界最全面的開發(fā)套件，包括開發(fā)板、ISE 設計套件工具、IP 核、參考設計和 FPGA 夾層卡 (FMC)，能幫助設計人員立即啟動應用開發(fā)。
新型Virtex?-7 FPGA VC707 評估套件、Kintex-7 FPGA KC705 評估套件，以及與安富利電子元件部( Avnet Electronic Marketing)聯(lián)合
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賽靈思 FPGA
引言 現(xiàn)代電信系統(tǒng)已發(fā)展為一個龐大的綜合化數(shù)字網(wǎng)絡，除了提供傳統(tǒng)電話服務外，也提供多種數(shù)據(jù)接入服務，其典型應用是為其它專用通信系統(tǒng)提供數(shù)據(jù)中繼服務。因E1信號接入方式簡單，一般電信交換機都會預留部分E1接入
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ST-BUS CPLD 總線 收發(fā)
從消費類產(chǎn)品到通信產(chǎn)品，微處理器都有著非常廣泛的應用。目前流行的8位微處理器不僅能夠完成高運算量的任務，而且成本很低，因此取得了巨大成功。微處理器非常擅長于有序處理和各種非實時的任務，典型的工作速度在2
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CPLD 彈性 指令集 微控制器
1 引言CPLD是一種用戶可以根據(jù)自行需要而自己能夠設計構造其邏輯功能的數(shù)字集成電路系統(tǒng),實現(xiàn)了硬件設計的軟件化。CPLD具有豐富的可編程I/O引腳，具有在系統(tǒng)可編程( In System programmability)、使用方便靈活的的特
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CPLD DSP VME 背板
隨著 FPGA 技術逐步延伸至軍事電子系統(tǒng)以及嵌入式電子產(chǎn)業(yè)的幾乎全部領域，能發(fā)揮可編程邏輯優(yōu)勢的應用已經(jīng)占據(jù)主流地位。通信、機載和控制系統(tǒng)尤其受益于 FPGA 的設計靈活性、現(xiàn)場重構和并行處理功能。同時，較短的
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FPGA 高級設計 方法
賽靈思在 DesignCon 2012 展會上推出面向 28nm 7 系列 FPGA 的目標設計平臺——3 款最新開發(fā)套件，其中包括Kintex?-7 FPGA KC705 評估套件、Virtex?-7 FPGA VC707 評估套件，以及 與 安富利電子元件部 (Avnet Electronic Marketing) 聯(lián)合開發(fā)的 Kintex?-7 FPGA DSP 套件。
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賽靈思 FPGA
全球可編程平臺領導廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )宣布推出其首批用于加速 28nm 7 系列FPGA系統(tǒng)開發(fā)與集成能力提升的目標設計平臺。賽靈思針對 FPGA 系統(tǒng)設計和集成的目標設計平臺方法提供了業(yè)界最全面的開發(fā)套件，包括開發(fā)板、ISE 設計套件工具、IP 核、參考設計和 FPGA 夾層卡 (FMC)，能幫助設計人員立即啟動應用開發(fā)。
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Xilinx FPGA
全球可編程平臺領導廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )今天宣布推出 ISE? 13.4設計套件。該設計套件可提供對 MicroBlaze? 微控制器系統(tǒng) (MCS) 的公共訪問功能、面向 28nm 7 系列 FPGA 的全新 RX 裕量分析和調試功能，以及支持面向 Artix?-7 系列和 Virtex?-7 XT 器件的部分可重配置功能。
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Xilinx FPGA ISE 13.4
JavaCard指令處理器的FPGA設計,1 JavaCard簡介 智能卡是指集成了CPU、ROM、RAM、COS(芯片操作系統(tǒng))和EEPROM，能儲存信息和圖像，具備讀/寫能力，信息能被加密保護的便攜卡。智能卡的最基本標準是ISO/IEC7816。智能卡在銀行、電信等行業(yè)得到廣泛
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設計 FPGA 處理器 指令 JavaCard
1 引言
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FPGA SOC 控制器
隨著數(shù)字通信技術的飛速發(fā)展，軟件無線電的應用愈加的廣泛， 而影響軟件無線電性能的關鍵器件數(shù)控振蕩器NCO(Numerical CONtrolled Oscillator) 的設計至關重要直接數(shù)字頻率合成(DDS)技術是一種從相位概念出發(fā)直接合
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FPGA NCO 設計方案
背景可編程邏輯器件的設計方法經(jīng)歷了布爾等式，原理圖輸入，硬件描語言這樣一個發(fā)展過程。隨著設計的日益復雜和可編程邏輯器件規(guī)模的不斷擴大，人們不停地尋求更加抽象的行為級設計方法，以便在盡可能短時間內完成自
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FPGA 大規(guī)模
0 引 言
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16C554 CPLD 航空發(fā)動機 參數(shù)采集器
引言 多節(jié)點系統(tǒng)，在目前的很多電子系統(tǒng)應用場合都可以看到。這種多節(jié)點系統(tǒng)由于具有結構可擴展性、功能配置的靈活性以及便于查找故障節(jié)點等良好的可維護性得到了越來越廣泛的應用。通常，多節(jié)點系統(tǒng)各個節(jié)點的主
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FPGA 節(jié)點 大容量 方法
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