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cpld／fpga 文章 最新資訊

基于CPLD的智能寬帶去邊沿抖動技術(shù)

  • 引　言在電子設(shè)計和測量過程中，信號邊沿抖動是我們經(jīng)常碰到的現(xiàn)象。如下圖示，t1，t2，...，t4，信號電平變化時出現(xiàn)多次隨機(jī)快速變化，這種隨機(jī)變化在有的場合可以容忍，但大部分時候是難以容忍的，比如精密測量、精
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基于FPGA實現(xiàn)的計算機(jī)與HDTV顯示器測試信號發(fā)生器

  • 摘要:為產(chǎn)生滿足14種計算機(jī)并兼容4種高清晰度電視(HDTV)視頻標(biāo)準(zhǔn)的13種測試圖案信號,研究開發(fā)了計算機(jī)與高清晰度電視顯示器測試信號發(fā)生器.采用現(xiàn)場可編程門陣列(FPGA)完成測試圖案數(shù)據(jù)存儲、各種視頻標(biāo)準(zhǔn)時序產(chǎn)生及
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應(yīng)用CPLD實現(xiàn)交通控制系統(tǒng)芯片設(shè)計

  • 摘要：介紹可編程邏輯器件的結(jié)構(gòu)和開發(fā)軟件MAX+PLUSII主要特點，以交通控制系統(tǒng)電路芯片設(shè)計為例，敘述自頂向下的設(shè)計方法。集成電路的發(fā)展經(jīng)歷了從小規(guī)模、中規(guī)模、大規(guī)模和超大規(guī)模集成的過程，但隨著科學(xué)技術(shù)的發(fā)
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萊迪思推出MachXO2 系列超低密度FPGA控制開發(fā)套件

  • 萊迪思半導(dǎo)體公司(NASDAQ: LSCC)日前宣布推出MachXO2?系列超低密度FPGA控制開發(fā)套件，適用于低成本的復(fù)雜系統(tǒng)控制和視頻接口設(shè)計的樣機(jī)開發(fā)。新加入了MachXO2-4000HC器件，包括4320個查找表(LUT)的可編程邏輯和222 Kbit片上存儲器，滿足了通信、計算、工業(yè)、消費電子和醫(yī)療市場所需的系統(tǒng)控制和接口應(yīng)用。
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降低FPGA功耗的設(shè)計技巧和ISE功能分析工具

  • 新一代FPGA的速度變得越來越快，密度變得越來越高，邏輯資源也越來越多。那么如何才能確保功耗不隨這些一起增加呢?很多設(shè)計抉擇可以影響系統(tǒng)的功耗，這些抉擇包括從顯見的器件選擇到細(xì)小的基于使用頻率的狀態(tài)機(jī)值的選
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加速FPGA系統(tǒng)實時調(diào)試技術(shù)

  • 摘要：隨著FPGA的設(shè)計速度、尺寸和復(fù)雜度明顯增長，在整個設(shè)計流程中的實時驗證和調(diào)試部分成為當(dāng)前FPGA系統(tǒng)的關(guān)鍵部分。獲得FPGA內(nèi)部信號有限、FPGA封裝和印刷電路板(PCB)電氣噪聲，這一切使得設(shè)計調(diào)試和檢驗變成設(shè)計
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基于CPLD寬帶移動通信系統(tǒng)數(shù)據(jù)幀的實現(xiàn)

  • 摘　要：寬帶移動通信系統(tǒng)的關(guān)鍵技術(shù)之一是自適應(yīng)調(diào)制，與窄帶移動通信系統(tǒng)的調(diào)制方式完全不同，因而系統(tǒng)數(shù)據(jù)幀格式也隨之改變，針對采用時分雙工(TDD)工作方式的時分復(fù)分系統(tǒng)(TDMA)，利用CPLD(復(fù)雜可編程邏輯器件)技
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基于FPGA的UART設(shè)計

  • UART作為RS232協(xié)議的控制接口得到了廣泛的應(yīng)用，將UART的功能集成在FPGA芯片中，可使整個系統(tǒng)更為靈活、緊湊，減小整個電路的體積，提高系統(tǒng)的可靠性和穩(wěn)定性。提出了一種基于FPGA的UART的實現(xiàn)方法，具體描述了發(fā)送、接收等模塊的設(shè)計，恰當(dāng)使用了有限狀態(tài)機(jī)，實現(xiàn)了FPGA片上UART的設(shè)計，給出了仿真結(jié)果。
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RADX、Xilinx和ADI聯(lián)合演示可編程EdgeQAM技術(shù)方案

  • RADX? Technologies公司、賽靈思公司(納斯達(dá)克：XLNX)和 ADI公司(納斯達(dá)克：ADI)在2012年SCTE有線電視技術(shù)展會(SCTE Cable-Tec Expo)上聯(lián)合演示了業(yè)界最具擴(kuò)展性的EdgeQAM可編程解決方案。
  • 關(guān)鍵字： RADX  賽靈思  ADI  FPGA  

了解LabVIEW FPGA和軟件設(shè)計射頻儀器的優(yōu)勢所在

  • 概覽 　　無線設(shè)備的數(shù)量、通信標(biāo)準(zhǔn)的多樣性，以及調(diào)制方案的復(fù)雜度，每一年都在不斷增加。而隨著每一代新技術(shù)的誕生，由于使用傳統(tǒng)技術(shù)測試無線設(shè)備，需要大量更復(fù)雜的測試設(shè)備，其成本也在不斷提高。 　　使用虛擬(軟件)儀器與模塊化I/O相結(jié)合是一種最小化硬件成本并減少測試時間的方法。軟件設(shè)計儀器的新方法使得射頻測試工程師無需憑借自定義或特殊標(biāo)準(zhǔn)的儀器，就能以多個數(shù)量級的幅度減少測試時間。
  • 關(guān)鍵字： NI  虛擬(軟件)儀器  LabVIEW  FPGA  vst  

單片機(jī)+CPLD在電子設(shè)計中的應(yīng)用

FPGA與PCB板焊接的連接問題分析

  • 問題描述：81%的電子系統(tǒng)中在使用FPGA，包括很多商用產(chǎn)品和國防產(chǎn)品，并且多數(shù)FPGA使用的是BGA封裝形式。BGA封裝形式的特點是焊接球小和焊接球的直徑小。當(dāng)FGPA被焊在PCB板上時，容易造成焊接連接失效。焊接連接失效
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基于FPGA的24點離散傅里葉變換結(jié)構(gòu)設(shè)計

  • 摘要 基于Good—Thomas映射算法和ISE快速傅里葉變換IP核，設(shè)計了一種易于FPGA實現(xiàn)的24點離散傅里葉變換，所設(shè)計的24點DFT模塊采用流水線結(jié)構(gòu)，主要由3個8點FFT模塊和1個3點DFT模塊級聯(lián)而成，并且兩級運算之間不
  • 關(guān)鍵字： FPGA  離散  傅里葉變換  結(jié)構(gòu)設(shè)計    

基于CPLD的無人機(jī)綜合無線電系統(tǒng)中擴(kuò)頻電路的設(shè)計

  • 1 引言擴(kuò)展頻譜通信(簡稱擴(kuò)頻通信)與常規(guī)通信系統(tǒng)相比，具有較強(qiáng)的抗人為干擾、窄帶干擾和多徑干擾能力，和信息隱蔽、低空間無線電波“通量密度”以及多址保密通信等優(yōu)點。因此，其在軍事通信領(lǐng)域得到了廣
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基于FPGA的氣象雜波圖設(shè)計與實現(xiàn)

  • 1 引 言無論什么體制的雷達(dá)都會受到其工作環(huán)境中的噪聲和雜波的干擾，從噪聲和雜波中發(fā)現(xiàn)目標(biāo)是雷達(dá)信號處理的基本任務(wù)。在碧空如洗的天空，空中目標(biāo)檢測是最容易的，隨著氣象變化，會遇到云、雨、雪、冰雹等不同天氣
  • 關(guān)鍵字： FPGA  雜波    
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