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高云半導(dǎo)體設(shè)立北美銷(xiāo)售辦事處加速拓展美洲業(yè)務(wù)

　　美國(guó)加州圣何塞，2018年5月21日，國(guó)內(nèi)領(lǐng)先的低功耗、小封裝和性能驅(qū)動(dòng)的現(xiàn)場(chǎng)可編程邏輯器件(FPGA)供應(yīng)商廣東高云半導(dǎo)體科技股份有限公司(如下簡(jiǎn)稱(chēng)“高云半導(dǎo)體”)，近日宣布在硅谷設(shè)立北美銷(xiāo)售辦事處，以順應(yīng)北美地區(qū)在消費(fèi)電子、通信、工業(yè)、汽車(chē)電子和醫(yī)療領(lǐng)域?qū)PGA持續(xù)快速增長(zhǎng)的市場(chǎng)需求，加速高云半導(dǎo)體在美洲地區(qū)的市場(chǎng)拓展與銷(xiāo)售增長(zhǎng)。　　此外，高云半導(dǎo)體還與Fahrner-Miller Associates簽署協(xié)議，這家具有代表性的電子制造商將推進(jìn)高云半導(dǎo)體在加利福尼亞北部和內(nèi)華達(dá)北部FPGA產(chǎn)品線
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MEMS制造是產(chǎn)業(yè)持續(xù)發(fā)展的瓶頸還是潛力股？

　　MEMS產(chǎn)業(yè)增長(zhǎng)潛力巨大，而MEMS制造是產(chǎn)業(yè)持續(xù)發(fā)展的瓶頸還是將潛力兌現(xiàn)成現(xiàn)實(shí)的關(guān)鍵路徑?據(jù)麥姆斯咨詢報(bào)道，漫長(zhǎng)的開(kāi)發(fā)周期、繁多的制造平臺(tái)、研發(fā)期間的用量少帶來(lái)的高報(bào)價(jià)是阻礙新產(chǎn)品快速研發(fā)的主要絆腳石。了解MEMS制造的特殊特性，清楚眾多生態(tài)系統(tǒng)的選擇，將有助于您在面臨挑戰(zhàn)時(shí)發(fā)展路線清晰，從而更快速地開(kāi)發(fā)出具有特色的新產(chǎn)品?！　EMS器件種類(lèi)繁多，要求不一。一種器件就是一套工藝流程，這是MEMS制造面臨巨大挑戰(zhàn)的根結(jié)所在。雖然單一的方法不適合所有公司，但利用不同公司專(zhuān)業(yè)知識(shí)形成生態(tài)系統(tǒng)是解決這些挑
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英特爾 FPGA 助力 Microsoft Azure 人工智能

　　新特性：在近日舉行的 Microsoft Build 大會(huì)上，Microsoft推出了基于 Project Brainwave 的 Azure 機(jī)器學(xué)習(xí)硬件加速模型，并與 Microsoft Azure Machine Learning SDK 相集成以供預(yù)覽?？蛻艨梢允褂?Azure 大規(guī)模部署的英特爾? FPGA(現(xiàn)場(chǎng)可編程邏輯門(mén)陣列)技術(shù)，為其模型提供行業(yè)領(lǐng)先的人工智能 (AI) 推理性能。　　“作為一家整體技術(shù)提供商，我們通過(guò)與 Microsoft 密切合作為人工智能提供支持。人工智能適用于
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解讀中國(guó)芯片真實(shí)水平，與世界頂尖差多少？

我國(guó)缺乏技術(shù)積累，沒(méi)有辦法很快趕上去。關(guān)鍵是缺乏這方面的人才，很多時(shí)候，人才靠錢(qián)來(lái)挖都是挖不到的。
關(guān)鍵字：芯片 FPGA

中國(guó)萬(wàn)能芯片獲突破可用于相控陣?yán)走_(dá) 打破西方壟斷

本次中國(guó)電子和中國(guó)電科在FPGA上取得的成績(jī)，則充分說(shuō)明了，自主研發(fā)的路是完全能夠走通的。
關(guān)鍵字： FPGA 相控陣?yán)走_(dá)

在FPGA的編程語(yǔ)言里，這是你最容易犯的錯(cuò)誤

　　我知道，我對(duì)與電子有關(guān)的所有事情都很著迷，但不論從哪個(gè)角度看，今天的現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)，都顯得“鶴立雞群”，真是非常棒的器件。如果在這個(gè)智能時(shí)代，在這個(gè)領(lǐng)域，想擁有一技之長(zhǎng)的你還沒(méi)有關(guān)注FPGA，那么世界將拋棄你，時(shí)代將拋棄你。本公眾號(hào)作者ALIFPGA，多年FPGA開(kāi)發(fā)經(jīng)驗(yàn)，所有文章皆為多年學(xué)習(xí)和工作經(jīng)驗(yàn)之總結(jié)?！　∵壿媽?xiě)多了，有時(shí)候一些基本的錯(cuò)誤忘了避免了。　　昨天設(shè)計(jì)邏輯的時(shí)候就不小心觸雷了，有個(gè)信號(hào)有激勵(lì)沒(méi)響應(yīng)，后來(lái)看了時(shí)序報(bào)告，有這么一句話。　　 &nbs
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FPGA的圖像處理是怎么做到的？

　　基于軟件的圖像處理方法存在著一些局限性，尤其是計(jì)算速度和算法效率方面。所以大家很自然的就想到了FPGA作為嵌入式圖像應(yīng)用的平臺(tái)。許多圖像處理本身就是并行計(jì)算的，并且FPGA的編程硬件，本質(zhì)上也是并行的。但是利用FPGA硬件進(jìn)行圖像處理存在很多的困難，需要學(xué)到很多的技巧。下面我介紹兩幾種比較基礎(chǔ)的圖像處理算法思想。　　單幅圖像的點(diǎn)操作是圖像處理中最簡(jiǎn)單的操作，輸出值只取決于輸入值，與位置無(wú)關(guān)，可以看作是一個(gè)函數(shù)的映射。從硬件實(shí)現(xiàn)的角度來(lái)說(shuō)，最簡(jiǎn)單的方式就是通過(guò)一個(gè)實(shí)現(xiàn)函數(shù)的模塊對(duì)輸入的每個(gè)像素進(jìn)行依次處
關(guān)鍵字： FPGA 圖像處理

工程師設(shè)計(jì)經(jīng)驗(yàn)分享：畫(huà)FPGA開(kāi)發(fā)板所犯的那些錯(cuò)誤

　　畫(huà)FPGA開(kāi)發(fā)板所犯的那些錯(cuò)誤，小編這里先截下我最初畫(huà)這個(gè)開(kāi)發(fā)板的一張“慘不忍睹”的PCB讓大家看看?！　op Layer如圖：　　　　Bottom Layer如圖：　　　　第一遍畫(huà)的時(shí)候，想“速戰(zhàn)速?zèng)Q”把它畫(huà)完，草草了事，但是等全部布線完以后卻發(fā)現(xiàn)這里面的錯(cuò)誤實(shí)在是太多了，我覺(jué)得最核心的錯(cuò)誤就是一開(kāi)始就沒(méi)有注意整個(gè)系統(tǒng)各個(gè)元器件的布局，從而導(dǎo)致了“災(zāi)難”的發(fā)生，后來(lái)的布線也就非常困難。大家很容易可以
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CAST和Achronix使用無(wú)損壓縮IP支持從數(shù)據(jù)中心到邊緣的數(shù)據(jù)處理

　　基于現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)的硬件加速器器件及嵌入式FPGA(eFPGA)領(lǐng)域內(nèi)領(lǐng)導(dǎo)性企業(yè)Achronix半導(dǎo)體公司(Achronix Semiconductor Corporation)日前宣布：與專(zhuān)注于為電子系統(tǒng)設(shè)計(jì)人員提供半導(dǎo)體IP的半導(dǎo)體知識(shí)產(chǎn)權(quán)公司CAST Incorporated達(dá)成合作;CAST的高性能無(wú)損壓縮IP已經(jīng)被植入，以支持Achronix 的FPGA產(chǎn)品組合，用來(lái)完成數(shù)據(jù)中心和移動(dòng)邊緣間數(shù)據(jù)傳輸?shù)母咝幚??！　AST為Deflate
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FPGA學(xué)習(xí)：PLL分頻計(jì)數(shù)的LED閃爍實(shí)例

　　如圖8.17所示，本實(shí)例將用到FPGA內(nèi)部的PLL資源，輸入FPGA引腳上的25MHz時(shí)鐘，配置PLL使其輸出4路分別為12.5MHz、25MHz、50MHz和100MHz的時(shí)鐘信號(hào)，這4路時(shí)鐘信號(hào)又分別驅(qū)動(dòng)4個(gè)不同位寬的計(jì)數(shù)器不停的計(jì)數(shù)工作，這些計(jì)數(shù)器的最高位最終輸出用于控制4個(gè)不同的LED亮滅。由于這4個(gè)時(shí)鐘頻率都有一定的倍數(shù)關(guān)系，所以我們也很容易通過(guò)調(diào)整合理的計(jì)數(shù)器位寬，達(dá)到4個(gè)LED閃爍一致的控制。　　　　cy4.v模塊代碼解析　　先來(lái)看cy4.v模塊的
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聯(lián)發(fā)科掘金ASIC市場(chǎng)，領(lǐng)先業(yè)界去打造下一個(gè)增長(zhǎng)新引擎

　　憑借過(guò)去20年在SoC上的經(jīng)驗(yàn)，聯(lián)發(fā)科技累積了豐富的IP和先進(jìn)的工藝制程，這為聯(lián)發(fā)科在ASIC芯片市場(chǎng)打下很好的基礎(chǔ)，使得聯(lián)發(fā)科可以快速為大型客戶量身打造專(zhuān)用定制化芯片(ASIC)，去年聯(lián)發(fā)科ASIC團(tuán)隊(duì)已順利搶下思科訂單，開(kāi)始與博通等國(guó)際廠商展開(kāi)競(jìng)爭(zhēng)。　　4月24日，聯(lián)發(fā)科在其深圳分公司舉行媒體溝通會(huì)，向記者展示了業(yè)界首個(gè)7nm 56G PAM4 SerDes IP ASIC。聯(lián)發(fā)科技副總經(jīng)理暨智能設(shè)備事業(yè)群總經(jīng)理游人杰表示，ASIC將會(huì)是高速成長(zhǎng)的市場(chǎng)，未來(lái)幾年，希望ASIC芯片能扮演聯(lián)發(fā)科業(yè)
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“FPGA加速”正進(jìn)入數(shù)據(jù)中心的主流應(yīng)用

　　“英特爾現(xiàn)在的定位是以數(shù)據(jù)為中心的企業(yè)，而過(guò)去是PC平臺(tái)。”英特爾可編程解決方案事業(yè)部亞太區(qū)市場(chǎng)拓展經(jīng)理劉斌先生稱(chēng)。他是在近日舉行的“英特爾可編程解決方案新聞發(fā)布會(huì)”上說(shuō)此番話的。　　此次發(fā)布會(huì)主要介紹了三個(gè)內(nèi)容：　　*采用英特爾PAC(可編程加速卡)的戴爾服務(wù)器現(xiàn)已大量上市;此外，富士通也在支持重點(diǎn)客戶使用。　　*通過(guò)免費(fèi)的PAC加速堆棧，可在常見(jiàn)軟件開(kāi)發(fā)環(huán)境中提供通用硬件加速性能。　　*兩個(gè)應(yīng)用案例：面向財(cái)務(wù)風(fēng)險(xiǎn)分析和數(shù)據(jù)庫(kù)加速的
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加速云基于FPGA的加速解決方案搞定高算力AI應(yīng)用場(chǎng)景

人工智能（AI）和大數(shù)據(jù)的不斷發(fā)展帶來(lái)對(duì)超高計(jì)算力的需求，使得相應(yīng)硬件組成和算法架構(gòu)也在不斷創(chuàng)新中尋求突破，以達(dá)到新應(yīng)用所需的計(jì)算能力。
關(guān)鍵字： FPGA，加速，AI，大數(shù)據(jù)

Arm/FPGA聯(lián)手發(fā)威　研華生產(chǎn)線大步邁入AI時(shí)代

　　人工智能(Artificial Intelligence, AI)無(wú)疑是近一兩年來(lái)科技產(chǎn)業(yè)內(nèi)最熱門(mén)的話題，除了科技業(yè)巨頭無(wú)不大力投入之外，金融等服務(wù)業(yè)者對(duì)導(dǎo)入人工智能，也展現(xiàn)出強(qiáng)烈興趣。制造業(yè)對(duì)AI技術(shù)的關(guān)注，也不在話下，并且在相關(guān)關(guān)鍵技術(shù)逐漸到位的情況下，已開(kāi)始有實(shí)際導(dǎo)入動(dòng)作。　　倡導(dǎo)智能制造不遺余力的研華科技，除了為各行各業(yè)提供對(duì)應(yīng)的先進(jìn)解決方案外，在自家生產(chǎn)在線也開(kāi)始逐步導(dǎo)入人工智能要素。比如機(jī)臺(tái)設(shè)備的狀態(tài)偵測(cè)/診斷、原物料/能源的使用狀況，乃至產(chǎn)品的品管流程等，均已逐步導(dǎo)入
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工程師20年經(jīng)驗(yàn)總結(jié)：ASIC芯片的成本計(jì)算

　　大規(guī)模集成電路芯片, 比如SoC(System on chip)，由多核CPU和GPU組成，用于智能手機(jī)主芯片、車(chē)載多媒體和導(dǎo)航系統(tǒng)，或者特定用途的集成電路芯片ASIC(Application specified integrated circuit)，用于電子控制模塊的信號(hào)處理，算法運(yùn)行和控制執(zhí)行部件，比如自動(dòng)泊車(chē)、啟動(dòng)安全氣囊、自動(dòng)駕駛的雷達(dá)信號(hào)分析等。這些芯片是未來(lái)數(shù)字化、智能化的核心元件。但是，它們的成本是怎樣構(gòu)成? 客戶所能知道的就是半導(dǎo)體公司或芯片貿(mào)易商(Distributor)的報(bào)價(jià)。
關(guān)鍵字： ASIC 芯片