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FPGA/EPLD的自上而下設計方法

  • FPGA/EPLD的自上而下設計方法,FPGA/EPLD的自上而下(Top-Down)設計方法:  傳統(tǒng)的設計手段是采用原理圖輸入的方式進行的,如圖1所示。通過調(diào)用FPGA/EPLD廠商所提供的相應物理元件庫,在電路原理圖中繪制所設計的系統(tǒng),然后通過網(wǎng)表轉換產(chǎn)生某一特
  • 關鍵字: FPGA  EPLD  自上而下  設計方法  

FPGA/EPLD的自上而下(Top-Down)設計方法解析

  • FPGA/EPLD的自上而下(Top-Down)設計方法:傳統(tǒng)的設計手段是采用原理圖輸入的方式進行的,通過調(diào)用FPGA/EPLD廠商所提供的相應物理元件庫,在電路原理圖
  • 關鍵字: FPGA  EPLD  自上而下  

FPGA/EPLD的自上而下設計方法及其優(yōu)缺點介紹

  • FPGA/EPLD的自上而下設計方法及其優(yōu)缺點介紹,FPGA/EPLD的自上而下(Top-Down)設計方法:  傳統(tǒng)的設計手段是采用原理圖輸入的方式進行的,如圖1所示。通過調(diào)用FPGA/EPLD廠商所提供的相應物理元件庫,在電路原理圖中繪制所設計的系統(tǒng),然后通過網(wǎng)表轉換產(chǎn)生某一特
  • 關鍵字: 缺點  介紹  及其  方法  自上而下  設計  FPGA/EPLD  

基于EPLD技術的抗干擾濾波器

  • 在同步串行數(shù)據(jù)傳輸過程中,時鐘線上只要有一點小毛刺就會導致數(shù)據(jù)傳輸失誤,從而影響系統(tǒng)的正常工作。傳統(tǒng)...
  • 關鍵字: 濾波器  EPLD  干擾信號  

FPGA/EPLD的自上而下設計方法

  • FPGA/EPLD的自上而下設計方法,FPGA/EPLD的自上而下(Top-Down)設計方法:  傳統(tǒng)的設計手段是采用原理圖輸入的方式進行的,如圖1所示。通過調(diào)用FPGA/EPLD廠商所提供的相應物理元件庫,在電路原理圖中繪制所設計的系統(tǒng),然后通過網(wǎng)表轉換產(chǎn)生某一特
  • 關鍵字: 方法  設計  自上而下  FPGA/EPLD  

一種基于EPLD技術的抗干擾濾波器的實現(xiàn)

  •  1問題的提出
      在同步串行數(shù)據(jù)傳輸過程中,時鐘線上只要有一點小毛刺就會導致數(shù)據(jù)傳輸失誤,從而影響系統(tǒng)的正常工作。傳統(tǒng)的處理方法是在接收端并入一小電容來濾除毛刺,這種方法只能去除某一固定頻率下的干擾,
  • 關鍵字: EPLD  抗干擾濾波器    

數(shù)話同傳控制器的設計與實現(xiàn)

  • 話音和數(shù)據(jù)同傳有多種方案,這些方案大都先將話音信號數(shù)字化,經(jīng)過壓縮后與外部數(shù)據(jù)一起打包傳輸。主要區(qū)別在于發(fā)送一包話音數(shù)據(jù)與外部數(shù)據(jù)的占用時間,以及話音數(shù)據(jù)與外部數(shù)據(jù)在包內(nèi)的分割時長。常見的有兩種方案[1
  • 關鍵字: 實現(xiàn)  設計  控制器  同傳  數(shù)話同傳  EPLD  AMBE話音  Codec  GMSK  Modem  

基于EPLD的PCI總線仲裁器的設計與實現(xiàn)

  • 隨著VLSI/ULSI技術的發(fā)展,可編程邏輯器件EPLD/FPGA越來越受到人們的青睞,由于它具有集成度高、速度快、開發(fā)周期短、費用低、用戶可定義功能及可重復編程和擦寫等許多優(yōu)點,其應用領域不斷擴大。這些器件的靈活性和
  • 關鍵字: EPLD  PCI  總線  仲裁器    

基于EPLD技術的PCI總線接口設計

  • PCI總線自其問世以來,以其諸多優(yōu)點,在當今的計算機系統(tǒng)中得到了廣泛應用,已經(jīng)成為計算機設備的標準接口。本文在認真分析PCI總線的接口信號和接口時序的基礎上,利用EPLD器件設計實現(xiàn)了PCI總線接口。由于EPLD器件支
  • 關鍵字: EPLD  PCI  總線  接口設計    

基于PCI總線的GP-IB接口電路設計

  • 主要介紹作為從設備如何根據(jù)PCI總線協(xié)議設計PCI總線接口電路,從而實現(xiàn)基于PCI總線的GP-IB接口電路設計,重點闡述PCI總線接口狀態(tài)機的設計。
  • 關鍵字: PCI  狀態(tài)機  GP-IB  EPLD  200806  

用EPLD實現(xiàn)單脈沖二次雷達的應答解碼處理

  •   摘 要:用EPLD實現(xiàn)的單脈沖二次雷達應答處理器。其主要功能包括:應答框架脈沖檢測,應答信息解碼,將應答信息裝配成飛機的同步應答組形成目標報告,丟棄非同步虛假應答。   關鍵詞:單脈沖二次雷達? 應答模式? EPLD   1 一次雷達與二次雷達   二次雷達與一次雷達基本上是并行發(fā)展的。與一次雷達相比,二次雷達有回波強、無目標閃爍效應、詢問波長與應答波長不等的特點,從而消除了地物雜波和氣象雜波的干擾。單脈沖技術應用于二次雷達,可以方便地基于多個波束對目標測量,進而有效地增加數(shù)
  • 關鍵字: EPLD  單脈沖二次雷達  應答模式  
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epld介紹

EPLD  EPLD: Erasable Programmable Logic Device(可擦除可編輯邏輯器件)可擦除可編程邏輯器件(EPLD)是一種集成電路,包括一系列的編程邏輯器件,其無需進行再次連接。   1、PLD器件的設計步驟   1.電路邏輯功能描述   PLD器件的邏輯功能描述一般分為原理圖描述和硬件描述語言描述,原理圖描述是一種直觀簡便的方法,它可以將現(xiàn)有的小規(guī)模集成 [ 查看詳細 ]

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