基于DSP+FPGA的磁鐵電源控制器的設計
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2．4 驅動電路的設計
圖4的驅動電路中高速光耦HCPL-4503快速實現(xiàn)信號的轉換和隔離，而故障信號經(jīng)低速光耦TLP521-1隔離后送至PDPINTx引腳，PWM輸出引腳變?yōu)楦咦钁B(tài)，同時產(chǎn)生一個中斷，封鎖驅動信號，關閉功率開關管。本文引用地址：http://www.2s4d.com/article/148555.htm
3 控制器軟件設計
當發(fā)生中斷時，DSP的CPU會根據(jù)中斷響應的優(yōu)先級和中斷向量表判斷，跳至相應的子程序執(zhí)行，實現(xiàn)各自的功能。圖5為主程序的流程圖。
為防止上下兩橋臂開關器件同時導通，驅動波形需要具有一定的死區(qū)時間。設置DSP死區(qū)控制寄存器DBTCONx[8-11]位死區(qū)定時器周期為m，DBTCON位的死區(qū)定時器預定標因子為x／p，若通用定時器時鐘周期為t，則死區(qū)時間ts=m*p*t。死區(qū)部分控制流程如圖6所示。
圖7為DSP和FPGA之間的通信流程。波特率的配置通過對DSP的SPIBRR寄存器的編程實現(xiàn)，在SPI接口設計時應注意使用系統(tǒng)時鐘對SCLK信號進行同步以減少SCLK引起的通信錯誤。
4 結束語
采用DSP+FPGA架構的磁鐵電源控制器兼有兩種信號處理芯片的優(yōu)越性，有效的提高了運算速度和精度。在后續(xù)的研究中根據(jù)需要設置相應參數(shù)，選擇合適的控制算法，以滿足磁鐵電源輸出極低紋波和受精確控制的電流。
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