virtex-ii 文章最新資訊

FPGA電路動(dòng)態(tài)老化技術(shù)研究

1引言FPGA是現(xiàn)場(chǎng)可編程門(mén)陣列（FieldProgrammingGateArray）的縮寫(xiě)，用戶(hù)可以編寫(xiě)程序?qū)PGA內(nèi)部的邏輯...
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Cortex-M3的μC／OS-II任務(wù)調(diào)度硬件指令實(shí)現(xiàn)

Cortex-M3的μC／OS-II任務(wù)調(diào)度硬件指令實(shí)現(xiàn),1 mu;C／OS-II的任務(wù)調(diào)度算法分析
1．1 mu;C／OS-II任務(wù)就緒表的解讀
mu;C／OS操作系統(tǒng)采用優(yōu)先級(jí)至上的任務(wù)調(diào)度原則，讓進(jìn)入就緒態(tài)任務(wù)中優(yōu)先級(jí)最高的那個(gè)任務(wù)，一進(jìn)入就緒態(tài)就能立即運(yùn)行。mu;C／OS操作系
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一種提高μC／OS-II操作系統(tǒng)安全性與穩(wěn)定性的方法

摘要：通過(guò)分析mu;C／OS-II操作系統(tǒng)的安全性與穩(wěn)定性，利用Cortex-M3內(nèi)核上配置的MPU(Memory Protection Unit，存儲(chǔ)器保護(hù)單元)，把內(nèi)存劃分為特權(quán)級(jí)與用戶(hù)級(jí)兩個(gè)區(qū)。對(duì)移植到內(nèi)核上的mu;C／OS-II實(shí)時(shí)操作系統(tǒng)進(jìn)行
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基于NIOS II的多串口數(shù)據(jù)通信的實(shí)現(xiàn)

串口傳輸常用于基于FPGA和DSP結(jié)構(gòu)的信號(hào)處理板和外部設(shè)備之間的數(shù)據(jù)交換。以GPS RTK定位應(yīng)用為基礎(chǔ)，針對(duì)單個(gè)串口全雙工傳輸不足以應(yīng)對(duì)多種數(shù)據(jù)類(lèi)型同時(shí)輸入輸出的情形，設(shè)計(jì)并實(shí)現(xiàn)了一種面向多串口不同類(lèi)型數(shù)據(jù)的傳輸方案。該方案通過(guò)增加串口控制寄存器實(shí)現(xiàn)單個(gè)中斷信號(hào)即可控制所有串口，采用乒乓交替讀寫(xiě)實(shí)現(xiàn)數(shù)據(jù)持續(xù)高速輸入。測(cè)試表明該方案可獨(dú)立對(duì)各串口進(jìn)行配置，可同時(shí)實(shí)現(xiàn)GPS定位結(jié)果、差分GPS修正數(shù)據(jù)與外界的交換以及用戶(hù)控制命令的輸入，并且可減少硬件調(diào)試時(shí)間，節(jié)約硬件資源。
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嵌入式實(shí)時(shí)操作系統(tǒng)μC／OS-II串口通信的設(shè)計(jì)與實(shí)現(xiàn)

摘要：為解決實(shí)時(shí)操作系統(tǒng)mu;C／OS-II串口通信設(shè)計(jì)中信號(hào)量、消息郵箱使用方法的問(wèn)題，提出了一種以STM32V評(píng)估板為硬件平臺(tái)和mu;C／OS-Ⅱ的串口通信程序設(shè)計(jì)方案。該方案采用Cortex-M3架構(gòu)的ARM處理器STM32F103VB作
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基于UC/OS-II的嵌入式構(gòu)件系統(tǒng)設(shè)計(jì)

基于UC/OS-II的嵌入式構(gòu)件系統(tǒng)設(shè)計(jì),近些年來(lái)，隨著嵌入式產(chǎn)品需求的不斷增加，嵌入式軟件正變得越來(lái)越復(fù)雜，而產(chǎn)品的開(kāi)發(fā)周期也越來(lái)越短。嵌入式軟件開(kāi)發(fā)迫切需要更高效的軟件重用手段。

隨著軟件復(fù)用研究成為熱點(diǎn)，其核心技術(shù)——構(gòu)件化
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基于FPGA的嵌入式脈象采集儀硬件電路設(shè)計(jì)

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嵌入式實(shí)時(shí)操作系統(tǒng)uCOS II的分析

關(guān)鍵字： uCOS II 內(nèi)核移植

基于Virtex-5的音視頻監(jiān)視系統(tǒng)設(shè)計(jì)

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使用Virtex-5 FPGA實(shí)現(xiàn)LTE仿真器

LTE系統(tǒng)的無(wú)線接入部分Node-B，是連接無(wú)線電和整個(gè)互聯(lián)網(wǎng)協(xié)議核心網(wǎng)絡(luò)之間的邊緣設(shè)備。這種架構(gòu)無(wú)法監(jiān)測(cè)和測(cè)試等效于UMTS中間鏈路上的元件。必須通過(guò)無(wú)線電接口，才能有效地測(cè)試LTE網(wǎng)絡(luò)元件。
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基于μC／OS-II的遠(yuǎn)程環(huán)境監(jiān)測(cè)系統(tǒng)

基于μC／OS-II的遠(yuǎn)程環(huán)境監(jiān)測(cè)系統(tǒng),為了實(shí)現(xiàn)同一套環(huán)境監(jiān)測(cè)系統(tǒng)能應(yīng)用于不同的污染源，使環(huán)境監(jiān)測(cè)更方便、快捷，提出一種遠(yuǎn)程環(huán)境監(jiān)測(cè)系統(tǒng)設(shè)計(jì)方案，該方案采用嵌入式系統(tǒng)和無(wú)線遠(yuǎn)程通信技術(shù)相結(jié)合的設(shè)計(jì)思想。與傳統(tǒng)環(huán)境監(jiān)測(cè)系統(tǒng)相比，該系統(tǒng)設(shè)計(jì)是以ARM7系列單片機(jī)LPC2214為核心，采用模塊化設(shè)計(jì)，可接入多種傳感器，通過(guò)μC／OS-Ⅱ調(diào)度和管理任務(wù)，實(shí)現(xiàn)環(huán)境參數(shù)數(shù)據(jù)的采集與處理，并經(jīng)過(guò)DTU無(wú)線模塊把數(shù)據(jù)發(fā)送至上位機(jī)，由上位機(jī)接收、存儲(chǔ)并顯示各個(gè)參數(shù)指標(biāo)，從而實(shí)現(xiàn)了使用同一套環(huán)境監(jiān)測(cè)系統(tǒng)，可同時(shí)實(shí)時(shí)監(jiān)測(cè)與遠(yuǎn)程
關(guān)鍵字：系統(tǒng) 環(huán)境監(jiān)測(cè) 遠(yuǎn)程 OS-II 基于

基于Nios II的語(yǔ)音加密傳輸系統(tǒng)設(shè)計(jì)

　摘要：設(shè)計(jì)并實(shí)現(xiàn)了一個(gè)基于Nios II的語(yǔ)音加密傳輸系統(tǒng)。介紹了進(jìn)行語(yǔ)音信號(hào)處理的功能模塊，包括語(yǔ)音采集回放模塊、基于G.729A的語(yǔ)音壓縮與解壓縮模塊和基于AES的數(shù)據(jù)加解密模塊。在控制模塊的協(xié)調(diào)下，使得語(yǔ)音
關(guān)鍵字：傳輸系統(tǒng) 設(shè)計(jì) 加密語(yǔ)音 Nios II 基于

基于Virtex-5 FPGA的音視頻監(jiān)視系統(tǒng)設(shè)計(jì)

基于Virtex-5 FPGA的音視頻監(jiān)視系統(tǒng)設(shè)計(jì),引言
本文探討在Virtex-5 FPGA中實(shí)現(xiàn)設(shè)計(jì)的一些難題，然后用一個(gè)項(xiàng)目作為示范來(lái)詳解充分利用其功能集的技法。設(shè)計(jì)過(guò)程包括幾個(gè)步驟，從針對(duì)應(yīng)用選擇適合的Virtex-5開(kāi)始。為便于本文敘述，我們假定IP模塊已經(jīng)過(guò)匯編
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μC／OS-II在TMS320VC5402處理器上的移植

μC／OS-II在TMS320VC5402處理器上的移植,在介紹了實(shí)時(shí)操作系統(tǒng)μC／OS-II的特點(diǎn)和內(nèi)核結(jié)構(gòu)的基礎(chǔ)上，給出了μC／OS-II實(shí)時(shí)操作系統(tǒng)在DSP芯片TMS320VC5402上移植的實(shí)現(xiàn)過(guò)程，并且通過(guò)了實(shí)際測(cè)試驗(yàn)證。
關(guān)鍵字：移植處理器 TMS320VC5402 OS-II

賽靈思 Virtex-6 HXT FPGA為光通信提供卓越的收發(fā)器性能

　　全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. )宣布推出支持 40Gbps 和 100Gbps 線路卡的Virtex®-6 HXT FPGA，并可靈活配置各種網(wǎng)絡(luò)速率包括40Gbps、4x10Gbps、100Gbps 和 10x10Gbps 等。此外，憑借其市場(chǎng)領(lǐng)先的收發(fā)器時(shí)鐘抖動(dòng)性能，Virtex-6 HXT FPGA還能滿(mǎn)足新一代通信設(shè)備長(zhǎng)距離光纖網(wǎng)絡(luò)傳輸?shù)男枰?，且無(wú)需昂貴的外部重定時(shí)器電路。　　賽靈思已經(jīng)和Avago Technologies(安華高科技)
關(guān)鍵字： Xilinx FPGA Virtex-6