vhdl-ams 文章進入vhdl-ams技術(shù)社區(qū)

Xilinx進駐北京新址并宣布成立中國研發(fā)中心

　　全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司?(Xilinx,?Inc.)日前在進駐北京新址的慶典上,強調(diào)其對高增長的中國市場的承諾。該公司不斷擴大其在亞太地區(qū)的影響力，包括開設(shè)研發(fā)中心，并將本地銷售、市場營銷和應(yīng)用工程設(shè)計等業(yè)務(wù)整合到統(tǒng)一的辦公地點。新址面積達?2,000?平米，將為北京本地、整個亞太區(qū)乃至跨國客戶提供強有力的支持。　　從左至右，?北京化工大學(xué)教授何賓，?賽靈思軟件研發(fā)總監(jiān)宋傳華博士，?全球研發(fā)高級總監(jiān)Devadas，&nbs
關(guān)鍵字： Xilinx 可編程平臺 FPGA，(AMS

基于FPGA的數(shù)字濾波器設(shè)計

　　利用VHDL語言設(shè)計數(shù)字濾波器，主要在于如何實現(xiàn)乘法。乘法常用的實現(xiàn)方法有位串行乘法、分布式算法和并行乘法等。位串行乘法能節(jié)省大量硬件資源，但運算周期過長，對于數(shù)字濾波器這種高速率要求不宜采取。分布式算法是現(xiàn)在比較流行的一種乘法實現(xiàn)方式，所用硬件資源較少，運算速率也較快，但這只是針對小位寬乘法來說。對于數(shù)字濾波器的較大位寬的乘法，不宜采取。并行乘法，算法實現(xiàn)簡單直觀，對于現(xiàn)在資源豐富的FPGA，很好實現(xiàn)
關(guān)鍵字：濾波器數(shù)字 FPGA VHDL

Mentor收購BDA 推動納米級模擬/混合信號驗證

EDA巨頭們一直在收購各類EDA廠商，不斷擴張版圖，正如現(xiàn)在中國互聯(lián)網(wǎng)三巨頭BAT一樣。
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基于FPGA的多功能電子密碼鎖設(shè)計

0 引言傳統(tǒng)機械鎖的防盜功能差，在現(xiàn)代高科技安防系統(tǒng)中無法起到作用，已逐步被更可靠、更智能的電子數(shù)字密碼鎖代替。目前市場上的大部分密碼鎖產(chǎn)品是以單片機為核心的，利用軟件進行控制，實際應(yīng)用中系統(tǒng)穩(wěn)定性較差且成本高。本文研究的是電子密碼鎖的一種純硬件實現(xiàn)方案，為彌補傳統(tǒng)技術(shù)的不足，采用EDA技術(shù)在可編程芯片上實現(xiàn)密碼的存儲、運算等操作，使產(chǎn)品既具有硬件的安全性和高速性，又具有軟件開發(fā)的靈活性和易維護性。 1 主要技術(shù)與開發(fā)環(huán)境 1.1 EDA技術(shù)及特點 EDA(Electronic Design A
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基于FPGA的ARM并行總線設(shè)計與仿真分析

在數(shù)字系統(tǒng)的設(shè)計中，F(xiàn)PGA+ARM的系統(tǒng)架構(gòu)得到了越來越廣泛的應(yīng)用，F(xiàn)PGA主要實現(xiàn)高速數(shù)據(jù)的處理;ARM主要實現(xiàn)系統(tǒng)的流程控制。人機交互。外部通信以及FPGA控制等功能。I2C、SPI等串行總線接口只能實現(xiàn)FPGA和ARM之間的低速通信; 當(dāng)傳輸?shù)臄?shù)據(jù)量較大。要求高速傳輸時，就需要用并行總線來進行兩者之間的高速數(shù)據(jù)傳輸。
關(guān)鍵字： FPGA ARM DATA VHDL 數(shù)據(jù)總線

基于FPGA的SPI Flash控制器的設(shè)計方案

本文提出一個基于FPGA的SPI Flash讀寫硬件實現(xiàn)方案，該方案利用硬件對SPI Flash進行控制，能夠非常方便地完成Flash的讀寫、擦除、刷新及預(yù)充電等操作，同時編寫的SPI Flash控制器IP核能夠進行移植和復(fù)用，作為SOC芯片的功能模塊。
關(guān)鍵字： FPGA Flash SOC CPU VHDL

基于FPGA的FIR數(shù)字濾波器設(shè)計方案

在Matlab/Simulink環(huán)境下，采用DSP Builder模塊搭建FIR模型，根據(jù)FDATool工具對FIR濾波器進行了設(shè)計，然后進行系統(tǒng)級仿真和ModelSim功能仿真，其仿真結(jié)果表明其數(shù)字濾波器的濾波效果良好。
關(guān)鍵字： DSP FPGA VHDL 濾波器 FIR

基于FPGA的幀同步系統(tǒng)設(shè)計方案

在Xilinx的FPGA器件XC3S200-4FT200上對方案中設(shè)計的幀同步系統(tǒng)進行了實現(xiàn)，利用Modelsim 6.0軟件進行了仿真測試。仿真結(jié)果表明，本方案設(shè)計的同步系統(tǒng)工作穩(wěn)定，滿足性能要求。
關(guān)鍵字： Xilinx FPGA 幀同步 VHDL 寄存器

基于FPGA的采集卡的圖像增強算法應(yīng)用研究

圖像在采集過程中不可避免地會受到傳感器靈敏度、噪聲干擾以及模數(shù)轉(zhuǎn)化時量化問題等因素影響而導(dǎo)致圖像無法達到人眼的視覺效果，為了實現(xiàn)人眼觀察或者機器自動分析的目的，對原始圖像所做的改善行為，就被稱作圖像增強技術(shù)。
關(guān)鍵字：傳感器圖像增強 FPGA PCI VHDL

基于VHDL的QPSK調(diào)制解調(diào)系統(tǒng)設(shè)計與仿真

文中詳細(xì)介紹了QPSK技術(shù)的工作原理和QPSK調(diào)制、解調(diào)的系統(tǒng)設(shè)計方案，并通過VHDL語言編寫調(diào)制解調(diào)程序和QuaitusII軟件建模對程序進行仿真，通過引腳鎖定，下載程序到FPGA芯片EP1K30TC144-3中驗證。軟件仿真和硬件驗證結(jié)果表明了該設(shè)計的正確性和可行性，由于采用FPGA芯片，減小了硬件設(shè)計的復(fù)雜性，該設(shè)計具有便于移植維護和升級的特點。
關(guān)鍵字： VHDL QPSK 調(diào)制解調(diào)系統(tǒng) 設(shè)計與仿真

VHDL設(shè)計進階:邏輯綜合的原則以及可綜合的代碼設(shè)計

4.5.1 always塊語言指導(dǎo)原則使用always塊進行可綜合的代碼設(shè)計時需要注意以下幾個問題。(1)每個always塊只能有一個事件控制“@(event-expression)”，而且要緊跟在always關(guān)鍵字后面。(2)always塊可以表示
關(guān)鍵字： VHDL 進階代碼設(shè)計邏輯

FPGA設(shè)計經(jīng)驗談

從大學(xué)時代第一次接觸FPGA至今已有10多年的時間。至今記得當(dāng)初第一次在EDA實驗平臺上完成數(shù)字秒表，搶答器，密碼鎖等實驗時，那個興奮勁。當(dāng)時由于沒有接觸到HDL硬件描述語言，設(shè)計都是在MAX+plus II原理圖環(huán)境下用74系列邏輯器件搭建起來的。
關(guān)鍵字： FPGA EDA VHDL Verilog 時鐘 IP核

基于FPGA的IRIG-B標(biāo)準(zhǔn)DC code編碼器VHDL設(shè)計

為了實現(xiàn)靶場時統(tǒng)終端輸出IRIG-B標(biāo)準(zhǔn)DC code信號，采用VHDL語言在FPGA邏輯電路中設(shè)計了DC code編碼器硬件電路，通過QuartusⅡ軟件建立工程文件對VHDL語言DC code編碼器電路進行編譯和仿真，獲得了符合IRIG-B標(biāo)準(zhǔn)的DC code信號。經(jīng)過實踐驗證，該電路具有實現(xiàn)方法簡單、電路穩(wěn)定性好、精度高的特點，實測同步精度小于1μs。
關(guān)鍵字： IRIG-B FPGA code VHDL

基于FPGA的UART 16倍頻采樣的VHDL設(shè)計

概述隨著電子設(shè)計自動化(EDA)技術(shù)的發(fā)展，可編程邏輯器件FPGA/CPLD已經(jīng)在許多方面得到了廣泛應(yīng)用，而UART(通用異步收發(fā)器) 是在數(shù)字通信和控制系統(tǒng)中廣泛使用的串行數(shù)據(jù)傳輸協(xié)議。因此越來越多用戶根據(jù)自己的需要，以
關(guān)鍵字： FPGA UART VHDL 倍頻

基于VHDL的數(shù)字濕度計研究

濕度計是一種常用的檢測儀器，文中利用FPGA器件與HS1101濕度傳感器設(shè)計實現(xiàn)了一種簡易的數(shù)字濕度計，用于檢測室內(nèi)濕度。該濕度計具有結(jié)構(gòu)簡單、測量準(zhǔn)確性高、穩(wěn)定性好等優(yōu)點。
關(guān)鍵字：濕度濕度傳感器 VHDL FPGA

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vhdl-ams介紹

　　即IEEE 1076.1標(biāo)準(zhǔn)。　　VHDL-AMS是VHDL的一個分支，它支持模擬、數(shù)字、數(shù)?；旌想娐废到y(tǒng)的建模與仿真。　　http://www.eda.org/vhdl-ams/ 　　Verilog-AMS與之類似。支持模擬、數(shù)字、數(shù)模混合電路系統(tǒng)的建模與仿真。　　http://www.eda.org/verilog-ams/ 　　The VHDL-AMS language [ 查看詳細(xì) ]