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rf-fpga 文章 最新資訊

基于FPGA的快速傅立葉變換

  • 在對FFT（快速傅立葉變換）算法進(jìn)行研究的基礎(chǔ)上，描述了用FPGA實(shí)現(xiàn)FFT的方法，并對其中的整體結(jié)構(gòu)、蝶形單元及性能等進(jìn)行了分析。
  • 關(guān)鍵字： FPGA  傅立葉變換    

異步FIFO結(jié)構(gòu)及FPGA設(shè)計

  • 首先介紹異步FIFO的概念、應(yīng)用及其結(jié)構(gòu)，然后分析實(shí)現(xiàn)異步FIFO的難點(diǎn)問題及其解決辦法；在傳統(tǒng)設(shè)計的基礎(chǔ)上提出一種新穎的電路結(jié)構(gòu)并對其進(jìn)行綜合仿真和FPGA實(shí)現(xiàn)。
  • 關(guān)鍵字： FIFO  FPGA    

3-DES算法的FPGA高速實(shí)現(xiàn)

  • 介紹3-DES算法的概要；以Xilinx公司SPARTANII結(jié)構(gòu)的XC2S100為例，闡述用FPGA高速實(shí)現(xiàn)3-DES算法的設(shè)計要點(diǎn)及關(guān)鍵部分的設(shè)計。
  • 關(guān)鍵字： FPGA  DES  算法  高速實(shí)現(xiàn)    

基于CPLD/FPGA的半整數(shù)分頻器的設(shè)計

  • 簡要介紹了CPLD/FPGA器件的特點(diǎn)和應(yīng)用范圍，并以分頻比為2.5的半整數(shù)分頻器的設(shè)計為例，介紹了在MAX+plus II開發(fā)軟件下，利用VHDL硬件描述語言以及原理圖的輸入方式來設(shè)計數(shù)字邏輯電路的過程和方法。
  • 關(guān)鍵字： CPLD  FPGA  整數(shù)  分頻器    

基于FPGA的總線型LVDS通信系統(tǒng)設(shè)計

  • 本文介紹一種基于總線型LVDS的通信系統(tǒng)方案，以及利用FPGA芯片實(shí)現(xiàn)系統(tǒng)核心模塊的設(shè)計方法。
  • 關(guān)鍵字： FPGA  LVDS  總線  通信    

基于FPGA的多路模擬量、數(shù)字量采集與處理系統(tǒng)

  • 提出一種基于FPGA技術(shù)的多路模擬量、數(shù)字量采集與處理系統(tǒng)的設(shè)計方案，分析整個系統(tǒng)的結(jié)構(gòu)，并討論FPGA內(nèi)部硬件資源的劃分和軟件的設(shè)計方案等。
  • 關(guān)鍵字： FPGA  多路  模擬量  數(shù)字量采集    

固定幾何結(jié)構(gòu)的FFT算法及其FPGA實(shí)現(xiàn)

  • 固定幾何結(jié)構(gòu)的FFT算法及其FPGA實(shí)現(xiàn)。
  • 關(guān)鍵字： FPGA  FFT  幾何  算法    

基于FPGA的高速高精度頻率測量的研究

  • 本文介紹的測頻方法，不僅消除了直接測頻方法中對測量頻率需要采用分段測試的局際，而且在整個測試頻段內(nèi)能夠保持高精度不變。
  • 關(guān)鍵字： FPGA  高精度  頻率  量的研究    

PSD813F2在FPGA配置中的應(yīng)用

  • 可編程外圍器件PSD應(yīng)用于單片機(jī)系統(tǒng)后，簡化了單片機(jī)外圍電路的設(shè)計，增加了系統(tǒng)的可靠性；利用PSD與單片機(jī)組成的系統(tǒng)，通過計算機(jī)串口對FPGA進(jìn)行實(shí)時在線編程、仿真和配置。
  • 關(guān)鍵字： 813F  FPGA  PSD  813    

用PowerPC860實(shí)現(xiàn)FPGA配置

  • 介紹如何用PowerPC860（MPC860）進(jìn)行FPGA（Xilinx的Virtex-II系列）的配置；給出進(jìn)行FPGA配置所需的詳細(xì)時序圖和原理圖。
  • 關(guān)鍵字： PowerPC  FPGA  860    

利用FPGA實(shí)現(xiàn)MMC2107與SDRAM接口設(shè)計

  • 介紹基于現(xiàn)場可編程門陣列（FPGA），利用VHDL語言設(shè)計實(shí)現(xiàn)MMC2107與SDRAM接口電路。文中包括MMC2107組成結(jié)構(gòu)、SDRAM存儲接口結(jié)構(gòu)和SDRAM控制狀態(tài)機(jī)的設(shè)計。
  • 關(guān)鍵字： SDRAM  FPGA  MMC    

系統(tǒng)級RF芯片nRF24E1收發(fā)原理與應(yīng)用編程

零中頻射頻接收機(jī)技術(shù)

  • 2004年7月A版 摘  要：零中頻(Zero IF)或直接變換(Direct-Conversion)接收機(jī)具有體積小、成本低和易于單片集成的特點(diǎn)，正成為射頻接收機(jī)中極具競爭力的一種結(jié)構(gòu)。本文在介紹超外差(Super Heterodyne)結(jié)構(gòu)與零中頻結(jié)構(gòu)性能和特點(diǎn)的基礎(chǔ)上，重點(diǎn)分析零中頻結(jié)構(gòu)存在的本振泄漏(LO Leakage)、偶次失真(Even-Order Distortion)、直流偏差(DC Offset)、閃爍噪聲(Flicker Noise)等問題，并給出零中頻接收機(jī)的設(shè)計方法和
  • 關(guān)鍵字： RF專題  RF  IF  音視頻技術(shù)  

用TMS320LF2407和FPGA實(shí)現(xiàn)電能質(zhì)量監(jiān)測

  • 提出用TMS320LF2407和FPGA實(shí)現(xiàn)電能監(jiān)測的一種方案，闡述各模塊的設(shè)計和實(shí)現(xiàn)方法，本方案中，F(xiàn)PGA用于采樣16路交流信號并進(jìn)行64次諧波分析。
  • 關(guān)鍵字： 質(zhì)量  監(jiān)測  電能  實(shí)現(xiàn)  FPGA  TMS320LF2407  

Vitex-4平臺FPGA

  • 　　Xilinx公司基于ASMBLTM(Advanced Silicon Modular Block)架構(gòu)最近推出第4代Virtex系列器件Vitex-4平臺FPGA，成為具有成本優(yōu)勢的ASIC和ASSP替代解決方案。 Vitex-4平臺FPGA 　　Vitex-4平臺FPGA系列(Vitex-4 LX、SX、FX)提供不同的內(nèi)核功能組合(見圖1)。邏輯、存儲器、并行和串行I/O、嵌入式處理器、高性能DSP、增強(qiáng)時鐘管理、硬IP、混合信號以及其他功能模塊的優(yōu)化組合使Vitex-4系列可以完美地滿足特定
  • 關(guān)鍵字： FPGA  嵌入式  
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