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mcu-fpga 文章 最新資訊

低碼率語音編碼MELP聲碼器的SOPC實現(xiàn)

  • 摘要：討論了低碼率語音編碼MELP的編解碼過程，有效降低了語音編碼碼率并能使說話者個人語音特征減弱，特...
  • 關(guān)鍵字： SOPC  MELP  語音編碼  FPGA  NiosII  

SignalTapII ELA的FPGA在線調(diào)試技術(shù)

  • 通過對FPGA內(nèi)部信號的捕獲測試，可以實現(xiàn)對系統(tǒng)設(shè)計缺陷的實時分析和修正。與外部測試設(shè)備相比，可以總結(jié)出SignalTapII ELA的幾點優(yōu)越性：不占用額外的I／O引腳，不占用PCB上的空間，不破壞信號的時序和完整性，不需額外費(fèi)用；從多方面證實，該測試手段可以減少調(diào)試時間，縮短設(shè)計周期。
  • 關(guān)鍵字： SignalTapII  FPGA  ELA  在線調(diào)試    

臺積電發(fā)布0.18微米車用嵌入式閃存硅知識產(chǎn)權(quán)

  • 　　TSMC今日宣布推出0.18微米車用嵌入式閃存硅知識產(chǎn)權(quán)，是TSMC第二代符合AEC-Q100產(chǎn)品高規(guī)格認(rèn)證之硅知識產(chǎn)權(quán)，適用于廣泛的車用電子產(chǎn)品。 　　TSMC 0.18微米車用嵌入式閃存硅知識產(chǎn)權(quán)與0.25微米嵌入式閃存硅知識產(chǎn)權(quán)相較，減少了百分之二十七的芯片尺寸?，F(xiàn)今0.18微米技術(shù)世代擁有已經(jīng)大量開發(fā)的硅知識產(chǎn)權(quán)，并能支持多種應(yīng)用，同時達(dá)到低成本與高效能的綜效。運(yùn)用TSMC獲認(rèn)證的0.18微米車用嵌入式閃存硅知識產(chǎn)權(quán)，客戶能夠?qū)⑵淠壳暗?.18微米產(chǎn)品范圍延伸至車用微控制器(MCU)產(chǎn)品領(lǐng)域
  • 關(guān)鍵字： 臺積電  嵌入式閃存  MCU  

誰會在代工投資“盛宴”中缺席？

  • 　　在前3年之前全球代工總是在看前4大的動向，包括臺積電、聯(lián)電、中芯國際及特許。然而，臺積電一家獨大，聯(lián)電居老二似乎也相安無事。 　　自AMD分出Globalfoundries，及ATIC又兼并特許，再把Globalfoundries與特許合并在一起。表面上看少了一個特許，實際上由于Globalfoundries在其金主支持下積極建新廠，在代工業(yè)界引發(fā)了波浪,至少誰將成為老二成為話題。 　　加上存儲器大享三星近期開始投資代工，放言要接高通的手機(jī)芯片訂單;加上fabless大廠Xilinx改變策略，把2
  • 關(guān)鍵字： 臺積電  FPGA  28nm  

基于FPGA的RS485接口誤碼測試儀的設(shè)計和實現(xiàn)

  • 介紹了一種基于FPGA的誤碼測試儀的設(shè)計原理、實現(xiàn)過程及調(diào)試經(jīng)驗。該誤碼測試系統(tǒng)使用RS485接口，具有原理簡單、接口獨特、功能豐富等特點，系統(tǒng)具有較好的可擴(kuò)展性。
  • 關(guān)鍵字： FPGA  485  RS  接口    

子帶分解的自適應(yīng)濾波器的FPGA實現(xiàn)

  • 基于子帶分解的自適應(yīng)濾波器在提高收斂性能的同時又可以節(jié)省一定的計算量。采用Altera公司的仿真軟件Altera DSP Builder和QuartusⅡ7．2進(jìn)行子帶分解的NLMS算法的自適應(yīng)濾波器現(xiàn)場可編程門陣列設(shè)計，利用Simulink和ModelSim對設(shè)計方案進(jìn)行了模型仿真和功能仿真，達(dá)到較好的效果。
  • 關(guān)鍵字： FPGA  分解  自適應(yīng)濾波器    

瑞薩電子推出“全球化與綠色化”MCU業(yè)務(wù)新戰(zhàn)略

  • 　　業(yè)界首屈一指的半導(dǎo)體解決方案供應(yīng)商瑞薩電子株式會社(以下簡稱“瑞薩電子”，TSE: 6723)日前宣布推出“全球化與綠色化”(“Global & Green”)戰(zhàn)略，這無疑是為公司具有核心競爭力的MCU(微控制器)產(chǎn)品開辟了新的業(yè)務(wù)視角。“全球化與綠色化”戰(zhàn)略傳達(dá)了瑞薩電子將致力于在為各地區(qū)提供解決方案，以提高全球業(yè)務(wù)增長的同時，通過提供先進(jìn)的MCU產(chǎn)品和技術(shù)來滿足日益增長的節(jié)能需求，不斷為實現(xiàn)環(huán)境
  • 關(guān)鍵字： 瑞薩電子  MCU  

常用FPGA/CPLD四種設(shè)計技巧

  • 常用FPGA/CPLD四種設(shè)計技巧,FPGA/CPLD的設(shè)計思想與技巧是一個非常大的話題，本文僅介紹一些常用的設(shè)計思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導(dǎo)日
  • 關(guān)鍵字： 技巧  設(shè)計  FPGA/CPLD  常用  

AEMB軟核處理器的SoC系統(tǒng)驗證平臺的構(gòu)建

  • SoC芯片的規(guī)模一般遠(yuǎn)大于普通的ASIC，同時深亞微米工藝帶來的設(shè)計困難等使得SoC設(shè)計的復(fù)雜度大大提高。仿...
  • 關(guān)鍵字： FPGA  SoC  系統(tǒng)驗證平臺  AEMB  軟核處理器  

基于FPGA的RS485接口誤碼測試儀的設(shè)計

  • 摘要：介紹了一種基于FPGA的誤碼測試儀的設(shè)計原理、實現(xiàn)過程及調(diào)試經(jīng)驗。該誤碼測試系統(tǒng)使用RS485接口...
  • 關(guān)鍵字： FPGA  RS485  誤碼測試儀  

可實現(xiàn)快速鎖定的FPGA片內(nèi)延時鎖相環(huán)設(shè)計

  • 摘要：延時鎖相環(huán)(DLL)是一種基于數(shù)字電路實現(xiàn)的時鐘管理技術(shù)。DLL可用以消除時鐘偏斜，對輸入時鐘進(jìn)行分頻、倍頻、移相等操作。文中介紹了FPGA芯片內(nèi)DLL的結(jié)構(gòu)和設(shè)計方案，在其基礎(chǔ)上提出可實現(xiàn)快速鎖定的延時鎖相環(huán)
  • 關(guān)鍵字： FPGA  延時  鎖相環(huán)    

使用SignalTap II邏輯分析儀調(diào)試FPGA

  • 摘 要 ：本文介紹了可編程邏輯器件開發(fā)工具Quartus II 中SingalTap II 嵌入式邏輯分析器的使用，并給出一個具體的設(shè)計實例，詳細(xì)介紹使用SignalTap II對FPGA調(diào)試的具體方法和步驟。
    關(guān)鍵字 ： SignalTap；硬件調(diào)試
  • 關(guān)鍵字： SignalTap  FPGA  邏輯分析儀  調(diào)試    

復(fù)用器重構(gòu)降低FPGA成本

  • 摘 要： 本文介紹了一種新的復(fù)用器重構(gòu)算法，能夠降低FPGA實際設(shè)計20％的成本。該算法通過減少復(fù)用器所需查找表（LUT）的數(shù)量來實現(xiàn)。算法以效率更高的4:1復(fù)用器替代2:1復(fù)用器樹。算法性能的關(guān)鍵在于尋找總線上出現(xiàn)的
  • 關(guān)鍵字： FPGA  復(fù)用器    

利用FPGA和CPLD數(shù)字邏輯實現(xiàn)ADC

  • 數(shù)字系統(tǒng)的設(shè)計人員擅長在其印制電路板上用FPGA和CPLD將各種處理器、存儲器和標(biāo)準(zhǔn)的功能元件粘合在一起來實現(xiàn)數(shù)字設(shè)計。除了這些數(shù)字功能之外，F(xiàn)PGA和CPLD還可以使用LVDS輸入、簡單的電阻電容(RC)電路和一些FPGA或CP
  • 關(guān)鍵字： FPGA  CPLD  ADC  數(shù)字邏輯    

基于Actel FPGA的VGA顯示控制方案

  • 　　目前無論是工控產(chǎn)品還是消費(fèi)產(chǎn)品，在需要用到大屏幕的場合最常使用的是基于VGA接口的顯示器。VGA接口的顯示器具有顯示分辨率大、顯示圖像細(xì)膩、彩色效果突出等特點。正是由于這些優(yōu)點，VGA接口的控制器廣泛應(yīng)用于各種終端設(shè)備、醫(yī)療儀器、汽車電子、消費(fèi)電子等領(lǐng)域。 　　1.VGA簡介 　　VGA是視頻圖形陣列(Video Graphics Array)的簡稱，是IBM于1987年提出的一個使用模擬信號的圖形顯示標(biāo)準(zhǔn)。最初的VGA標(biāo)準(zhǔn)最大只能支持640*480分辨率的顯示器，而為了適應(yīng)大屏幕的應(yīng)用，視頻
  • 關(guān)鍵字： Actel  FPGA  VGA接口  201005  
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