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fpga-pwm 文章 最新資訊

CERN科學(xué)家利用Virtex-4 FPGA進行大爆炸研究

  • CERN ScientistsUseVirtex-4 FPGAs for Big Bang Research 　　在法國瑞士邊境的地下隧道中，歐洲核子研究中心的科學(xué)家們正在準備進行一項稱為“大型離子撞擊實驗 -ALICE（A Large Ion Collider Experiment）”的實驗。 他們將利用世界上最強大的粒子加速器將兩束重鉛離子加速到接近光速的速度，并控制他們迎頭相撞，試圖重新創(chuàng)造出據(jù)說僅在宇宙大爆炸后短暫存在過的條件。 CERN科學(xué)家預(yù)計每次相撞將會釋放出巨
  • 關(guān)鍵字： CERN  Virtex-4  FPGA  200811  

Floorplanner工具應(yīng)用基于FPGA的嵌入式

  • 通過在可編程邏輯器件中嵌入低成本、高性能的處理器，芯片開發(fā)商不但能提高系統(tǒng)的整體性能，而且能夠從可編...
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基于TOP249Y芯片的開關(guān)電源設(shè)計方法

  • 1引言隨著PWM技術(shù)的不斷發(fā)展和完善,開關(guān)電源得到了廣泛的應(yīng)用,以往開關(guān)電源的設(shè)計通常采用控制電...
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業(yè)界容量最大的ASIC原型電路板采用了Altera Stratix III器件

  •  　　2008年11月11號，北京——Altera公司(NASDAQ: ALTR)今天宣布，Dini集團在其業(yè)界容量最大的單板FPGA原型引擎中采用了具有340K邏輯單元(LE)的Stratix® III EP3SL340 FPGA。DN7020K10采用了1,760引腳封裝的20片EP3SL340 FPGA，每個器件提供1,104個用戶I/O，容量等價于5千萬ASIC邏輯門?？蛻粼O(shè)計無線通信、網(wǎng)絡(luò)和圖形處理應(yīng)用等定制ASIC時，可以利用這一超大容量原型電路板來驗
  • 關(guān)鍵字： Altera  Dini集團  Altera Stratix III FPGA  ASIC  

采用FPGA來實現(xiàn)自適應(yīng)波束形成算法

直面FPGA在嵌入式測試系統(tǒng)中的設(shè)計挑戰(zhàn)

  • “嵌入式系統(tǒng)”這個詞范圍很廣，從數(shù)字式電子表到變電站電力檢測系統(tǒng)中的PC都可歸于這一范疇。大多數(shù)情況...
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FPGA與PCB板焊接連接的實時失效檢測

  • 問題描述：81%的電子系統(tǒng)中在使用FPGA，包括很多商用產(chǎn)品和國防產(chǎn)品，并且多數(shù)FPGA使用的是BGA封裝形式...
  • 關(guān)鍵字： FPGA  PCB  BGA  

DSP+FPGA實時信號處理系統(tǒng)

  • 實時信號處理系統(tǒng)要求必須具有處理大數(shù)據(jù)量的能力,以保證系統(tǒng)的實時性;其次對系統(tǒng)的體積、功耗、穩(wěn)定性...
  • 關(guān)鍵字： DSP  FPGA  信號處理  實時操作  

PSoC? 在清華大學(xué)取得巨大成功

  • 　　2008 年 10 月 14日，北京訊 — 賽普拉斯半導(dǎo)體公司中國業(yè)務(wù)運營部與賽普拉斯大學(xué)聯(lián)盟 (CUA) 協(xié)力共同為中國的名牌大學(xué)清華大學(xué) (THU) 提供 PSoC? 器件及相關(guān)套件。相關(guān)工作取得了顯著成效，PSoC 在兩門課程的學(xué)習(xí)中得到全面推廣，并幫助 100 多名學(xué)生了解到如何用賽普拉斯業(yè)界領(lǐng)先的可編程片上系統(tǒng)解決方案設(shè)計復(fù)雜的系統(tǒng)。 　　清華大學(xué)自動化系與清華大學(xué)科教儀器設(shè)備廠攜手開發(fā)了 PSoC 實驗室套件。該套件于去年春天獲得了清華大學(xué)頒發(fā)的“第10屆
  • 關(guān)鍵字： 賽普拉斯  PSoC   FPGA   

利用可編程邏輯實現(xiàn)高性能的罪犯抓捕系統(tǒng)

  • 由于高科技工具成為抓捕罪犯的武器中越來越關(guān)鍵的部分，因此執(zhí)法機構(gòu)和安全專業(yè)人員不斷尋求更快更方便的數(shù)據(jù)...
  • 關(guān)鍵字： FPGA  汽車電子  語音  視頻  

基于FPGA的UART接口開發(fā)

  • 　　設(shè)計背景 　　串口即通用異步收發(fā)器（UART，Universal Asynchronous Receiver Transmitter）。串行通信具有傳輸線少、成本低、可靠性高等優(yōu)點，所以系統(tǒng)間互聯(lián)常采用RS-232接口方式，一般該接口由UART 專用芯片來實現(xiàn)。但UART接口芯片一般引腳較多，內(nèi)含許多輔助模塊和一些輔助功能，在實際使用時往往用不到這些功能，因此若采用UART專用芯片，必將使電路變得復(fù)雜，PCB面積增大，從而導(dǎo)致成本增加，系統(tǒng)的穩(wěn)定性和可靠性降低?；镜腢ART通信只需要兩條信號線（R
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2008嵌入式設(shè)計調(diào)查：工程師時刻都在趕項目

  • 　??? Tech?Insights/Embedded?Systems?Design?2008年嵌入式市場調(diào)研報告表明，嵌入式系統(tǒng)設(shè)計人員在2008年要參與更多項目的開發(fā)，按期完成開發(fā)任務(wù)是他們最大的問題，有一半以上（大于50%）的開發(fā)項目不能按期完成。 　　調(diào)查結(jié)果表明：自2005年以來，2008年新項目對應(yīng)項目改進的比例是這幾年中最高的。在所有開發(fā)項目中，新開發(fā)項目占46%，剩余54%為以往開發(fā)項目的升級和改進。項目的改進和升級主
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賽靈思推出Virtex-5 FXT FPGA ML510 嵌入式開發(fā)平臺

  • 　　賽靈思公司日前宣布推出 Virtex-5 FXT FPGA ML510 嵌入式開發(fā)平臺，用于開發(fā)支持雙處理器的高性能嵌入式系統(tǒng)。這一新的開發(fā)平臺基于集成雙 Power PC? 440處理器的 Virtex-5 FXT FPGA，并且可以支持 Linux和VxWorks 操作系統(tǒng)，為軟件和硬件設(shè)計團隊提供了無與倫比的靈活性和計算能力。 　　結(jié)合豐富的參考設(shè)計和由屢獲殊榮的開發(fā)工具、配置向?qū)Ш?IP 組成的賽靈思嵌入式開發(fā)套件（EDK），ML510 嵌入式開發(fā)平臺為構(gòu)建利用雙處理器完成專用分配功
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