fpga soc 文章最新資訊

工程師設(shè)計(jì)經(jīng)驗(yàn)分享：畫(huà)FPGA開(kāi)發(fā)板所犯的那些錯(cuò)誤

　　畫(huà)FPGA開(kāi)發(fā)板所犯的那些錯(cuò)誤，小編這里先截下我最初畫(huà)這個(gè)開(kāi)發(fā)板的一張“慘不忍睹”的PCB讓大家看看。　　Top Layer如圖：　　　　Bottom Layer如圖：　　　　第一遍畫(huà)的時(shí)候，想“速戰(zhàn)速?zèng)Q”把它畫(huà)完，草草了事，但是等全部布線(xiàn)完以后卻發(fā)現(xiàn)這里面的錯(cuò)誤實(shí)在是太多了，我覺(jué)得最核心的錯(cuò)誤就是一開(kāi)始就沒(méi)有注意整個(gè)系統(tǒng)各個(gè)元器件的布局，從而導(dǎo)致了“災(zāi)難”的發(fā)生，后來(lái)的布線(xiàn)也就非常困難。大家很容易可以
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CAST和Achronix使用無(wú)損壓縮IP支持從數(shù)據(jù)中心到邊緣的數(shù)據(jù)處理

　　基于現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)的硬件加速器器件及嵌入式FPGA(eFPGA)領(lǐng)域內(nèi)領(lǐng)導(dǎo)性企業(yè)Achronix半導(dǎo)體公司(Achronix Semiconductor Corporation)日前宣布：與專(zhuān)注于為電子系統(tǒng)設(shè)計(jì)人員提供半導(dǎo)體IP的半導(dǎo)體知識(shí)產(chǎn)權(quán)公司CAST Incorporated達(dá)成合作;CAST的高性能無(wú)損壓縮IP已經(jīng)被植入，以支持Achronix 的FPGA產(chǎn)品組合，用來(lái)完成數(shù)據(jù)中心和移動(dòng)邊緣間數(shù)據(jù)傳輸?shù)母咝幚怼！　AST為Deflate
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FPGA學(xué)習(xí)：PLL分頻計(jì)數(shù)的LED閃爍實(shí)例

　　如圖8.17所示，本實(shí)例將用到FPGA內(nèi)部的PLL資源，輸入FPGA引腳上的25MHz時(shí)鐘，配置PLL使其輸出4路分別為12.5MHz、25MHz、50MHz和100MHz的時(shí)鐘信號(hào)，這4路時(shí)鐘信號(hào)又分別驅(qū)動(dòng)4個(gè)不同位寬的計(jì)數(shù)器不停的計(jì)數(shù)工作，這些計(jì)數(shù)器的最高位最終輸出用于控制4個(gè)不同的LED亮滅。由于這4個(gè)時(shí)鐘頻率都有一定的倍數(shù)關(guān)系，所以我們也很容易通過(guò)調(diào)整合理的計(jì)數(shù)器位寬，達(dá)到4個(gè)LED閃爍一致的控制?！　?nbsp; 　　cy4.v模塊代碼解析　　先來(lái)看cy4.v模塊的
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將eFPGA應(yīng)用于嵌入式360度視域視覺(jué)系統(tǒng)中

　　引言：2018年4月11日，工業(yè)和信息化部、公安部和交通運(yùn)輸部聯(lián)合發(fā)布“關(guān)于印發(fā)《智能網(wǎng)聯(lián)汽車(chē)道路測(cè)試管理規(guī)范(試行)》的通知”，為我國(guó)智能網(wǎng)聯(lián)汽車(chē)道路測(cè)試提供了相關(guān)法律依據(jù)。三部委在賦予智能網(wǎng)聯(lián)汽車(chē)上路資格的同時(shí)，也提出了若干嚴(yán)格的條件?！　∑渲?，在第二章“測(cè)試主體、測(cè)試駕駛?cè)思皽y(cè)試車(chē)輛”的第七條第(四)點(diǎn)中，三部委要求：具備車(chē)輛狀態(tài)記錄、存儲(chǔ)及在線(xiàn)監(jiān)控功能，能實(shí)時(shí)回傳下列第1、2、3項(xiàng)信息，并自動(dòng)記錄和存儲(chǔ)下列各項(xiàng)信息在車(chē)輛事故或失效狀況發(fā)生前至少90秒的數(shù)據(jù)，數(shù)據(jù)存儲(chǔ)時(shí)間不少于3年：　　1.&n
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Arm推出全新靈活SoC解決方案，助力物聯(lián)網(wǎng)安全設(shè)備加速開(kāi)發(fā)

　　Arm宣布推出一套基于PSA規(guī)范的全新物聯(lián)網(wǎng)解決方案——Arm SDK-700系統(tǒng)設(shè)計(jì)套件，以用于加速安全SoC的開(kāi)發(fā)。作為一套綜合的SoC系統(tǒng)框架，使用 Arm SDK-700系統(tǒng)設(shè)計(jì)套件可設(shè)計(jì)安全的SoC，并應(yīng)用于豐富多樣的IoT節(jié)點(diǎn)、網(wǎng)關(guān)設(shè)備和嵌入式產(chǎn)品。該解決方案不僅使合作伙伴能夠在通用軟件開(kāi)發(fā)環(huán)境中打造安全設(shè)備，同時(shí)還使其業(yè)務(wù)的多樣性和差異化可以在新的物聯(lián)網(wǎng)應(yīng)用中蓬勃發(fā)展?！　rm是物聯(lián)網(wǎng)的首選架構(gòu)，迄今為止已為1250億芯片提供了計(jì)算能力。公司有一個(gè)宏大的愿
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“FPGA加速”正進(jìn)入數(shù)據(jù)中心的主流應(yīng)用

　　“英特爾現(xiàn)在的定位是以數(shù)據(jù)為中心的企業(yè)，而過(guò)去是PC平臺(tái)。”英特爾可編程解決方案事業(yè)部亞太區(qū)市場(chǎng)拓展經(jīng)理劉斌先生稱(chēng)。他是在近日舉行的“英特爾可編程解決方案新聞發(fā)布會(huì)”上說(shuō)此番話(huà)的。　　此次發(fā)布會(huì)主要介紹了三個(gè)內(nèi)容：　　*采用英特爾PAC(可編程加速卡)的戴爾服務(wù)器現(xiàn)已大量上市;此外，富士通也在支持重點(diǎn)客戶(hù)使用。　　*通過(guò)免費(fèi)的PAC加速堆棧，可在常見(jiàn)軟件開(kāi)發(fā)環(huán)境中提供通用硬件加速性能。　　*兩個(gè)應(yīng)用案例：面向財(cái)務(wù)風(fēng)險(xiǎn)分析和數(shù)據(jù)庫(kù)加速的
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加速云基于FPGA的加速解決方案搞定高算力AI應(yīng)用場(chǎng)景

人工智能（AI）和大數(shù)據(jù)的不斷發(fā)展帶來(lái)對(duì)超高計(jì)算力的需求，使得相應(yīng)硬件組成和算法架構(gòu)也在不斷創(chuàng)新中尋求突破，以達(dá)到新應(yīng)用所需的計(jì)算能力。
關(guān)鍵字： FPGA，加速，AI，大數(shù)據(jù)

Arm/FPGA聯(lián)手發(fā)威　研華生產(chǎn)線(xiàn)大步邁入AI時(shí)代

　　人工智能(Artificial Intelligence, AI)無(wú)疑是近一兩年來(lái)科技產(chǎn)業(yè)內(nèi)最熱門(mén)的話(huà)題，除了科技業(yè)巨頭無(wú)不大力投入之外，金融等服務(wù)業(yè)者對(duì)導(dǎo)入人工智能，也展現(xiàn)出強(qiáng)烈興趣。制造業(yè)對(duì)AI技術(shù)的關(guān)注，也不在話(huà)下，并且在相關(guān)關(guān)鍵技術(shù)逐漸到位的情況下，已開(kāi)始有實(shí)際導(dǎo)入動(dòng)作?！　〕珜?dǎo)智能制造不遺余力的研華科技，除了為各行各業(yè)提供對(duì)應(yīng)的先進(jìn)解決方案外，在自家生產(chǎn)在線(xiàn)也開(kāi)始逐步導(dǎo)入人工智能要素。比如機(jī)臺(tái)設(shè)備的狀態(tài)偵測(cè)/診斷、原物料/能源的使用狀況，乃至產(chǎn)品的品管流程等，均已逐步導(dǎo)入
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無(wú)線(xiàn)充電市場(chǎng)將迎來(lái)價(jià)格戰(zhàn)，MCU替代SoC或成長(zhǎng)尾效應(yīng)

　　自iPhone 8/X標(biāo)配無(wú)線(xiàn)充電功能后，無(wú)線(xiàn)充電市場(chǎng)開(kāi)始爆發(fā)且持續(xù)升溫，給國(guó)內(nèi)無(wú)線(xiàn)充電廠(chǎng)商帶來(lái)了巨大的市場(chǎng)紅利，其中發(fā)射端無(wú)線(xiàn)充電器快速起量，增幅超10倍。然而，隨著蘋(píng)果無(wú)線(xiàn)充電器AirPower即將上市，小米、華為也將發(fā)布帶有無(wú)線(xiàn)充電功能的新機(jī)，整個(gè)無(wú)線(xiàn)充電市場(chǎng)將會(huì)迎來(lái)又一輪的爆發(fā)。不過(guò)，在新一輪的爆發(fā)潮中，由MCU和SoC方案引發(fā)的價(jià)格戰(zhàn)也隨之而來(lái)?！　irPower上市在即，新一輪爆發(fā)開(kāi)啟價(jià)格戰(zhàn)　　近日，業(yè)界傳出最新消息稱(chēng)，蘋(píng)果原裝的無(wú)線(xiàn)充電器AirPower會(huì)在月底正式上市發(fā)售，
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慧榮科技（Silicon Motion）圖形顯示SoC

　　功耗和帶寬：　　將任何電腦橋接到任何高清顯示器的解決方案的兩大挑戰(zhàn)　　從設(shè)計(jì)和配置目前辦公空間、零售店、酒店運(yùn)營(yíng)和工廠(chǎng)的趨勢(shì)來(lái)看，該方案比以往更具移動(dòng)性和靈活性。這對(duì)提供各類(lèi)設(shè)備顯示器接口具有重要作用。尤其是用戶(hù)和雇主需要通過(guò) USB 連接到便攜式或共享顯示器的設(shè)備?！　SB(通用串行總線(xiàn))，名符其實(shí)，在計(jì)算設(shè)備(如筆記本電腦、平板電腦和智能設(shè)備)中得到普遍使用。雖然筆記本電腦或平板電腦可能不包含目前所有顯示器接口(如&
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芯原微電子購(gòu)買(mǎi)Arteris IP的 FlexNoC?互連技術(shù)

　　Arteris IP是經(jīng)過(guò)實(shí)際驗(yàn)證的系統(tǒng)級(jí)芯片(SoC)互連半導(dǎo)體知識(shí)產(chǎn)權(quán)(IP)產(chǎn)品的創(chuàng)新供應(yīng)商，今天宣布，芯原微電子控股有限公司(VeriSilicon)已購(gòu)買(mǎi)多項(xiàng)Arteris FlexNoC互聯(lián)IP產(chǎn)品的使用權(quán)，在數(shù)據(jù)中心、汽車(chē)和其他應(yīng)用中用作系統(tǒng)級(jí)芯片(SoC)片上通信的主干部件?！　⌒驹㈦娮邮且患覐氖鹿璋雽?dǎo)體平臺(tái)服務(wù)(SiPaaS?)的公司，為廣泛的市場(chǎng)提供全面的系統(tǒng)級(jí)芯片(SoC)解決方案。芯原微電子團(tuán)隊(duì)擅長(zhǎng)使用Arteris IP來(lái)優(yōu)化系統(tǒng)級(jí)芯片的片上通
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英特爾? FPGA 加速人工智能發(fā)展，助力深度學(xué)習(xí)應(yīng)用于微軟必應(yīng)智能搜索

　　人工智能 (AI) 正在革新各行各業(yè)，改變數(shù)據(jù)的管理和解釋方式，而且將幫助人們和企業(yè)更快地解決實(shí)際難題?！　〗裉斓?nbsp;微軟必應(yīng)智能搜索(Intelligent Search)*新聞?wù)故玖擞⑻貭? FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)技術(shù)正如何有效支持全球最先進(jìn)的一些人工智能平臺(tái)。借助實(shí)時(shí)人工智能，必應(yīng) (Bing)搜索引擎不僅能夠提供標(biāo)準(zhǔn)搜索結(jié)果，還能滿(mǎn)足用戶(hù)的更多需求，幫助其快速了解所需知識(shí)和信息。必應(yīng)智能搜索將提供答案而非網(wǎng)頁(yè)，支持系統(tǒng)理解詞語(yǔ)和詞
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怎樣加速“深度學(xué)習(xí)”？GPU、FPGA還是專(zhuān)用芯片？

　　計(jì)算機(jī)發(fā)展到今天，已經(jīng)大大改變了我們的生活，我們已經(jīng)進(jìn)入了智能化的時(shí)代。但要是想實(shí)現(xiàn)影視作品中那樣充分互動(dòng)的人工智能與人機(jī)互動(dòng)系統(tǒng)，就不得不提到深度學(xué)習(xí)?！　∩疃葘W(xué)習(xí)　　深度學(xué)習(xí)的概念源于人工神經(jīng)網(wǎng)絡(luò)的研究。含多隱層的多層感知器就是一種深度學(xué)習(xí)結(jié)構(gòu)。深度學(xué)習(xí)通過(guò)組合低層特征形成更加抽象的高層表示屬性類(lèi)別或特征，以發(fā)現(xiàn)數(shù)據(jù)的分布式特征表示。　　深度學(xué)習(xí)的概念由Hinton等人于2006年提出。基于深信度網(wǎng)(DBN)提出非監(jiān)督貪心逐層訓(xùn)練算法，為解決深層結(jié)構(gòu)相關(guān)的優(yōu)化難題帶來(lái)希望，隨后提出多層自動(dòng)編碼器深
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CPU主頻比FPGA快，但為啥FPGA才可以加速？

　　CPU的主頻高達(dá)幾個(gè)GHz，F(xiàn)PGA的速率往往在幾百兆。但是，往往我們會(huì)說(shuō)FPGA會(huì)給CPU進(jìn)行加速?！　‰m然CPU主頻很高，但其是通用處理器，做某個(gè)特定運(yùn)算(如信號(hào)處理，圖像處理)可能需要很多個(gè)時(shí)鐘周期;而FPGA可以通過(guò)編程重組電路，直接生成專(zhuān)用電路，加上電路并行性，可能做這個(gè)特定運(yùn)算只需要一個(gè)時(shí)鐘周期?！　〖僭O(shè)我們用FPGA完整的實(shí)現(xiàn)了CPU，然后再跑軟件的話(huà)，的確比CPU慢。問(wèn)題是FPGA不會(huì)那么干，它會(huì)直指問(wèn)題本質(zhì)，解決問(wèn)題。　　　　即使我們用FPGA實(shí)現(xiàn)一個(gè)CP
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聽(tīng)大神聊FPGA設(shè)計(jì)：豁然開(kāi)朗

　　FPGA是可編程芯片，因此FPGA的設(shè)計(jì)方法包括硬件設(shè)計(jì)和軟件設(shè)計(jì)兩部分。硬件包括FPGA芯片電路、存儲(chǔ)器、輸入輸出接口電路以及其他設(shè)備，軟件即是相應(yīng)的HDL程序以及最新才流行的嵌入式C程序。硬件設(shè)計(jì)是基礎(chǔ)，但其方法比較固定，本書(shū)將在第4節(jié)對(duì)其進(jìn)行詳細(xì)介紹，本節(jié)主要介紹軟件的設(shè)計(jì)方法。　　目前微電子技術(shù)已經(jīng)發(fā)展到SOC階段，即集成系統(tǒng)(Integrated System)階段，相對(duì)于集成電路(IC)的設(shè)計(jì)思想有著革命性的變化。SOC是一個(gè)復(fù)雜的系統(tǒng)，它將一個(gè)完整產(chǎn)品的功能集成在一個(gè)芯片上，包
關(guān)鍵字： FPGA