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fpga soc 文章 最新資訊

滿足嵌入式系統(tǒng)應(yīng)用的多核處理器SoC設(shè)計(jì)

  • 隨著嵌入式處理需求的快速增長，系統(tǒng)架構(gòu)正朝著多處理器設(shè)計(jì)的方向發(fā)展，以解決單處理器系統(tǒng)復(fù)雜度太高和計(jì)...
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Cadence使用最新開放型綜合平臺(tái)加快SoC實(shí)現(xiàn)，降低成本

  • 　　Cadence設(shè)計(jì)系統(tǒng)公司今天發(fā)布Cadence Open Integration Platform，該平臺(tái)能夠顯著降低SoC開發(fā)成本，提高質(zhì)量并加快生產(chǎn)進(jìn)度。Cadence Open Integration Platform是支持其新一代應(yīng)用驅(qū)動(dòng)式開發(fā)的EDA360愿景的一個(gè)關(guān)鍵支柱，包含公司自身及其產(chǎn)業(yè)鏈參與者提供的面向集成而優(yōu)化的IP、全新Cadence Integration Design Environment 以及按需集成服務(wù)。Cadence混合信號(hào)(模擬與數(shù)字)設(shè)計(jì)、驗(yàn)證與實(shí)現(xiàn)產(chǎn)品與解決
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德州儀器推出新型 FPGA 擴(kuò)展板

  • 　　日前，德州儀器 (TI) 宣布推出專用于 DK-LM3S9B96 開發(fā)套件的新型 Stellaris FPGA 擴(kuò)展板，可顯著加速開發(fā)低成本安全接入控制系統(tǒng)及其它需要高速外部處理單元接口的應(yīng)用。這款全新電路板使開發(fā)人員能夠輕松評(píng)估 Stellaris 微處理器 (MCU) 高靈活性外設(shè)接口 (EPI) 的高帶寬機(jī)器對(duì)機(jī)器 (M2M) 并行接口功能。EPI 的 M2M 模式可支持高達(dá) 32 位的數(shù)據(jù)寬度以及高達(dá)每秒 150 MB 的數(shù)據(jù)速率，專用于幫助低成本安全接入控制應(yīng)用的開發(fā)人員將攝像系統(tǒng)或低分辨率
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DNLMS濾波器的FPGA實(shí)現(xiàn)

  • 自適應(yīng)濾波器的研究是近年來研究的熱門方向，在PFGA中實(shí)現(xiàn)高速的自適應(yīng)濾波器的設(shè)計(jì)更是一個(gè)熱點(diǎn)，在此采用DSP Builder系統(tǒng)建模的方法，在FPGA中實(shí)現(xiàn)了歸一化LMS算法，實(shí)驗(yàn)結(jié)果表明：用DSPBuilder設(shè)計(jì)的8階DNLMS算法比用底層的VHDL代碼設(shè)計(jì)效率更高，靈活性更大，速度更快。同樣比通用的DSP芯片設(shè)計(jì)的8階NLMS濾波器處理速度快了20多倍。如果將8階NLMS濾波器擴(kuò)展到512階或者1 024階，可以很好地應(yīng)用于自適應(yīng)回聲消除等很多自適應(yīng)濾波的領(lǐng)域。
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一種基于FPGA的NoC驗(yàn)證平臺(tái)的構(gòu)建

  • 半導(dǎo)體工藝技術(shù)進(jìn)入深亞微米時(shí)代后，基于總線系統(tǒng)芯片SoC(SvstemonChip)的體系結(jié)構(gòu)在物理設(shè)計(jì)、通信帶...
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一種基于FPGA的新型數(shù)字電壓表研究與設(shè)計(jì)

  • 數(shù)字電壓表是大學(xué)物理教學(xué)和實(shí)驗(yàn)中的重要儀表，其數(shù)字化是指將連續(xù)的模擬電壓量轉(zhuǎn)換成不連續(xù)、離散的數(shù)字...
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Mobileye 獲MIPS32 1004K 同步處理系統(tǒng)授權(quán)

  • 　　為數(shù)字消費(fèi)、家庭網(wǎng)絡(luò)、無線、通信和商業(yè)應(yīng)用提供業(yè)界標(biāo)準(zhǔn)處理器架構(gòu)與內(nèi)核的領(lǐng)導(dǎo)廠商美普思科技公司(MIPS Technologies, Inc.,)宣布，全球視覺式(vision-based)防撞系統(tǒng)的先驅(qū)和領(lǐng)導(dǎo)廠商 Mobileye 公司已獲得其多線程、多處理 MIPS32 1004K 同步處理系統(tǒng)(CPS)授權(quán)。Mobileye 將在其新一代 EyeQ 視覺式 SoC 中采用 1004K CPS，用于駕駛輔助系統(tǒng)。Mobileye 在其現(xiàn)有的 EyeQ2 SoC 中已采用了多線程 MIPS32 34
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全球代工進(jìn)入投資競(jìng)賽

  • 　　幾年之前代工廠宣布建新生產(chǎn)線是為了超過它的競(jìng)爭(zhēng)對(duì)手，而不是真正市場(chǎng)需求。 　　此種不計(jì)后果的思維，使得許多代工制造商即便在產(chǎn)業(yè)的下降時(shí)期也開建生產(chǎn)線，但是近年來代工己經(jīng)變得越來越保守，因?yàn)樗鼈兒ε庐a(chǎn)能過剩。 　　眼下許多代工廠的表現(xiàn)又好象回復(fù)到過去的戰(zhàn)術(shù)，開始進(jìn)入新一輪的投資戰(zhàn)或者武器競(jìng)賽。這是巴克萊投資公司分析師 CJ Muse在新報(bào)告中的描述。 　　三個(gè)廠GlobalFoundries,Samsung及TSMC都準(zhǔn)備為了在新一輪上升周期中擴(kuò)大自已的市場(chǎng)份額, 而開始投資競(jìng)賽。此種趨勢(shì)顯然對(duì)于
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基于FPGA的多路正弦波信號(hào)發(fā)生器專用芯片設(shè)計(jì)

  • 基于開源思想與SOPC技術(shù)，采用32位開源軟核處理器OR1200和開源軟核DDS，在FPGA上實(shí)現(xiàn)了頻率、相位可預(yù)置并且可調(diào)的3路正弦波信號(hào)發(fā)生器專用芯片的設(shè)計(jì)。該專用芯片基于OR1200固化專用程序?qū)崿F(xiàn)，通過UART傳輸控制數(shù)據(jù)，可同時(shí)控制3路正弦波的產(chǎn)生，其頻率范圍為1 Hz~100 MHz，步進(jìn)頻率為1 Hz，相位范圍為0°~359°。設(shè)計(jì)方案在DE2-70開發(fā)板上進(jìn)行了實(shí)際驗(yàn)證，證明了設(shè)計(jì)的正確性和可行性。
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AES算法中S-box和列混合單元的優(yōu)化及FPGA技術(shù)實(shí)現(xiàn)

  • AES算法中S-box和列混合單元的優(yōu)化及FPGA技術(shù)實(shí)現(xiàn),1 S-box的優(yōu)化設(shè)計(jì)

    在AES標(biāo)準(zhǔn)算法中定義了兩個(gè)較大的列表。S-box和逆S-box。將S-box用于兩個(gè)應(yīng)用：字節(jié)替代和密鑰擴(kuò)展。而逆S-box則用于逆字節(jié)替代。這兩個(gè)列表是不相同的，因此必須建立兩個(gè)不同的ROM(256×8 b)，
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Virtex-6 FPGA ML605開發(fā)評(píng)估技術(shù)方案

  • Virtex-6 FPGA ML605開發(fā)評(píng)估技術(shù)方案,Virtex-6 FPGA適合用有線通信,無線基礎(chǔ)設(shè)備和廣播設(shè)備等領(lǐng)域.本文介紹了Virtex-6 FPGA主要特性,以及骨干網(wǎng)OTU-4成幀與EFEC框圖, LTE 2x2無線電設(shè)計(jì)框圖和支持SD/HD/3G-SDI接口的新一代交換框圖, Virtex®-6 FPGA
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德州儀器 C64x 架構(gòu)采用 Linux 內(nèi)核

  • 　　日前，德州儀器 (TI) 宣布為其 C64x 系列數(shù)字信號(hào)處理器 (DSP) 與多內(nèi)核片上系統(tǒng) (SoC) 提供 Linux 內(nèi)核支持，以充分滿足通信與關(guān)鍵任務(wù)基礎(chǔ)設(shè)施、醫(yī)療診斷以及高性能測(cè)量測(cè)試等應(yīng)用需求?？蛻粽諠u將開源代碼作為產(chǎn)品的重要組成部分，因此應(yīng)用開發(fā)人員將充分受益于 TI 高性能 DSP 采用 Linux 的優(yōu)勢(shì)，可減少軟件開發(fā)，并集中更多的精力在其應(yīng)用中實(shí)現(xiàn)特性與軟件的差異化。 　　Nash Technologies 的 Olaf Soentgen 指出：“TI 基于 C
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Synopsys推出快速原型系統(tǒng)HAPS-60系列

  • 下一代系統(tǒng)提供最高的性能、最高的容量、預(yù)測(cè)試IP和獨(dú)有先進(jìn)驗(yàn)證功能 美國加利福尼亞州山景城，2010年5月—— 全球領(lǐng)先的半導(dǎo)體設(shè)計(jì)、驗(yàn)證和制造軟件及知識(shí)產(chǎn)權(quán)（IP）供應(yīng)商新思科技有限公司（Nasdaq:SNPS）今天宣布推出快速原型系統(tǒng)HAPS™-60系列，這是一種可降低復(fù)雜SoC設(shè)計(jì)和驗(yàn)證挑戰(zhàn)的綜合解決方案。HAPS-60系列是Confirma™ Rapid Prototyping Platform快速原型平臺(tái)的一部分，是一種易于使用和具有高性價(jià)比的快
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基于CPLD的IEEE1149.1 USB下載電纜設(shè)計(jì)

  • 引言隨著片上系統(tǒng)(SoC，SystemonChip)時(shí)代的到來，包括復(fù)雜可編程邏輯器件(CPLD，ComplexProgrammab...
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Tensilica將于5月26日在滬舉辦首屆中國區(qū)技術(shù)研討會(huì)

  • 　　業(yè)界領(lǐng)先的可配置處理器IP供應(yīng)商Tensilica將于5月26日在上海舉辦其在中國地區(qū)的首次技術(shù)研討會(huì)。屆時(shí)Tensilica 公司創(chuàng)始人及CTO ，在美國硅谷享有聲譽(yù)的Chris Rowen博士,移動(dòng)多媒體方案市場(chǎng)總監(jiān)Larry Przywara將與大家探討Tensilica公司的ATLAS LTE架構(gòu)以及在SOC設(shè)計(jì)中增加音頻處理時(shí)需要考慮的最重要的事項(xiàng)。 　　Dr. Chris Rowen 　　Larry Przywara 　　高清視頻、高清音頻、LTE等一系列不斷涌現(xiàn)的新需求迫使
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fpga soc介紹

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