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fpga soc 文章 最新資訊

FPGA實(shí)現(xiàn)OFDM水聲通信系統(tǒng)定時(shí)同步

  • FPGA實(shí)現(xiàn)OFDM水聲通信系統(tǒng)定時(shí)同步,引 言　　正交頻分復(fù)用(Orthogonal Frequency Division Multiplexing，OFDM)技術(shù)是一種多載波調(diào)制技術(shù)，它將寬帶信道分解為相互正交的一組窄帶子信道，利用各個(gè)子信道進(jìn)行并行數(shù)據(jù)傳輸，因此其頻譜利用率高、抗多徑衰
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S2C為Xilinx原型驗(yàn)證系統(tǒng)提供突破性驗(yàn)證模塊技術(shù)

  • S2C 日前宣布其Verification Module技術(shù)（專利申請中）已可用于其基于Xilinx的FPGA原型驗(yàn)證系統(tǒng)中。V6 TAI Verification Module可以實(shí)現(xiàn)在FPGA原型驗(yàn)證環(huán)境和用戶驗(yàn)證環(huán)境之間高速海量數(shù)據(jù)傳輸。用戶可以使用Xilinx ChipScope或者第三方調(diào)試環(huán)境，同時(shí)查看4個(gè)FPGA。另外，V6 TAI Verification Module還可以用于1.3M～4.7M ASIC門的原型設(shè)計(jì)。V6 TAI Verification Module具有PCIe G
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惠瑞捷推出半導(dǎo)體行業(yè)首創(chuàng)可擴(kuò)展測試機(jī)臺系列 -V93000 Smart Scale平臺

  • Advantest 集團(tuán)（東京證券交易所：6857；紐約證券交易所：ATE）旗下企業(yè)惠瑞捷發(fā)布了業(yè)界首創(chuàng)可擴(kuò)展、高性價(jià)比的測試機(jī)臺系列，可用來測試28 納米及更小尺寸工藝和 3D 架構(gòu)的芯片。
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惠瑞捷V93000 SOC 測試平臺裝機(jī)數(shù)量達(dá)到2,500 臺

  • Advantest 集團(tuán)（東京證券交易所：6857；紐約證券交易所：ATE）旗下公司惠瑞捷 (Verigy)的 V93000 片上系統(tǒng) (SOC) 測試平臺安裝數(shù)量已達(dá) 2,500 臺，具有重大里程碑意義。此次具有里程碑意義的裝機(jī)為日月光半導(dǎo)體制造股份有限公司（簡稱 ASE，臺灣證券交易所：2311，紐約證券交易所：ASX）多系統(tǒng)訂單的一部分。日月光為世界最大的 IC 封裝和測試服務(wù)的獨(dú)立供應(yīng)商。
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一款用DSP+FPGA實(shí)現(xiàn)的數(shù)字相關(guān)器

  • 引　言數(shù)字相關(guān)器作為軟件無線電的典型應(yīng)用，在擴(kuò)頻通信中成為必不可少的技術(shù)。在傳統(tǒng)的擴(kuò)頻通信中，采用模擬器件(如：聲表面波器) 來實(shí)現(xiàn)解擴(kuò)單元，而用數(shù)字相關(guān)器可以增加系統(tǒng)的靈活性和穩(wěn)定性，因此，對數(shù)字相關(guān)器
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基于FPGA的混合信號驗(yàn)證流程

  • 基于FPGA的混合信號驗(yàn)證流程,隨著SoC設(shè)計(jì)上的混合信號組件數(shù)量增加了，基本的功能驗(yàn)證對于硅初期能否成功也愈來愈重要。FPGA在系統(tǒng)整合難題上加入了一個(gè)新特點(diǎn)。在核心上，此新范例-可編程系統(tǒng)單芯片(programmable system chip,PSC)整合FPGA電閘
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基于FPGA的檢糾錯(cuò)邏輯算法的實(shí)現(xiàn)

  • 基于FPGA的檢糾錯(cuò)邏輯算法的實(shí)現(xiàn),星載計(jì)算機(jī)系統(tǒng)中電子器件容易受到空間環(huán)境電磁場的輻射和重粒子的沖擊，從而導(dǎo)致器件運(yùn)行出錯(cuò)，特別是存儲器中數(shù)據(jù)容易出現(xiàn)錯(cuò)誤，需要具有檢糾錯(cuò)功能的電路模塊對其進(jìn)行糾正，以免造成嚴(yán)重的后果?；跐h明碼的糾錯(cuò)
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音頻編解碼芯片接口的FPGA應(yīng)用

  • 音頻編解碼芯片接口的FPGA應(yīng)用,介紹了音頻編解碼芯片WM8731基于FPGA的接口電路的設(shè)計(jì)，包括芯片配置模塊與音頻數(shù)據(jù)接口模塊等，使得控制器只通過寄存器就可以方便地對其進(jìn)行操作。整個(gè)設(shè)計(jì)以VHDL和Verilog HDL語言在Max+Plus Ⅱ里實(shí)現(xiàn)，并進(jìn)行了驗(yàn)
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Altera演示第一款基于模型的FPGA浮點(diǎn)DSP工具

  • 　　Altera公司日前演示了使用FPGA的浮點(diǎn)DSP新設(shè)計(jì)流程，這是業(yè)界第一款基于模型的浮點(diǎn)設(shè)計(jì)工具，支持在FPGA中實(shí)現(xiàn)復(fù)數(shù)浮點(diǎn)DSP算法。伯克萊設(shè)計(jì)技術(shù)公司 (Berkeley Design Technology, Inc, BDTI) 進(jìn)行的獨(dú)立分析驗(yàn)證了能夠在Altera 的Stratix 和Arria FPGA系列中簡單方便的高效實(shí)現(xiàn)高性能浮點(diǎn)DSP設(shè)計(jì)。 　　
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EtherWaves和Tensilica合作擴(kuò)展數(shù)字廣播解決方案

  • 　　EtherWaves和Tensilica日前宣布，通過植入Tensilica公司的Xtensa數(shù)據(jù)處理器，從而進(jìn)一步拓展ClearSignal的軟件DAB/DMB解決方案，EtherWaves公司，是業(yè)界公認(rèn)的車載和SOC(片上系統(tǒng))數(shù)字廣播IP核的領(lǐng)導(dǎo)者，Tensilica是業(yè)界領(lǐng)先的且經(jīng)驗(yàn)證的可配置處理器IP供應(yīng)商。這項(xiàng)舉措非常符合EtherWaves公司一貫的支持領(lǐng)先芯片架構(gòu)的戰(zhàn)略方針，同時(shí)也拓展了ClearSignal軟件設(shè)計(jì)的實(shí)用性。
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應(yīng)用于除顫器的FPGA解決方案

  • 越來越多的人們認(rèn)識到當(dāng)心臟病患者的心臟驟停時(shí)，快速及時(shí)的救治能夠帶來很大的好處。這促使更多公共場所和辦...
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一種基于Spartan3E的DDS優(yōu)化設(shè)計(jì)

基于ARM和FPGA架構(gòu)的三維圖形加速系統(tǒng)

  • 引言隨著圖形處理的巨額運(yùn)算量，CPU變得不堪重負(fù)。此時(shí)，需要使用特定的硬件設(shè)備來為嵌入式CPU承擔(dān)圖形處...
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為參加2011 Digilent Design Contest的中國代表團(tuán)壯行

  • ??????? 2011年9月12日，中秋月圓之夜，參加 2011 DDC? 德國總決賽的中國代表團(tuán)整裝待發(fā)，即將登機(jī)遠(yuǎn)赴德國慕尼黑參加DDC總決賽，與來自世界各地的16支隊(duì)伍進(jìn)行角逐。讓我們?yōu)樗麄儔研校☆A(yù)祝他們?nèi)〉煤贸煽儯? ??????
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EtherWaves公司拓展數(shù)字廣播解決方案

  • EtherWaves和Tensilica今日宣布，通過植入Tensilica公司的Xtensa 數(shù)據(jù)處理器，從而進(jìn)一步拓展ClearSignal的軟件DAB/DMB解決方案，EtherWaves公司，是業(yè)界公認(rèn)的車載和SOC（片上系統(tǒng)）數(shù)字廣播IP核的領(lǐng)導(dǎo)者，Tensilica是業(yè)界領(lǐng)先的且經(jīng)驗(yàn)證的可配置處理器IP供應(yīng)商。這項(xiàng)舉措非常符合EtherWaves公司一貫的支持領(lǐng)先芯片架構(gòu)的戰(zhàn)略方針，同時(shí)也拓展了ClearSignal軟件設(shè)計(jì)的實(shí)用性。
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