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將ASIC IP核移植到FPGA上——更新概念并推動改變以完成充滿挑戰(zhàn)的任務!

  • 本系列文章從數(shù)字芯片設計項目技術總監(jiān)的角度出發(fā)，介紹了如何將芯片的產品定義與設計和驗證規(guī)劃進行結合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設計時需要考慮到的IP核相關因素，用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發(fā)原型驗證系統(tǒng)設計時需要考量的因素。在上篇文章中，我們介紹了將ASIC IP移植到FPGA原型平臺上的必要性，并對原型設計中各種考量因素進行了總體概述，分析開發(fā)A
  • 關鍵字： ASIC IP  FPGA  SmartDV  

國產FPGA，走到哪一步了？

  • 隨著人工智能（AI）技術的飛速發(fā)展，其應用邊界不斷拓寬，從簡單的圖像識別到復雜的自然語言處理，再到自動駕駛、智能制造等前沿領域，AI 正以前所未有的速度改變著我們的世界。在這場 AI 革命中，深度學習作為其核心驅動力，不斷推動著算法與模型的革新，同時也對計算資源提出了更為嚴苛的要求。誕生于 1985 年的 FPGA 雖然問世時間不長，但已經憑借「可編程」的獨特優(yōu)勢，在百花齊放的芯片浪潮中奪得一席之地，成為 GPU 芯片的又一勁敵。FPGA 的特點FPGA 芯片是基于可編程器件（PAL、GAL、CPLD）發(fā)
  • 關鍵字： FPGA  

將ASIC IP核移植到FPGA上——明了需求和詳細規(guī)劃以完成充滿挑戰(zhàn)的任務

  • 本文從數(shù)字芯片設計項目技術總監(jiān)的角度出發(fā)，介紹了如何將芯片的產品定義與設計和驗證規(guī)劃進行結合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設計時需要考慮到的IP核相關因素，用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發(fā)原型驗證系統(tǒng)設計時需要考量的因素。本篇文章是SmartDV數(shù)字芯片設計經驗分享系列文章的第一篇，作為全球領先的驗證解決方案和設計IP提供商，SmartDV的產品研發(fā)及
  • 關鍵字： FPGA  SmartDV  

萊迪思全新推出邏輯優(yōu)化的通用FPGA拓展其小型FPGA產品組合

  • 萊迪思半導體，低功耗可編程器件的領先供應商，今日宣布為其領先的小尺寸FPGA產品中再添一款邏輯優(yōu)化的全新萊迪思Certus-NX? FPGA器件。新產品包括兩款新器件，即Certus-NX-28?和Certus-NX-09?，擁有多種封裝選項，可提供行業(yè)領先的低功耗、小尺寸和可靠性以及靈活的遷移選項。這些器件旨在加速廣泛的通信、計算、工業(yè)和汽車應用。萊迪思半導體產品營銷副總裁Dan Mansur表示：“萊迪思致力于在小型、低功耗FPGA領域持續(xù)創(chuàng)新，為我們的客戶提供優(yōu)化的解決方案，滿足空間受限的應用需求，
  • 關鍵字： 萊迪思  FPGA  小型FPGA  

利用強大的軟件設計工具為FPGA開發(fā)者賦能

  • 許多嵌入式系統(tǒng)的開發(fā)者都對使用基于FPGA的SoC系統(tǒng)感興趣，但是基于傳統(tǒng)HDL硬件描述語言的FPGA開發(fā)工具和復雜流程往往會令他們望而卻步。為了解決這一問題，萊迪思的Propel工具套件提供了基于圖形化設計方法的設計環(huán)境，用于創(chuàng)建，分析，編譯和調試基于FPGA的嵌入式系統(tǒng)，從而完成系統(tǒng)軟硬件設計。萊迪思的Propel工具套件由兩部分組成：Propel Builder提供圖形化的SoC系統(tǒng)和硬件設計，通過拖放方式，選擇處理器和相關的外設與IP，通過圖形化的方式進行配置和連接，從而完成系統(tǒng)層面的硬件設計；
  • 關鍵字： 軟件設計工具  FPGA  萊迪思  

燦芯半導體發(fā)布通用高性能小數(shù)分頻鎖相環(huán)IP及相關解決方案

  • 一站式定制芯片及IP供應商——燦芯半導體（上海）股份有限公司近日宣布成功研發(fā)出一款通用高性能小數(shù)分頻鎖相環(huán)（fractional-N PLL） IP，支持24bits高精度小數(shù)分頻，最高輸出頻率4.5Ghz，另外還支持擴頻時鐘（SSC）功能，可以為客戶提供多功能的小數(shù)分頻 PLL解決方案。PLL電路一般用于產生輸出頻率，輸出頻率值與PLL的參考輸入頻率呈倍數(shù)關系。小數(shù)分頻PLL通過頻率乘法比例的小數(shù)值，實現(xiàn)更精確的輸出頻率控制，從而提供更高精度和準確度的輸出頻率。SSC發(fā)生器是在一定頻率范圍內調制時鐘信號
  • 關鍵字： 燦芯半導體  小數(shù)分頻  鎖相環(huán)  IP  

萊迪思推出全新安全控制FPGA系列產品，具備先進的加密敏捷性和硬件可信根

  • 萊迪思半導體，低功耗可編程器件的領先供應商，近日宣布推出兩款全新解決方案，進一步鞏固其在安全硬件和軟件領域的領先地位，幫助客戶應對系統(tǒng)安全領域日益嚴峻的挑戰(zhàn)。全新發(fā)布的萊迪思MachXO5D-NX?系列高級安全控制FPGA提供加密敏捷算法、集成閃存的硬件可信根功能以及故障安全（fail-safe）遠程現(xiàn)場更新功能，實現(xiàn)可靠和安全的產品生命周期管理。此外，萊迪思還推出了最新版本的Lattice Sentry?解決方案集合，其新功能為客戶提供可定制的、基于FPGA的平臺固件保護恢復（PFR）解決方案，且支持最
  • 關鍵字： 萊迪思  安全控制  FPGA  加密敏捷性  硬件可信根  

IC設計倚重IP、ASIC趨勢成形

  • 半導體制程進入2奈米，擷發(fā)科技董事長楊健盟指出，IC設計難度陡增，未來硅智財、ASIC角色將更加吃重，協(xié)助IC設計以SoC方式因應AI新世代。楊健盟分析，過往IDM分拆晶圓代工之典范，將在IC設計上發(fā)生，AI時代IC設計大者恒大趨勢成形。 擷發(fā)科技已獲國際芯片大廠AI芯片外包訂單，楊健盟認為，現(xiàn)在芯片晶體管動輒百億個，考驗IC設計業(yè)者研發(fā)量能。大量采用基礎、接口IP使研發(fā)能力更能專注前段設計，海外大廠甚至將后段交由ASIC業(yè)者，未來倚重IP、ASIC趨勢只會更加明顯。中國臺灣半導體產業(yè)鏈在邏輯先進制程、先
  • 關鍵字： IC設計  IP  ASIC  

半導體知識產權市場規(guī)模將增長27.1億美元

  • 根據(jù)Technavio的報告，全球半導體知識產權（IP）市場規(guī)模預計將在2024年至2028年間增長27.1億美元。預計在預測期內，市場的復合年增長率（CAGR）將超過7.47%。復雜芯片設計和多核技術的使用推動了市場的增長，同時納米光子集成電路（ICs）的出現(xiàn)也是一大趨勢。然而，半導體IP的重復使用構成了一項挑戰(zhàn)。主要市場參與者包括Achronix Semiconductor Corp.、Advanced Micro Devices Inc.、Alphawave IP Group plc、Arm Ltd
  • 關鍵字： 半導體知識產權  IP  

采用創(chuàng)新的FPGA 器件來實現(xiàn)更經濟且更高能效的大模型推理解決方案

  • 摘要本文根據(jù)完整的基準測試，將Achronix Semiconductor公司推出的Speedster7t FPGA與GPU解決方案進行比較，在運行同一個Llama2 70B參數(shù)模型時，該項基于FPGA的解決方案實現(xiàn)了超越性的LLM推理處理。采用 FPGA 器件來加速LLM 性能，在運行 Llama2 70B 參數(shù)模型時，Speedster7t FPGA 如何與 GPU 解決方案相媲美？證據(jù)是令人信服的——Achronix Speedster7t FPGA通過提供計算能力、內存帶寬和卓越能效的最佳組合，在
  • 關鍵字： Achronix  FPGA  

FPGA比單片機厲害嗎？

  • 01 前言做單片機開發(fā)的工程師，一般都會接觸FPGA。有讀者大概問了這樣的問題：FPGA能做什么？比單片機厲害嗎？這么說吧，F(xiàn)PGA在某方面也能實現(xiàn)單片機做的事，在某些領域，F(xiàn)PGA遠比單片機強的多。當然，F(xiàn)PGA和單片機各有各的特點，在應用上也有一些區(qū)別，本文主要說下FPGA厲害的地方。02 關于FPGAFPGA（現(xiàn)場可編程門陣列）是一種可編程的硬件設備，通過編程可以定義其內部邏輯電路的結構和功能，具有高度的靈活性和可定制性。下面說說FPGA常見的幾大應用的領域：通信系統(tǒng)FPGA在通信領域的應用可以說是
  • 關鍵字： FPGA  單片機  

iCE40 LP/HX系列FPGA：萊迪思的創(chuàng)新可編程解決方案

  • FPGA是一種集成電路芯片，它屬于專用集成電路（ASIC）領域中的半定制電路。FPGA芯片廣泛應用于通信、軍事、汽車、工業(yè)控制等領域。FPGA具有高度的靈活性和可編程性，其內部由大量的可編程邏輯塊（Configurable Logic Block，CLB）組成，這些邏輯塊可以通過編程連接成任意的邏輯電路，從而在不重新設計電路的情況下，通過編程來改變其功能。FPGA的這種特性大大加快了開發(fā)速度并降低了開發(fā)成本。隨著物聯(lián)網(wǎng)、人工智能和5G等技術的快速發(fā)展，F(xiàn)PGA芯片的市場需求將進一步增加。根據(jù)最新的研究報告
  • 關鍵字： iCE40 LP/HX  FPGA  萊迪思  可編程解決方案  

國產28納米FPGA流片

  • 珠海鏨芯半導體有限公司（以下簡稱“珠海鏨芯”）近日成功實現(xiàn)28納米流片。鏨芯CERES-1FPGA芯片對標28納米FPGA國際主流架構，實現(xiàn)管腳兼容，比特流兼容。配合鏨芯KUIPER-1開發(fā)板，用戶可以無縫銜接國際主流開發(fā)平臺和生態(tài)，實現(xiàn)芯片和開發(fā)板國產化替代。據(jù)珠海鏨芯介紹，CERES-1 FPGA包含60萬個邏輯門，3750個6輸入邏輯查找表，100個用戶IO，180KB片上存儲，10片DSP單元。MPW流片成功驗證珠海鏨芯28納米FPGA技術成熟度和可靠性。公司下一個里程碑事件是28納米FPGA芯片
  • 關鍵字： FPGA  EDA  芯片  

Arm發(fā)布基于3nm芯片工藝的新CPU、GPU IP

  • 芯片設計公司Arm今日發(fā)布了針對旗艦智能手機的新一代CPU和GPU IP（設計方案）：Cortex-X925 CPU、Immortalis G925 GPU。新產品均使用了其最新的Armv9架構，基于臺積電3nm制程工藝方案，針對終端設備在AI應用上的性能進行設計優(yōu)化。此外還將提供軟件工具，讓開發(fā)人員更容易在采用Arm架構的芯片上運行生成式AI聊天機器人和其他AI代碼。預計搭載最新內核設計的手機將于2024年底上市。據(jù)官方介紹，新的CPU與GPU IP是目前旗下同類產品中性能最強的一代，新CPU性能提升3
  • 關鍵字： arm  CPU  GPU  IP  3nm  

西門子推出 Solido IP 驗證套件，為下一代 IC 設計提供端到端的芯片質量保證

  • ●? ?西門子集成的驗證套件能夠在整個IC設計周期內提供無縫的IP質量保證，為IP開發(fā)團隊提供完整的工作流程西門子數(shù)字化工業(yè)軟件日前推出 Solido? IP 驗證套件 (Solido IP Validation Suite)，這是一套完整的自動化簽核解決方案，可為包括標準單元、存儲器和 IP 模塊在內的設計知識產權 (IP) 提供質量保證。這一全新的解決方案提供完整的質量保證 (QA) 覆蓋范圍，涵蓋所有 IP 設計視圖和格式，還可提供 “版本到版本” 的 IP 認證，能夠提升完整芯
  • 關鍵字： 西門子  Solido IP  IC設計  IC 設計  
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