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fpga ip 文章 最新資訊

面向未來基站IP化的無線回傳方案

  • 核心網(wǎng)CN的IP化，PS域直接定

  • 關(guān)鍵字： 基站  IP  

基于DSP+FPGA+ASIC的實時圖像處理系統(tǒng)

  • 隨著紅外焦平面陣列技術(shù)的快速發(fā)展，紅外成像系統(tǒng)實現(xiàn)了高幀頻、高分辨率、高可靠性及微型化，在目標跟蹤、智能交通監(jiān)控中得到了越來越多的應(yīng)用，并向更加廣泛的軍事及民用領(lǐng)域擴展。
  • 關(guān)鍵字： DSP  FPGA  ASIC  

基于IEEE1451標準的IP傳感器的設(shè)計與實現(xiàn)

  • 摘要:本文基于簡化的IEEE1451智能傳感器信息模型,提出了基于嵌入式Internet技術(shù)的IP傳感器模型,并進行了原型實現(xiàn)。分析了IP傳感器的網(wǎng)絡(luò)時延問題,并在網(wǎng)絡(luò)環(huán)境下對其時延性能進行了測試。實驗結(jié)果表明,所設(shè)計的IP傳感
  • 關(guān)鍵字： 設(shè)計  實現(xiàn)  傳感器  IP  IEEE1451  標準  基于  

基于FPGA的SoftSerdes設(shè)計與實現(xiàn)

  • 引言 在高速源同步應(yīng)用中，時鐘數(shù)據(jù)恢復(fù)是基本的方法。最普遍的時鐘恢復(fù)方法是利用數(shù)字時鐘模塊(DCM、)產(chǎn)生的多相位時鐘對輸入的數(shù)據(jù)進行過采樣。但是由于DCM的固有抖動，在頻率很高時，利用DCM作為一種數(shù)據(jù)恢復(fù)的
  • 關(guān)鍵字： SoftSerdes  FPGA    

基于高端FPGA的IC驗證平臺的PI分析

  • 1 引言
    大多數(shù)非FPGA類型的、高密度IC(如CPU)對去耦電容都有非常明確的要求。由于這些器件僅為執(zhí)行特定的任務(wù)而設(shè)計，所以其電源電流需求是固定的，僅在一定范圍內(nèi)有所波動。 然而，F(xiàn)PGA不具備這種
  • 關(guān)鍵字： FPGA  分析    

借助物理綜合提高FPGA設(shè)計效能

  • 借助物理綜合提高FPGA設(shè)計效能,隨著FPGA密度的增加，系統(tǒng)設(shè)計人員能夠開發(fā)規(guī)模更大、更復(fù)雜的設(shè)計，從而將密度優(yōu)勢發(fā)揮到最大。這些大規(guī)模設(shè)計基于這樣的設(shè)計需求――需要在無線通道卡或者線路卡等現(xiàn)有應(yīng)用中加入新功能，或者通過把兩種芯片功能合
  • 關(guān)鍵字： 設(shè)計  效能  FPGA  提高  物理  綜合  借助  

遠程視頻監(jiān)控解決方案中動態(tài)IP技術(shù)的應(yīng)用

  • 隨著網(wǎng)絡(luò)的發(fā)展，基于IP技術(shù)的各種視頻通訊應(yīng)用也應(yīng)運而生(如網(wǎng)絡(luò)遠程視頻監(jiān)控)。其不但具傳統(tǒng)模擬視頻監(jiān)控的...
  • 關(guān)鍵字： 網(wǎng)絡(luò)  遠程視頻監(jiān)控  動態(tài)  IP  

雷達視頻積累算法在FPGA上的實現(xiàn)


  • 1 引 言由于雷達所處的環(huán)境的復(fù)雜性，除了地物、云雨、鳥群等干擾外，還可能來自臨近的雷達異步干擾、電臺干擾等。所有的干擾，經(jīng)過接收機進入信號處理機，雖然經(jīng)過了中頻信號的處理，但還可能有殘余。因
  • 關(guān)鍵字： FPGA  雷達視頻  積累  算法    

FPGA在智能壓力傳感器系統(tǒng)中的應(yīng)用設(shè)計

  • 0引言傳統(tǒng)氣體壓力測量儀器的傳感器部分與數(shù)據(jù)采集系統(tǒng)是分離的，抗干擾的能力較差，并且通常被測對...
  • 關(guān)鍵字： FPGA  智能壓力傳感器系統(tǒng)  

基于FPGA的智能溫度采集控制器

  • 摘要：溫度的監(jiān)測與控制，對于工業(yè)生產(chǎn)的發(fā)展有著非常重要的意義。分析并設(shè)計了基于數(shù)字化一線總線技術(shù)的智能溫度測控系統(tǒng)。本系統(tǒng)采用FPGA實現(xiàn)一個溫度采集控制器，用于傳感器和上位機的連接，并采用微軟公司的Visu
  • 關(guān)鍵字： 一線總線  異步通訊  FPGA  MSCOMM  

采用FPGA和DSP直接控制硬盤實現(xiàn)存儲控制的方法

  • 摘 要 介紹了采用FPGA和DSP直接控制硬盤進行數(shù)據(jù)存儲的方法，并采用一片F(xiàn)IFO作為數(shù)據(jù)緩存，能夠滿足80Khz數(shù)據(jù)采樣率系統(tǒng)的存盤要求。 關(guān)鍵詞 FPGA；DSP；硬盤；數(shù)據(jù)存儲 1　引言 數(shù)據(jù)存儲是數(shù)據(jù)采集過程中
  • 關(guān)鍵字： FPGA  DSP  直接控制  硬盤    

利用基于SystemC/TLM的方法學進行IP開發(fā)和FPGA建模

  • 隨著系統(tǒng)級芯片技術(shù)的出現(xiàn)，設(shè)計規(guī)模正變得越來越大，因而變得非常復(fù)雜，同時上市時間也變得更加苛刻。通常RTL已經(jīng)不足以擔當這一新的角色。上述這些因素正驅(qū)使設(shè)計師開發(fā)新的方法學，用于復(fù)雜IP(硬件和軟件)以及復(fù)雜
  • 關(guān)鍵字： SystemC  FPGA  TLM  IP開發(fā)    

基于FPGA的可層疊組合式SoC原型系統(tǒng)設(shè)計

  • 為解決單片F(xiàn)PGA無法滿足復(fù)雜SoC原型驗證所需邏輯資源的問題，設(shè)計了一種可層疊組合式超大規(guī)模SoC驗證系統(tǒng)。該系統(tǒng)采用了模塊化設(shè)計，通過互補連接器和JTAG控制電路，支持最多5個原型模塊的層疊組合,最多可提供2 500萬門邏輯資源。經(jīng)本系統(tǒng)驗證的地面數(shù)字電視多媒體廣播基帶調(diào)制芯片(BHDTMBT1006)已成功流片。
  • 關(guān)鍵字： FPGA  SoC  層疊  組合式    

對FPGA中SPI復(fù)用配置的編程方法的研究

  • SPI(SerialPeripheralInteRFace，串行外圍設(shè)備接口)是一種高速、全雙工、同步的通信總線，在芯片的引腳上...
  • 關(guān)鍵字： FPGA  SPI  復(fù)用配置  存儲器  

晨星半導(dǎo)體獲MIPS處理器IP授權(quán)

  • 　　為數(shù)字消費、家庭網(wǎng)絡(luò)、無線、通信和商業(yè)應(yīng)用提供業(yè)界標準處理器架構(gòu)與內(nèi)核的領(lǐng)導(dǎo)廠商美普思科技公司(MIPS Technologies, Inc., 納斯達克代碼：MIPS)宣布，全球領(lǐng)先的數(shù)字電視IC供應(yīng)商晨星半導(dǎo)體(MStar Semiconductor)獲得其多線程MIPS32TM 34Kf™ Pro可合成處理器內(nèi)核授權(quán)，用來開發(fā)新一代設(shè)備。34Kf內(nèi)核包括一個浮點單元，可為圖形密集型功能提供增強的性能，對連網(wǎng)數(shù)字電視及Java、JavaScript、Adobe® Flash&r
  • 關(guān)鍵字： MIPS  處理器  IP  
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