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fir ip 文章 最新資訊

基于MATLAB的數(shù)字基帶傳輸?shù)?FIR濾波器的設(shè)計

  • O 引言
    目前，數(shù)字基帶傳輸已廣泛地應(yīng)用于利用對稱電纜構(gòu)成的近程數(shù)據(jù)通信系統(tǒng)之中。隨著數(shù)字通信技術(shù)的發(fā)展，基帶傳輸方式不僅可以用于低速數(shù)據(jù)傳輸，而且也可以用于高速數(shù)據(jù)傳輸。然而數(shù)字基帶傳輸也同樣不可
  • 關(guān)鍵字： MATLAB  FIR  數(shù)字基帶  傳輸    

基于MATLAB與QUARTUS II的 FIR濾波器設(shè)計與驗證

  • 1 引言
    FIR數(shù)字濾波器能夠滿足濾波器對幅度和相位特性的嚴(yán)格要求，避免模擬濾波器的溫漂和噪聲等問題，具有精確的線性相位、易于硬件實現(xiàn)和系統(tǒng)穩(wěn)定等優(yōu)點，可廣泛應(yīng)用于現(xiàn)代電子通信系統(tǒng)。實際信號處理應(yīng)用往往
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Gartner：今年半導(dǎo)體創(chuàng)業(yè)公司籌資逾7.5億美元

  • 　　據(jù)國外媒體報道，美國市場研究公司Gartner表示，全球半導(dǎo)體創(chuàng)業(yè)公司今年以來總計籌集了超過7.5億美元資金，但其中約四分之一的投資來自于大型半導(dǎo)體公司旗下風(fēng)投部門等戰(zhàn)略投資者。 　　Gartner指出，在過去的這一年，風(fēng)投公司主要青睞投資后期創(chuàng)業(yè)公司，與去年相比，今年獲得投資的創(chuàng)業(yè)公司數(shù)量明顯下降。每家公司獲得的投資金額最高為4000萬美元，平均為1430萬美元。 　　Gartner表示，在獲得投資的創(chuàng)業(yè)公司中，70%為無晶圓廠芯片公司，14%為EDA(電子設(shè)計自動化)公司，7%為IP公司，5%
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基于DSP/BIOS的FIR數(shù)字濾波器設(shè)計與實現(xiàn)

  • 用可編程DSP器件實現(xiàn)數(shù)字濾波，通過修改濾波器參數(shù)可方便地改變?yōu)V波器的特性。以TMS320F2812數(shù)字信號處理器為核心，將濾波器算法作為DSP／BIOS的任務(wù)來實現(xiàn)，可方便地實現(xiàn)多任務(wù)系統(tǒng)。詳細(xì)介紹一種基于DSP／B10S的軟件開發(fā)過程，并在DSK2812平臺上實現(xiàn)數(shù)字濾波器的開發(fā)實例，對需進(jìn)行數(shù)字信號處理的多任務(wù)軟件開發(fā)具有一定的參考價值。
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基于SoC的音頻IP模塊設(shè)計

  • 隨著集成電路設(shè)計技術(shù)和深亞微米制造技術(shù)的發(fā)展，集成電路已進(jìn)入了片上系統(tǒng)時代。由于SoC結(jié)構(gòu)極其復(fù)雜，對于設(shè)計者而言，數(shù)百萬門規(guī)模的系統(tǒng)級芯片設(shè)計不可能一切從頭開始，隨著集成電路設(shè)計技術(shù)的發(fā)展，IP核的
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基于DSP Builder的16階FIR濾波器實現(xiàn)

  • 現(xiàn)場可編程門陣列(FPGA)器件廣泛用于數(shù)字信號處理領(lǐng)域．而使用VHDL或VerilogHDL語言進(jìn)行設(shè)計的難度較大。提出一種采用DSP Builder實現(xiàn)FIR濾波器的設(shè)計方案，按照Matlab／Simulink／DSP Builder／Modelsim／QuartusⅡ的設(shè)計流程，設(shè)計一個16階的FIR低通濾波器，并完成了軟硬件的仿真與驗證。結(jié)果表明，該方法簡單易行，可滿足設(shè)計要求，它驗證了采用DSP Builder實現(xiàn)濾波器設(shè)計的獨特優(yōu)勢。
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基于NCO IP core的Chirp函數(shù)實現(xiàn)設(shè)計

  • 首先分析Chirp函數(shù)在頻域上的一般特性，并且分析Altrea公司提供的數(shù)控振蕩器知識產(chǎn)權(quán)核(NCO IP core)的輸入／輸出特性，通過MegaCore環(huán)境確定其輸入控制字，通過外圍邏輯電路實時向NCO IP core調(diào)入控制頻率控制字以達(dá)到改變輸出頻率的目的，并通過在示波器上觀測FPGA的運行情況，驗證了該設(shè)計具有很好的輸出效果。
  • 關(guān)鍵字： Chirp  core  NCO  IP    

首款串行 RapidIO 2.1 IP 解決方案(Altera)

  • Altera 公司 宣布推出業(yè)界首款支持 RapidIO® 2.1 規(guī)范的知識產(chǎn)權(quán) (IP) 內(nèi)核。Altera 的串行 RapidIO IP 內(nèi)核可支持多達(dá)四條通道，每條通道速率為 5.0 GBaud，從而滿足了無線市場日益增長的帶寬和可靠性需求。該
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FIR帶通濾波器的FPGA實現(xiàn)

  • 為設(shè)計一個項目可用的FIR數(shù)字帶通濾波器，采用Matlab／Simulink軟件中DSPBulider強大的算法模塊設(shè)計工具，結(jié)合Altera公司的FPGA開發(fā)板實現(xiàn)FIR數(shù)字帶通濾波器的系統(tǒng)集成、RTL級仿真、綜合編譯、下載等設(shè)計流程，并對正弦信號進(jìn)行濾波，結(jié)果下載到開發(fā)板上用示波器觀測，達(dá)到了預(yù)期的濾波效果和目的?；贒SPBuilder完成系統(tǒng)建模，省去了復(fù)雜的VHDL編程，還可針對具體模塊進(jìn)行參數(shù)設(shè)置從而適應(yīng)不同的濾波需求。該方法實現(xiàn)簡單、可靠，還可類推實現(xiàn)其他復(fù)雜的嵌入式系統(tǒng)設(shè)計。
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Avago宣布向Juniper Networks提供關(guān)鍵知識產(chǎn)權(quán)IP

  • 　　Avago Technologies(安華高科技)今日宣布，公司提供的關(guān)鍵知識產(chǎn)權(quán)(IP, Intellectual Property)已經(jīng)幫助Juniper Networks公司成功進(jìn)行高性能硅芯片器件產(chǎn)品的開發(fā)，這些新設(shè)計為帶來Juniper公司MX-3D平臺Junos® Trio芯片組的一部分。Avago為提供通信、工業(yè)和消費性等應(yīng)用模擬接口元器件之全球領(lǐng)導(dǎo)廠商。 　　每個器件都擁有接近100個SerDes串行/解串器通道，并且可以推動松散背板通道和多重背板連接器，除了展現(xiàn)出同級產(chǎn)品最
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嵌入式TCP/IP技術(shù)在恒溫振蕩器中的應(yīng)用

  • 嵌入式TCP/IP技術(shù)在恒溫振蕩器中的應(yīng)用,介紹了一種基于嵌入式TCP/IP技術(shù)的恒溫振蕩器的數(shù)據(jù)傳輸系統(tǒng)，使TCP/IP技術(shù)應(yīng)用于恒溫振蕩器的設(shè)計，實現(xiàn)遠(yuǎn)程監(jiān)控的功能。給出了恒溫振蕩器溫度和速度控制等關(guān)鍵技術(shù)的實現(xiàn)方法。
  • 關(guān)鍵字： 振蕩器  應(yīng)用  恒溫  技術(shù)  TCP/IP  嵌入式  轉(zhuǎn)換器  

賽靈思與ARM公司共同宣布合作開發(fā)計劃

  • 　　全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司與ARM公司宣布正式開展合作，在賽靈思FPGA中應(yīng)用ARM處理器與互聯(lián)技術(shù)。賽靈思公司目前已經(jīng)開始采用ARM Cortex處理器IP，利用性能優(yōu)化的ARM數(shù)字單元庫(cell library)和嵌入式存儲器，為未來的可編程平臺提供支持。此外，兩家公司還共同對下一代ARM® AMBA®互聯(lián)技術(shù)進(jìn)行定義，以增強并優(yōu)化FPGA架構(gòu)。 　　兩大公司的合作， 意味著賽靈思致力于采用全線ARM技術(shù)，并充分利用ARM處理器的巨大優(yōu)勢為客戶和生態(tài)系統(tǒng)開發(fā)人員提
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GSM 協(xié)會推出國際號碼可攜帶登記服務(wù)

  • 　　GSM 協(xié)會 (GSMA) 今天宣布推出 PathFinder Number Portability Discovery 服務(wù)。這是一種由 GSM 協(xié)會管理，由 Neustar, Inc. 經(jīng)營的服務(wù)。這項新服務(wù)旨在成為全球號碼可攜帶性的最先進(jìn)解決方案，它面向的是全球22億個受到號碼可攜帶性影響的電話號碼，而這一數(shù)字預(yù)計還將快速上升。號碼可攜帶 (Number Portability) 目前已在全球超過52個國家實現(xiàn)，而且預(yù)計2010年年底之前還會在中國和印度等更多國家推行。這項服務(wù)還將集合全球幾乎所
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基于PSO的FIR數(shù)字濾波器設(shè)計

  • 有限沖激響應(yīng)(FIR)數(shù)字濾波器的設(shè)計實質(zhì)是一個多參數(shù)優(yōu)化的問題，而傳統(tǒng)的一些優(yōu)化設(shè)計方法，如遺傳算法、神經(jīng)網(wǎng)絡(luò)法等，存在算法復(fù)雜，收斂速度慢，效果不明顯等缺點。提出一種改進(jìn)粒子群優(yōu)化算法(IMPSO)的FIR數(shù)字濾波器設(shè)計。該方法首先根據(jù)粒子聚合度情況引入變異思想，克服PSO算法容易早熟的毛病，對算法進(jìn)行改進(jìn)，然后利用改進(jìn)的IMPSO搜索濾波器參數(shù)的最優(yōu)解，對FIR濾波器進(jìn)行優(yōu)化設(shè)計。實例設(shè)計FIR數(shù)字低通、帶通濾波器，仿真結(jié)果表明，該方法具有算法簡單，收斂速度快，魯棒性好等優(yōu)點。
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基于Actel FPGA的PWM IP的應(yīng)用

  • 　　脈沖寬度調(diào)制(PWM)是英文“Pluse Width Modulation”的縮寫，簡稱脈寬調(diào)制。它是利用微處理器的數(shù)字輸出來對模擬電路進(jìn)行控制的一種非常有效的技術(shù)，根據(jù)相應(yīng)的載荷的變化來調(diào)制晶體管柵極或基極的偏置，來實現(xiàn)開關(guān)穩(wěn)壓電源輸出晶體管或晶體管導(dǎo)通時間的改變。這種方式能使電源的輸出電壓在工作條件變化時保持恒定，廣泛應(yīng)用于測量、通信、功率控制與變化等許多領(lǐng)域。 　　Actel公司免費提供PWM IP核：CorePWM。CorePWM是基于APB總線形式的，它的優(yōu)點是可以
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