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讓Verilog仿真狀態(tài)機(jī)時(shí)可以顯示狀態(tài)名

基于Nios的DDS高精度信號源實(shí)現(xiàn)

FPGA系統(tǒng)設(shè)計(jì)實(shí)戰(zhàn)經(jīng)驗(yàn)分享FPGA系統(tǒng)設(shè)計(jì)實(shí)戰(zhàn)經(jīng)驗(yàn)分享

FPGA基礎(chǔ)入門

面向超低功耗設(shè)計(jì)的微控制器功效優(yōu)化方案

基于FPGA的嵌入式以太網(wǎng)與Matlab通信系統(tǒng)設(shè)計(jì)

  • 0引言近年來，隨著信息技術(shù)的發(fā)展，網(wǎng)絡(luò)化日加普遍，以太網(wǎng)被廣泛應(yīng)用到各個(gè)領(lǐng)域。例如在數(shù)據(jù)采集領(lǐng)域，一些小型...
  • 關(guān)鍵字： FPGA  IP  嵌入式  PLD  CPLD  SoC  數(shù)字信號處理  消費(fèi)電子  FPGA  

基于PCI接口芯片外擴(kuò)FIFO的FPGA實(shí)現(xiàn)

基于FPGA的MIII總線與RS422通信協(xié)議轉(zhuǎn)換板的設(shè)計(jì)

FPGA設(shè)計(jì)工具淺談

  • 作為一個(gè)負(fù)責(zé)FPGA企業(yè)市場營銷團(tuán)隊(duì)工作的人，我不得不說，由于在工藝技術(shù)方面的顯著成就以及硅芯片設(shè)計(jì)領(lǐng)域的獨(dú)...
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FPGA硬件電路的調(diào)試

一種實(shí)用光端機(jī)的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：提出了一種簡易的實(shí)用光端機(jī)的設(shè)計(jì)方法，能夠完成TTL／E1、RS232、RS422 3類信號經(jīng)光纖傳送，很好地實(shí)現(xiàn)了中短距離的點(diǎn)對點(diǎn)通信。TTL／E1信號直接送給通道選擇。RS232和RS422分別經(jīng)過相應(yīng)的信號調(diào)理變?yōu)門IL電
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萊迪思推出新的MachXO2 PLD系列

  • 　　萊迪思半導(dǎo)體公司今天宣布推出其新的MachXO2? PLD系列，為低密度PLD的設(shè)計(jì)人員提供了在單個(gè)器件中前所未有的低成本，低功耗和高系統(tǒng)集成。嵌入式閃存技術(shù)采用了低功耗65納米工藝，與MachXO? PLD系列相比，MachXO2系列提供了3倍的邏輯密度、10倍的嵌入式存儲器、降低了100倍以上的靜態(tài)功耗并減少了高達(dá)30%的成本。
  • 關(guān)鍵字： 萊迪思  PLD  

PLD設(shè)計(jì)方法及步驟

  • 1、PLD器件的設(shè)計(jì)步驟 　　1.電路邏輯功能描述　　PLD器件的邏輯功能描述一般分為原理圖描述和硬件描述語言描述，原理圖描述是一種直觀簡便的方法，它可以將現(xiàn)有的小規(guī)模集成電路實(shí)現(xiàn)的功能直接用PLD器件來實(shí)現(xiàn)，而不
  • 關(guān)鍵字： PLD  設(shè)計(jì)方法    

基于MachXO設(shè)計(jì)的PLD控制開發(fā)技術(shù)

  • 基于MachXO設(shè)計(jì)的PLD控制開發(fā)技術(shù),MachXO PLD是非易失的可以無限次重新配置的可編邏輯器件PLD），具有256-2280個(gè)查找表（LUT），73-271個(gè)I/O，多達(dá)27.6Kb sysMEM嵌入?yún)^(qū)塊RAM，多達(dá)7.7Kb分布式RAM，可編程的sysIOtrade;緩沖器支持LVCMOS 3.3/2.5/1.8/
  • 關(guān)鍵字： 控制  開發(fā)技術(shù)  PLD  設(shè)計(jì)  MachXO  基于  

用VHDL實(shí)現(xiàn)的有線電視機(jī)頂盒信源發(fā)生方案

  • VHDL是隨著可編輯邏輯器件（PLD）的發(fā)展而發(fā)展起來的一種硬件描述語言。它是1980年美國國防部VHSIC（超高速集...
  • 關(guān)鍵字： PLD  VHDL  機(jī)頂盒  信源  
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