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一種密鑰可配置的DES加密算法的FPGA
- 一種密鑰可配置的DES加密算法的FPGA,摘 要： 在傳統(tǒng)的DES加密算法的基礎(chǔ)上，提出一種對(duì)密鑰實(shí)行動(dòng)態(tài)管理的硬件設(shè)計(jì)方案，給出了其FPGA實(shí)現(xiàn)方法。通過對(duì)DES加密原理的分析，利用其子密鑰的生成與核心算法相關(guān)性較弱的特點(diǎn)，對(duì)密鑰進(jìn)行重新配置。DES算法采
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DES 線性反饋移位寄存器 混沌加密 FPGA
隨著密碼學(xué)技術(shù)的飛速發(fā)展，軟件加密已經(jīng)非常流行，但由于硬件加密的穩(wěn)定性和兼容性更好而且速度更快，所以仍是商業(yè)和軍事用途的主要選擇。而FPGA在實(shí)現(xiàn)算法方面具有靈活性、物理安全性和比軟件更高的速度性能，已成為硬件實(shí)現(xiàn)加密算法的最好選擇。
基于DSP技術(shù)的雙電源自動(dòng)轉(zhuǎn)換控制器的設(shè)計(jì)
- 隨著國民經(jīng)濟(jì)的迅速發(fā)展，人們對(duì)供電連續(xù)性、可靠性的要求越來越高，研究能夠精確檢測(cè)電源狀態(tài)，實(shí)時(shí)控制兩路電源可靠安全轉(zhuǎn)換，結(jié)構(gòu)簡單的雙電源供電系統(tǒng)是十分緊迫和必要的。本文提出一種新型雙電源供電系統(tǒng)控制器的設(shè)計(jì)方案，該控制器采用高性能處理器TMS320F2812作為主控芯片，通過信號(hào)采集和處理電路對(duì)常用和備用電源的狀態(tài)進(jìn)行實(shí)時(shí)檢測(cè)和實(shí)時(shí)控制，實(shí)現(xiàn)對(duì)負(fù)載的連續(xù)供電。
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基于DSP TMS 3 2 0F2 8 1 2的智能接口板設(shè)計(jì)
- 基于DSP TMS 3 2 0F2 8 1 2的智能接口板設(shè)計(jì),本文介紹了一種基于TI公司高性能DSP TMS320F2812的智能接口板設(shè)計(jì)，主要包括處理器及存儲(chǔ)器電路設(shè)計(jì)、復(fù)位時(shí)鐘電路設(shè)計(jì)、接口設(shè)計(jì)等內(nèi)容。具有成本低、通用性強(qiáng)、設(shè)計(jì)難度低、開發(fā)周期短的優(yōu)點(diǎn)，在數(shù)據(jù)處理系統(tǒng)設(shè)計(jì)中具有典型性和實(shí)用性。
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基于FPGA的步進(jìn)電機(jī)控制器研究和實(shí)現(xiàn)
- 摘要：步進(jìn)電機(jī)是一種將電脈沖轉(zhuǎn)化為角位移的執(zhí)行機(jī)構(gòu)，已廣泛應(yīng)用于各種自動(dòng)化控制系統(tǒng)中。為了提高對(duì)步進(jìn)電機(jī)的細(xì)分要求，提出了基于FPGA控制的步進(jìn)電機(jī)控制器方案。給出了用VHDL語言層次化設(shè)計(jì)各功能模塊的過程，
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IGLOO的FPGA構(gòu)成的馬達(dá)控制方案
- 本文介紹了IGLOO系列主要特性和優(yōu)勢(shì)，IGLOO系列架構(gòu)框圖以及采用AGL125的馬達(dá)控制子板主要特性，步進(jìn)馬達(dá)控制邏...
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基于DSP控制系統(tǒng)的離散模型參考自適應(yīng)算法在燃料電池車中的應(yīng)用
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基于DSP芯片TMS320F2812的帶式輸送機(jī)多路溫度檢測(cè)
- 0引言帶式輸送機(jī)是煤礦最理想的高效連續(xù)運(yùn)輸設(shè)備，與其他運(yùn)輸設(shè)備(如機(jī)車類)相比，具有輸送距離長、運(yùn)量...
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DSP芯片（TMS320C6711D）的Flash存儲(chǔ)器
- 在嵌入式系統(tǒng)中，為了實(shí)現(xiàn)程序的脫機(jī)自動(dòng)運(yùn)行，程序往往固化在電可擦除的Flash存儲(chǔ)器中。要實(shí)現(xiàn)一個(gè)嵌入式系統(tǒng)...
- 關(guān)鍵字： DSP TMS320C6711D Flash
ASIC和FPGA的優(yōu)勢(shì)與劣勢(shì)
- ASIC和FPGA的優(yōu)勢(shì)與劣勢(shì),ASIC和FPGA具有不同的價(jià)值主張，在作出選擇前必須仔細(xì)評(píng)估。兩種種技術(shù)對(duì)比。這里介紹了ASIC和FPGA 的優(yōu)勢(shì)與劣勢(shì)：FPGA與ASIC的設(shè)計(jì)優(yōu)勢(shì)
FPGA 的設(shè)計(jì)優(yōu)勢(shì) - 關(guān)鍵字： 劣勢(shì) 優(yōu)勢(shì) FPGA ASIC
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