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dsp＋fpga 文章 最新資訊

符合中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中的HDLC協(xié)議的FPGA設(shè)計與實現(xiàn)

  • 隨著通信與網(wǎng)絡(luò)技術(shù)的不斷發(fā)展，使我國用現(xiàn)有的E1資源來傳輸以太網(wǎng)業(yè)務(wù)成為廣泛的應(yīng)用。以太網(wǎng)數(shù)據(jù)要通過E1線路傳輸就必須對以太網(wǎng)凈荷數(shù)據(jù)進(jìn)行幀封裝，才能從E1線路上恢復(fù)出以太網(wǎng)數(shù)據(jù)幀，完成以太網(wǎng)數(shù)據(jù)的交換。通常，以太網(wǎng)數(shù)據(jù)是通過HDLC協(xié)議或GFP協(xié)議來進(jìn)行封裝的。本文介紹了中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中以太網(wǎng)到單路E1轉(zhuǎn)換器HDLC協(xié)議封裝的FPGA（現(xiàn)場可編程邏輯陣列）設(shè)計與實現(xiàn)。
  • 關(guān)鍵字： 中國移動  FPGA  201106  

CEVA和CellGuide合作為CEVA-XC提供軟件GPS解決方案

  • 全球領(lǐng)先的硅產(chǎn)品知識產(chǎn)權(quán)(SIP)平臺解決方案和數(shù)字信號處理器(DSP)內(nèi)核授權(quán)廠商CEVA公司和領(lǐng)先的GNSS解決方案供應(yīng)商CellGuide宣布，合作為CEVA-XC通信處理器提供基于軟件的GPS解決方案。通過利用CellGuide的GPS/GLONASS軟件IP，CEVA-XC獲授權(quán)廠商可為其處理器設(shè)計增添GPS功能，而無需進(jìn)行任何硬件更改或增加芯片尺寸。
  • 關(guān)鍵字： CEVA  DSP  

CEVA推出基于CEVA-XC DSP的HSPA+軟件物理層IP

  • 全球領(lǐng)先的硅產(chǎn)品知識產(chǎn)權(quán) (SIP) 平臺解決方案和數(shù)字信號處理器 (DSP) 內(nèi)核授權(quán)廠商CEVA公司宣布，推出經(jīng)充分優(yōu)化的HSPA+軟件程序庫，適用于CEVA-XC DSP。在CEVA-XC軟件定義無線電 (SDR) 參考架構(gòu)中增加新的程序庫，能夠?qū)嵤┗谲浖亩嗄SPA/HSPA+/LTE/LTE-A解決方案。對HSPA和HSPA+的支持是為移動應(yīng)用提供強制性3G后向兼容所必要的。
  • 關(guān)鍵字： CEVA  DSP  HSPA  

基于FPGA的NAND Flash ECC校驗

  • 摘要 基于Flash存儲器的Hamming編碼原理，在Altera QuartusⅡ7．0開發(fā)環(huán)境下，實現(xiàn)ECC校驗功能。測試結(jié)果表明，該程序可實現(xiàn)每256 Byte數(shù)據(jù)生成3 Byte的ECC校驗數(shù)據(jù)，能夠檢測出1 bit錯誤和2 bit錯誤，對于1 bit錯誤
  • 關(guān)鍵字： Flash  FPGA  NAND  ECC    

雙DSP系統(tǒng)串口擴(kuò)展

  • 雙DSP系統(tǒng)串口擴(kuò)展,在研制無線分組網(wǎng)絡(luò)路由控制器時，采用了雙DSP結(jié)構(gòu)進(jìn)行數(shù)據(jù)處理，另外還需擴(kuò)展8個串口，很顯然這是DSP本身所無法解決的，故必須進(jìn)行串口擴(kuò)展。
    常用串口擴(kuò)展方法:
    從本質(zhì)上講，所有的串口擴(kuò)展接口電路都是以并行數(shù)
  • 關(guān)鍵字： 擴(kuò)展  串口  系統(tǒng)  DSP  

一種基于ARM 的FPGA可重構(gòu)配置方法的實現(xiàn)及應(yīng)用

  • 隨著半導(dǎo)體工藝技術(shù)的迅猛發(fā)展，現(xiàn)場可編程邏輯器件FPGA的集成度迅速提高，已達(dá)到百萬門量級，與此同時，F(xiàn)PGA中的邏 ...
  • 關(guān)鍵字： ARM  FPGA  加載配置  

DSP芯片加工及選型參數(shù)

  • DSP芯片加工及選型參數(shù),DSP芯片也稱數(shù)字信號處理器，是一種特別適合于進(jìn)行數(shù)字信號處理運算的微處理器具，其主機應(yīng)用是實時快速地實現(xiàn)各種數(shù)字信號處理算法。根據(jù)數(shù)字信號處理的要求，DSP芯片一般具有如下主要特點：　　(1)在一個指令周期內(nèi)
  • 關(guān)鍵字： 參數(shù)  選型  加工  芯片  DSP  

DSP數(shù)字多功能板的工作原理與實現(xiàn)

  • DSP數(shù)字多功能板的工作原理與實現(xiàn),1 引言　　音板(tone)、主叫號碼顯示板、多頻互控收發(fā)器板、雙音頻接收器板等是程控交換機重要的公共設(shè)備。這些設(shè)備在程控交換機中是一塊塊不同的硬件單板，這些單板都是以專用集成電路(IC)來實現(xiàn)其功能的。但要增加
  • 關(guān)鍵字： 原理  實現(xiàn)  工作  多功能  數(shù)字  DSP  

基于DSP的電動助力轉(zhuǎn)向系統(tǒng)的設(shè)計

  • 基于DSP的電動助力轉(zhuǎn)向系統(tǒng)的設(shè)計,摘要：電動助力轉(zhuǎn)向(EPS)是一種新型的汽車動力轉(zhuǎn)向技術(shù)。設(shè)計了一種基于TMS320LF2407A DSP控制的汽車電動助力轉(zhuǎn)向系統(tǒng)，介紹了其硬件組成及軟件結(jié)構(gòu)，采用PID控制策略對電機電流進(jìn)行閉環(huán)控制，利用PWM技術(shù)控制電機的
  • 關(guān)鍵字： 轉(zhuǎn)向系統(tǒng)  設(shè)計  助力  電動  DSP  基于  

IIR數(shù)字濾波器的Matlab和FPGA實現(xiàn)

  • 摘要：提出一種通過兩個二階節(jié)級聯(lián)構(gòu)成四階IIR數(shù)字橢圓濾波器的設(shè)計方法，并利用Matlab仿真軟件設(shè)計了通帶內(nèi)波紋不大于0．1 dB，阻帶衰減不小于42 dB的IIR數(shù)字濾波器。論述了一種采用可編程邏輯器件，通過VHDL硬件描
  • 關(guān)鍵字： Matlab  FPGA  IIR  數(shù)字濾波器    

基于FPGA的多路數(shù)字信號復(fù)分接器的設(shè)計

  • 在現(xiàn)代數(shù)字通信中，對數(shù)據(jù)傳輸容量和傳輸效率的要求越來越高，因此經(jīng)常依據(jù)時分復(fù)用[1]的原理通過數(shù)字復(fù)接與分...
  • 關(guān)鍵字： 數(shù)字復(fù)接技術(shù)  FPGA  時分復(fù)用  

FPGA時鐘設(shè)計

  • 摘要：在FPGA設(shè)計中，為了成功地操作，可靠的時鐘是非常關(guān)鍵的。設(shè)計不良的時鐘在極限的溫度、電壓下將導(dǎo)致錯誤的行為。在設(shè)計PLD／FPGA時通常采用如下四種類型時鐘：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。
  • 關(guān)鍵字： FPGA  時鐘設(shè)計    

基于FPGA的自適應(yīng)波束形成算法實現(xiàn)

  • 　1 引 言　　在雷達(dá)及聲納信號處理系統(tǒng)中，波束形成算法通常采用DSP軟件編程實現(xiàn)，控制邏輯電路采用CPLD來完成，這種方法具有軟件編程靈活、功能易于擴(kuò)展的優(yōu)點，但對于實時性能要求很高的系統(tǒng)，如雷達(dá)、聲納探測和
  • 關(guān)鍵字： FPGA  自適應(yīng)波束  算法    

基于FPGA的實時中值濾波器硬件實現(xiàn)

  • 針對高清圖像在中值濾波預(yù)處理過程中排序量多、速度慢的特點，提出適合鄰域圖像并行處理機的分塊存儲方法。在流水線結(jié)構(gòu)下，1個時鐘周期可以并行處理32個3×3鄰域的中值濾波運算，實現(xiàn)了高速、實時的1 920×1 080灰度圖像中值濾波器。
  • 關(guān)鍵字： FPGA  中值濾波  硬件實現(xiàn)    

萊迪思宣布首個符合PCI Express 2.0規(guī)范的低成本FPGA

  • 　　萊迪思半導(dǎo)體公司日前宣布LatticeECP3TMFPGA系列符合PCI Express 2.0在2.5Gbps的規(guī)范。針對最近PCI – SIG研討會上涉及的1-通道和 4-通道配置，LatticeECP3 FPGA和其PCI Express(PCIe)IP核通過了符合PCI - SIGPCIe 2.0規(guī)范和互操作性的測試，確保萊迪思的解決方案與現(xiàn)有的支持系統(tǒng)的PCIe 2.0具有互操作性。
  • 關(guān)鍵字： 萊迪思  FPGA  
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