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dsp+fpga 文章 最新資訊

FPGA實現(xiàn)IRIG-B(DC)碼編碼和解碼的設計

  • 為達到IRIG-B碼與時間信號輸入、輸出的精確同步，采用現(xiàn)代化靶場的IRIG-B碼編碼和解碼的原理，從工程的角度出發(fā)，提出了使用現(xiàn)場可編程門陣列(FPGA)來實現(xiàn)IRIG-B碼編碼和解碼的設計方案和體系結構，設計中會涉及到幾個不同的時鐘頻率，F(xiàn)PGA對時鐘的同步性具有靈活性、效率高、且功耗低?？垢蓴_性好的特點。結果表明，F(xiàn)PGA能夠確保為從設備提供同源的時鐘基準，使時鐘與信號的延遲控制在200 ns以內(nèi)，從而得到了IRIG-B碼與時間精確同步的效果。
  • 關鍵字： IRIG-B  FPGA  DC  編碼    

基于FPGA與DSP的雷達高速數(shù)據(jù)采集系統(tǒng)

  • 激光雷達的發(fā)射波及回波信號經(jīng)光電器件轉(zhuǎn)換形成的電信號具有脈寬窄，幅度低，背景噪聲大等特點，對其進行低速數(shù)據(jù)采集存在數(shù)據(jù)精度不高等問題。同時，A／D轉(zhuǎn)換器與數(shù)字信號處理器直接連接會導致數(shù)據(jù)傳輸不及時，影響系統(tǒng)可靠性、實時性。針對激光雷達回撥信號，提出基于FPGA與DSP的高速數(shù)據(jù)采集系統(tǒng)，利用FPGA內(nèi)部的異步FIFO和DCM實現(xiàn)A／D轉(zhuǎn)換器與DSP的高速外部存儲接口(EMIF)之間的數(shù)據(jù)傳輸。介紹了ADC外圍電路、工作時序以及DSP的EMIF的設置參數(shù)，并對異步FIFO數(shù)據(jù)讀寫進行仿真，結合硬件結構詳細地
  • 關鍵字： FPGA  DSP  雷達  高速數(shù)據(jù)    

高精度DDFS信號源FPGA實現(xiàn)

  • 為進行高精度信號源的設計，同時降低設計成本，以Cyclone II系列低端FPGA為核心，利用直接頻率合成技術，對正弦信號等數(shù)據(jù)進行1／4周期壓縮存儲到ROM中，在外部時鐘頻率為50 MHz，實現(xiàn)了正弦信號源的設計，同時，實現(xiàn)三角波、鋸齒波、矩形脈沖及2-ASK、2-PSK和2-FSK等數(shù)字調(diào)制信號，系統(tǒng)還具有掃頻、指定波形次數(shù)等功能。仿真結果表明，信號源精度高，頻率調(diào)整步進可達0．034 92 Hz，頻率范圍為0．034 92 Hz～9．375 MHz，制作成本低，功能豐富。
  • 關鍵字： DDFS  FPGA  高精度  信號源    

基于DSP的PSK信號調(diào)制設計與實現(xiàn)

  • 基于DSP的PSK信號調(diào)制設計與實現(xiàn), 數(shù)字調(diào)制信號又稱為鍵控信號， 其調(diào)制過程是用鍵控的方法由基帶信號對載頻信號的振幅、頻率及相位進行調(diào)制。這種調(diào)制的最基本方法有三種： 振幅鍵控(ASK)、頻移鍵控(FSK)、相移鍵控(PSK)， 同時可根據(jù)所處理的基
  • 關鍵字： 設計  實現(xiàn)  調(diào)制  信號  DSP  PSK  基于  

一種基于DSP的音頻實時處理系統(tǒng)

  • 一種基于DSP的音頻實時處理系統(tǒng),摘要：聲學回聲消除器一直是視頻會議系統(tǒng)不可缺少的組件。將回聲消除算法結合噪音消除和靜音檢測算法等，提出一種改進的實時音頻處理系統(tǒng)方法，并在TMS320C6713B上實現(xiàn)，能夠有效改善噪音、雙工檢測、非線性回聲等導
  • 關鍵字： 處理  理系  實時  音頻  DSP  基于  

基于FPGA的視頻格式轉(zhuǎn)換系統(tǒng)設計

  • 摘 要: 針對電視制式PAL /NTSC 信號輸出VGA 顯示格式的解決辦法，詳細講述了基于FPGA 視頻格式轉(zhuǎn)換系統(tǒng)的設計實現(xiàn)。采用Cyclone Ⅲ系列的EP3C1*84C6作為核心處理器件，實現(xiàn)了NTSC /PAL制式視頻的解碼、色空間轉(zhuǎn)換(
  • 關鍵字： 系統(tǒng)  設計  轉(zhuǎn)換  格式  FPGA  視頻  基于  

一種基于FPGA 的嵌入式塊SRAM 的設計

  • 摘　要：文章中提出了一種應用于FPGA 的嵌入式可配置雙端口的塊存儲器。該存儲器包括與其他電路的布線接口、可配置邏輯、可配置譯碼、高速讀寫電路。在編程狀態(tài)下，可對所有存儲單元進行清零，且編程后為兩端口獨
  • 關鍵字： FPGA  SRAM  嵌入式    

基于FPGA的語音存儲與回放系統(tǒng)設計

  • 1 設計要求　　設計并制作一個數(shù)字化語音存儲與回放系統(tǒng)，其示意圖如圖1所示。

    圖1 數(shù)字化語音存儲與回放系統(tǒng)示意圖　　(1)放大器1的增益為46dB，放大器2的增益為40dB，增益均可調(diào)；　　(2)帶通濾波器：通帶為30
  • 關鍵字： FPGA  語音存儲  回放  系統(tǒng)設計    

基于FPGA 與VHDL 的微型打印機的驅(qū)動設計

  • 摘 要：為了取代傳統(tǒng)利用單片機驅(qū)動微型打印機，使用Alt era 公司的FPGA 芯片EP3C25Q240C8N 設計驅(qū)動打印機的硬件控制電路，并正確控制微型打印機的工作時序。軟件使用硬件描述語言VH DL 實現(xiàn)對微型打印機的時序控
  • 關鍵字： FPGA  VHDL  微型打印機  驅(qū)動設計    

基于FPGA 的衛(wèi)星便攜站的同步數(shù)字復接器的設計

  • 在便攜式數(shù)字衛(wèi)星通信系統(tǒng)中，為了擴大傳輸容量和提高傳輸效率，滿足同時傳輸幾種業(yè)務的需求，通常采用時分復用的方法，將若干個低速數(shù)字碼流按一定格式合并成一個高速數(shù)據(jù)碼流，以便在一條信道中傳輸，使各個業(yè)務信
  • 關鍵字： FPGA  衛(wèi)星  便攜  數(shù)字復接器    

根升余弦脈沖成形濾波器FPGA實現(xiàn)

  • 摘要：提出了基于電路分割技術實現(xiàn)通信系統(tǒng)發(fā)送端根升余弦波形成形濾波器查表法的FPGA結構，節(jié)省了ROM單元，討論了其ROM初始化時形波數(shù)據(jù)的組織方法，完成了該結構的VHDL實現(xiàn)，給出了該設計在Modelsim環(huán)境下的時序仿
  • 關鍵字： FPGA  脈沖  成形濾波器    

SoC FPGA上的策略考慮

  • SoC FPGA上的策略考慮,引言　　集成了 FPGA 架構、硬核 CPU 子系統(tǒng)以及其他硬核 IP 的半導體器件 SoC FPGA 已經(jīng)發(fā)展到了一個“關鍵點”，它在今后十年中會得到廣泛應用，為系統(tǒng)設計人員提供更多的選擇。對于在 FPGA 上開發(fā)的系統(tǒng)
  • 關鍵字： 考慮  策略  FPGA  SoC  

PLD/FPGA硬件語言設計verilog HDL

  • PLD/FPGA硬件語言設計verilog HDL,HDL概述　　隨著EDA技術的發(fā)展，使用硬件語言設計PLD/FPGA成為一種趨勢。目前最主要的硬件描述語言是VHDL和verilog HDL及System Verilog。 VHDL發(fā)展的較早，語法嚴格;而Verilog HDL是在C語言的基礎上發(fā)展起來的一種硬
  • 關鍵字： verilog  HDL  設計  語言  硬件  PLD/FPGA  

基于DSP+FPGA的紅外圖像小目標檢測系統(tǒng)設計

  • 基于DSP+FPGA的紅外圖像小目標檢測系統(tǒng)設計,研究單幀紅外圖像小目標的檢測問題。對傳統(tǒng)基于數(shù)學形態(tài)學的Top-hat算子進行分析和實驗，并利用一種最大類間方差方法確定分割閾值，進行圖像分割和目標檢測。在Matlab仿真中發(fā)現(xiàn)，這種方法能夠在一定程度上提高單幀圖像目標檢測的成功率，并且在一定程度上能夠適應不同環(huán)境的需要，在實際應用中具有一定的魯棒性。同時描述一種基于DSP+FPGA的紅外圖像處理系統(tǒng)，該結構在一定程度上可滿足實時性和靈活性的要求，具有很強的通用性和可擴展性。介紹了該系統(tǒng)的總體結構，并且給
  • 關鍵字： 目標  檢測系統(tǒng)  設計  圖像  紅外  DSP  FPGA  基于  

TKScope DK10率先支持TI DSP全系列快速仿真、燒寫

  • TKScope DK10率先支持TI DSP全系列快速仿真、燒寫, TKScope DK10是廣州致遠電子有限公司2010年隆重推出的一款高性能綜合仿真開發(fā)平臺，支持DSP和ARM內(nèi)核的仿真調(diào)試，并且支持片內(nèi)／片外Flash的獨立燒寫，同時內(nèi)嵌32路專業(yè)邏輯分析儀。1 TKScope DK10仿真器簡介
  • 關鍵字： 全系列  快速  仿真  燒寫  DSP  TI  DK10  率先  支持  TKScope  
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