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dsp+fpga 文章 最新資訊

多聲源情境下的三維定位與分離系統(tǒng)的設(shè)計實現(xiàn)

  • 　　項目背景及可行性分析 　　項目名稱、項目的主要內(nèi)容及目前的進(jìn)展情況 　　項目主要內(nèi)容：聲音分離的研究在聲音通信、聲學(xué)目標(biāo)檢測等方面都有著重要的理論和實用價值;聲源分離技術(shù)在機器聽覺、安保監(jiān)控、軍事等領(lǐng)域具有特別的應(yīng)用。目前，嘈雜背景下，單聲源定位與增強，已有所應(yīng)用;但多聲源情景下的定位與分離，由于算法和硬件復(fù)雜，還很少走向應(yīng)用。本項目通過構(gòu)建麥克風(fēng)陣列信號采集硬件，實現(xiàn)FPGA聲音分離算法，以完成兩個或兩個以上聲源的三維定位和分離，利用FPGA的并行性，以達(dá)到實時性的目標(biāo)。項目難點在于，制作信號采
  • 關(guān)鍵字： FPGA  NE5532  AD73360  

基于FPGA的混沌加密虹膜識別系統(tǒng)設(shè)計(二)

  • 　　7.1.3 虹膜外邊緣的確定 　　(1) 虹膜外邊緣的特征分析 　　由圖1中所示的虹膜圖像可以看出，虹膜外邊緣的主要特點是：較相對與虹膜內(nèi)邊緣而言，邊緣處灰度變化不是特別明顯，有一小段漸變的區(qū)域。也就是說，虹膜內(nèi)部灰度趨近于一致這個事實，在參考文獻(xiàn)[8]中，介紹的環(huán)量積分算子應(yīng)該式是一種有效的方法。 　　即： 　　 ? 　　(7-10) 　　(2) 采用環(huán)量積分算子實現(xiàn)虹膜外邊緣的檢測 　　如上分析，虹膜環(huán)量積分算子是檢測虹膜外邊緣的一種有效手段，為了克服虹膜紋理對環(huán)量線
  • 關(guān)鍵字： FPGA  虹膜識別  CMOS  

基于FPGA的混沌加密虹膜識別系統(tǒng)設(shè)計(一)

  • 　　項目信息 　　1.項目名稱：基于FPGA的混沌加密虹膜識別系統(tǒng)設(shè)計 　　2.應(yīng)用領(lǐng)域：工業(yè)控制、科研、醫(yī)療、安檢 　　3.設(shè)計摘要： 　　基于虹膜的生物識別技術(shù)是一種最新的識別技術(shù)，通過一定的虹膜識別算法，可以達(dá)到十分優(yōu)異的準(zhǔn)確性。隨著虹膜識別技術(shù)的發(fā)展，它的應(yīng)用領(lǐng)域越來越寬，不僅在高度機密場所應(yīng)用，并逐步推廣到機場、銀行、金融、公安、出入境口岸、安全、網(wǎng)絡(luò)、電子商務(wù)等場合。在研究了虹膜識別算法，即預(yù)處理、特征提取和匹配的基礎(chǔ)上，我們設(shè)計了一種可便攜使用的基于FPGA的嵌入式虹膜識別系統(tǒng)。本系
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基于SoC FPGA進(jìn)行工業(yè)設(shè)計及電機控制

  • 　　引言 　　在工業(yè)系統(tǒng)中選擇器件需要考慮多個因素，其中包括：性能、工程變更的成本、上市時間、人員的技能、重用現(xiàn)有IP/程序庫的可能性、現(xiàn)場升級的成本，以及低功耗和低成本。 　　工業(yè)市場的近期發(fā)展推動了對具有高集成度、高性能、低功耗FPGA器件的需求。設(shè)計人員更喜歡網(wǎng)絡(luò)通信而不是點對點通信，這意味著可能需要額外的控制器用于通信，進(jìn)而間接增加了BOM成本、電路板尺寸和相關(guān)NRE(一次性工程費用)成本。 　　總體擁有成本用于分析和估計購置的壽命周期成本，它是所有與設(shè)計相關(guān)的直接和間接成本的擴展集，包括工
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FPGA研發(fā)之道(10)架構(gòu)設(shè)計漫談(五)數(shù)字電路的靈魂-流水線

  • 　　流水線，最早為人熟知，起源于十九世紀(jì)初的福特汽車工廠，富有遠(yuǎn)見的福特，改變了那種人圍著汽車轉(zhuǎn)、負(fù)責(zé)各個環(huán)節(jié)的生產(chǎn)模式，轉(zhuǎn)變成了流動的汽車組裝線和固定操作的人員。于是，工廠的一頭是不斷輸入的橡膠和鋼鐵，工廠的另一頭則是一輛輛正在下線的汽車。這種改變，不但提升了效率，更是拉開了工業(yè)時代大生產(chǎn)的序幕。 　　如今，這種模式常常應(yīng)用于數(shù)字電路的設(shè)計之中，與現(xiàn)在流驅(qū)動的FPGA架構(gòu)不謀而合。舉例來說：某設(shè)計輸入為A種數(shù)據(jù)流，而輸出則是B種數(shù)據(jù)流，其流水架構(gòu)如下所示： 　　 ? 　　每個模塊只
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FPGA研發(fā)之道(9)架構(gòu)設(shè)計漫談(四)并行與復(fù)用

  • 　　FPGA其在眾多器件中能夠被工程師青睞的一個很重要的原因就是其強悍的處理能力。那如何能夠做到高速的數(shù)據(jù)處理，數(shù)據(jù)的并行處理則是其中一個很重要的方式。 　　數(shù)據(jù)的并行處理，從結(jié)構(gòu)上非常簡單，但是設(shè)計上卻是相當(dāng)復(fù)雜，對于現(xiàn)有的FPGA來說，雖然各種FPGA的容量都在增加，但是在有限的邏輯中達(dá)到更高的處理能力則是FPGA工程師面臨的挑戰(zhàn)。常用并行計算結(jié)構(gòu)如下圖所示： 　　 ? 　　上圖中：前端處理單元負(fù)責(zé)將進(jìn)入數(shù)據(jù)信息，分配到多個計算單元中，圖中為3個計算單元(幾個根據(jù)所需的性能計算得
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德州儀器推增強Jacinto信息娛樂處理器系列DSP和視覺處理

  • 　　日前，德州儀器(TI)宣布將信號處理功能添加到其全新的DRA75x處理器，以便幫助客戶增強信息娛樂系統(tǒng)并為信息高級駕駛員輔助系統(tǒng)(ADAS)功能配對。這兩者的完美結(jié)合將幫助客戶生產(chǎn)具有極高數(shù)字化駕駛艙集成及傳統(tǒng)信息娛樂功能的汽車，同時不影響任何性能。Jacinto 6 EP與Jacinto 6 Ex兩種全新的DRA75x處理器和其它“Jacinto”器件基于相同的架構(gòu)而開發(fā)，使汽車制造商能擴展自己的投資，無需進(jìn)行額外的研究與開發(fā)或顯著增加材料清單(BOM)即可提供具有軟硬件兼容
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FPGA研發(fā)之道(8)架構(gòu)設(shè)計漫談(三)時鐘和復(fù)位

  • 　　接口確定以后，F(xiàn)PGA內(nèi)部如何規(guī)劃?首先需要考慮就是時鐘和復(fù)位。 　　時鐘：根據(jù)時鐘的分類，可以分為邏輯時鐘，接口時鐘，存儲器時鐘等; 　　(1)邏輯時鐘取決與邏輯的關(guān)鍵路徑，最終值是設(shè)計和優(yōu)化的結(jié)果，從經(jīng)驗而不是實際出發(fā)：低端FPGA(cyclone spantan)工作頻率在40-80Mhz之間，而高端器件(stratix virtex)可達(dá)100-200Mhz之間，根據(jù)各系列的先后性能會有所提升，但不是革命性的。 　　(2)接口時鐘，異步信號的時序一般也是通過FPGA片內(nèi)同步邏輯產(chǎn)生，一般
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FPGA研發(fā)之道(7)架構(gòu)設(shè)計漫談(二)穩(wěn)定壓倒一切

  • 　　敏捷開發(fā)宣言中，有一條定律是“可以工作的軟件勝過面面俱到的文檔”。如何定義可可以工作的，這就是需求確定后架構(gòu)設(shè)計的首要問題。而大部分看這句話的同志更喜歡后半句，用于作為不寫文檔的借口。 　　FPGA的架構(gòu)設(shè)計最首先可以確定就是外接接口，就像以前說的，穩(wěn)定可靠的接口是成功的一半。接口的選擇需要考慮幾個問題。 　　1， 有無外部成熟IP。一般來說，ALTERA和XILINX都提供大量的接口IP，采用這些IP能夠提升研發(fā)進(jìn)度，但不同IP在不同F(xiàn)PGA上需要不同license，這個
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FPGA研發(fā)之道(6)架構(gòu)設(shè)計漫談(一)流驅(qū)動和調(diào)用式

  • 　　勿用諱言，現(xiàn)在國內(nèi)FPGA開發(fā)還處于小作坊的開發(fā)階段，一般都是三、四個人，七八臺機器.小作坊如何也能做出大成果。這是每個FPGA工程師都要面臨的問題。架構(gòu)設(shè)計是面臨的第一關(guān)。經(jīng)常有這樣的項目，需求分析，架構(gòu)設(shè)計匆匆忙忙，號稱一兩個月開發(fā)完畢，實際上維護項目就花了一年半時間。主要包括幾個問題，一，性能不滿足需求。二，設(shè)計頻繁變更。三，系統(tǒng)不穩(wěn)定，調(diào)試問題不收斂。 　　磨刀不誤砍柴工，F(xiàn)PGA設(shè)計的需求分析是整個設(shè)計第一步。如何將系統(tǒng)的功能需求，轉(zhuǎn)換成FPGA的設(shè)計需求，是FPGA架構(gòu)設(shè)計的首要問題。首
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基于DDS的頻譜分析儀設(shè)計

  • 　　1 引言 　　直接數(shù)字頻率合成(DDS)是近幾年一種新型的頻率合成法，其具有頻率切換速度快，頻率分辨率高，以及便于集成等優(yōu)點。在此，設(shè)計了基于DDS的頻譜分析儀，該頻譜分析儀依據(jù)外差原理，被測信號與本征頻率混頻，實現(xiàn)信號的頻譜分析。 　　2 系統(tǒng)設(shè)計 　　圖1給出系統(tǒng)設(shè)計框圖，主要由本機振蕩電路、混頻電路、放大檢波電路、頻譜輸出顯示電路等組成。通過單片機和現(xiàn)場可編程門陣列(FPGA)共同控制AD985l，以產(chǎn)生正弦掃頻輸出信號，然后經(jīng)濾波、程控放大得到穩(wěn)定輸出，與經(jīng)放大處理的被測信號混頻，再經(jīng)放
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基于FPGA的簡易頻譜分析儀

  • 　　1 引言 　　目前，由于頻譜分析儀價格昂貴，高等院校只是少數(shù)實驗室配有頻譜儀。但電子信息類教學(xué)，如果沒有頻譜儀輔助觀察，學(xué)生只能從書本中抽象理解信號特征，嚴(yán)重影響教學(xué)實驗效果。 　　針對這種現(xiàn)狀提出一種基于FPGA的簡易頻譜分析儀設(shè)計方案，其優(yōu)點是成本低，性能指標(biāo)滿足教學(xué)實驗所要求的檢測信號范圍。 　　2 設(shè)計方案 　　圖1為系統(tǒng)設(shè)計總體框圖。該系統(tǒng)采用C8051系列單片機中的 C8051F121作為控制器，CvcloneⅢ系列EP3C40F484C8型FPGA為數(shù)字信號算法處理單元。系統(tǒng)設(shè)計
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基于NIOS II的頻譜分析儀的設(shè)計與研制

  • 　　頻譜分析儀是微電子測量領(lǐng)域中最基礎(chǔ)、最重要的測量儀器之一，是從事各種電子產(chǎn)品研發(fā)、生產(chǎn)、檢驗的重要工具。高分辨率、寬頻帶數(shù)字頻譜分析的方法和實現(xiàn)一直是該領(lǐng)域的研究熱點[1]?，F(xiàn)代頻譜分析儀是基于現(xiàn)代數(shù)字信號處理理論的頻譜分析儀，信號經(jīng)過前置預(yù)處理、抗混疊濾波、A/D變換、數(shù)字頻譜分析等環(huán)節(jié)而得到信號中的頻率分量， 達(dá)到與傳統(tǒng)頻譜分析儀同樣的結(jié)果。 　　本設(shè)計完全利用FPGA實現(xiàn)FFT，在FPGA上實現(xiàn)整個系統(tǒng)構(gòu)建。其中CPU選用Altera公司的Nios II軟核處理器進(jìn)行開發(fā), 硬件平臺關(guān)鍵模塊使
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Imagination 將舉辦高峰論壇，展示最新 64 位處理器

  • 　　Imagination Technologies 將于 2014 年 11 月 12 日(深圳)、11 月 14 日(上海)舉辦 Imagination 高峰論壇，針對網(wǎng)絡(luò)通信、視頻、圖形、顯示、數(shù)字信號處理(DSP)、嵌入式系統(tǒng)、系統(tǒng)級芯片(SoC)等尖端技術(shù)，邀請合作伙伴和各界專家就技術(shù)應(yīng)用市場的發(fā)展發(fā)表專題演講。此高峰論壇為免費活動，歡迎 SoC 硬件或軟件設(shè)計和管理人員以及感興趣人士在線報名。 　　Imagination 將在高峰論壇發(fā)表最新 64 位處理器，推出設(shè)計最新穎的解決方案，展示
  • 關(guān)鍵字： Imagination  DSP  SoC   

基于SPWM控制全數(shù)字單相變頻器的設(shè)計及實現(xiàn)

  • 　　本文介紹了基于DSPTMS320LF2407A并使用SPWM控制技術(shù)的全數(shù)字單相變頻器的設(shè)計及實現(xiàn)方法，最后給出了實驗波形。 　　常見的AC/DC/AC變頻器，是對輸出部分進(jìn)行變頻、變壓調(diào)節(jié)，而且在多種逆變控制技術(shù)中，應(yīng)用最廣泛的一種逆變控制技術(shù)是正弦脈寬調(diào)制(SPWM)技術(shù)。在變頻調(diào)速系統(tǒng)中，應(yīng)用DSP作為控制芯片以實現(xiàn)數(shù)字化控制，它既提高了系統(tǒng)可靠性，又使系統(tǒng)的控制精度高、實時性強、硬件簡單、軟件編程容易，是變頻調(diào)速系統(tǒng)中最有發(fā)展前景的研究方向之一。 　　TMS320LF2407A芯片簡介
  • 關(guān)鍵字： SPWM  變頻器  DSP  
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