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cpld／ppga 文章 最新資訊

基于CPLD的水下沖擊波記錄儀的設計

  • 基于CPLD的水下沖擊波記錄儀的設計,1.引言
    　　
    隨著大規(guī)模集成電路和單片機的迅速發(fā)展，復雜可編程邏輯器件（CPLD）具有使用靈活、可靠性高、功能強大的優(yōu)點，在電子產(chǎn)品設計中得到了廣泛的應用。CPLD可實現(xiàn)在系統(tǒng)編程，重復多次，而且還兼容IEEE1
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節(jié)省電池能量的系統(tǒng)斷電電路CPLD

  • 節(jié)省電池能量的系統(tǒng)斷電電路CPLD,今天，大多數(shù)的CPLD（復雜可編程邏輯器件）都采用可減少功耗的工作模式，但當系統(tǒng)未使用時，應完全切斷電源以保存電池能量，從而實現(xiàn)很多設計者的終極節(jié)能目標。圖1描述了如何在一片CPLD 上增加幾只分立元件，實現(xiàn)一
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基于CPLD的專用鍵盤接口芯片的方案設計

  • 基于CPLD的專用鍵盤接口芯片的方案設計,在單片機應用系統(tǒng)中，存在多種形式的外部數(shù)據(jù)輸入接口界面，例如RS-232C串行通信、鍵盤輸入等[1,4] 。其中利用鍵盤接口輸入數(shù)據(jù)，是實現(xiàn)現(xiàn)場實時調(diào)試、數(shù)據(jù)調(diào)整和控制最常用的方法。單片機的外圍鍵盤擴展電路有多種實
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基于CPLD的數(shù)字電壓表設計

  • 雙積分型ADC具有轉(zhuǎn)換精度高，速度慢的特點，因而被廣泛應用于高精度數(shù)字儀器儀表中。該設計的主要創(chuàng)新點是以可編程器件(CPL-D)為核心，采用積分電路、檢零比較器等組成16位ADC，控制部分采用51單片機，能實現(xiàn)自動量程轉(zhuǎn)換。由于采用了CPLD技術(shù)，減少了外界干擾和所占空間，而且大大提高了系統(tǒng)的響應時間，提高了數(shù)字電壓表的性能。
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基于CPLD的圖像傳感器非均勻性校正研究

  • 圖像傳感器是現(xiàn)代視覺信息獲取的一種基礎器件,它將入射到光敏面上按空間分布的光強信息轉(zhuǎn)換為按時序輸...
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基于CPLD／FPGA的CMI編碼設計與實現(xiàn)

  • 根據(jù)CMI碼的特性，介紹了一種新的編程思路實現(xiàn)CMI編碼，在Max+PlusⅡ開發(fā)平臺上使用VHDL編程實現(xiàn)CMI編碼，并得到仿真波形。實驗結(jié)果表明，這種編程思路簡單、清晰。在產(chǎn)生7位偽隨機序列的前提下，分別對“O”，“1”進行編碼。這種思路為其他碼型設計提供了參考。
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一種基于CPLD的壓電生物傳感器檢測電路的設計

  • 本文介紹了一種基于復雜可編程邏輯器件(CPLD)的壓電生物傳感器檢測電路.該檢測電路以高性能CPLD(MAX7128)為核心,實現(xiàn)了對壓電生物傳感器10MHz高頻信號的測量與采集,以及所采集的頻率數(shù)據(jù)動態(tài)、實時顯示以及頻率數(shù)據(jù)串行通信等功能.該電路體積小、集成度高,具有可靠性高、實時性高的特點.此外該系統(tǒng)還可以通過RS-232串行接口與計算機連接進行數(shù)據(jù)傳輸和數(shù)據(jù)存儲及分析.詳細闡明了系統(tǒng)整體結(jié)構(gòu)設計以及系統(tǒng)硬件部分的實現(xiàn),并給出了CPLD內(nèi)核仿真結(jié)果和數(shù)據(jù)采集軟件實測頻率曲線.
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使用用CPLD和Flash實現(xiàn)FPGA的配置

  • 電子設計自動化EDA(ElectronicDesignAutomation)是指以計算機為工作平臺，以EDA軟件為開發(fā)環(huán)境，以硬件描...
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基于CPLD器件的單穩(wěn)態(tài)脈沖展寬電路的設計

  • 在數(shù)字電路設計中，當需要將一輸入的窄脈沖信號展寬成具有一定寬度和精度的寬脈沖信號時，往往很快就想到利...
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一種基于VC++程序的FPGA重配置方案設計

  • 引言隨著大規(guī)模集成電路的快速發(fā)展，系統(tǒng)設計已從傳統(tǒng)的追求大規(guī)模、高密度逐漸轉(zhuǎn)向提高資源利用率，...
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CPLD設計的CCD信號發(fā)生器技術(shù)

  • CPLD設計的CCD信號發(fā)生器技術(shù),本文設計了一種基于CPLD的可編程高精度CCD信號發(fā)生器。充分利用CPLD的可編程性．模擬出滿足系統(tǒng)要求的CD信號，輸出信號頻率達到1IMHZ。1 引言

    CCD (Charge Coupled Devices)電荷藕合器件是20世紀70年代初發(fā)展起來
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CPLD設計的驅(qū)動數(shù)碼顯示電路案例

  • CPLD設計的驅(qū)動數(shù)碼顯示電路案例,顯示原理：
    八段數(shù)碼顯示管如圖1.1 所示，八段數(shù)碼管每一段為一發(fā)光二極管，共有a～g 以及小數(shù)點dp 八個發(fā)光二極管。將八段數(shù)碼管中的每個二極管的陰極并聯(lián)在一起，組成公共陰極端。這樣把共陰極管腳接地，此時
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一種基于CPLD的DSP人機接口模塊設計

  • CPLD(ComplexprogrammableLogicDevice，復雜可編程邏輯器件)是在傳統(tǒng)的PAL、GAL基礎上發(fā)展而來的，具有...
  • 關(guān)鍵字： CPLD  DSP  人機接口模塊  
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