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cpld／fpga 文章 最新資訊

基于ARM和FPGA的電腦繡花機(jī)控制系統(tǒng)的設(shè)計(jì)

  • 電腦繡花機(jī)是隨著計(jì)算機(jī)技術(shù)、電子技術(shù)、機(jī)械加工技術(shù)的應(yīng)用發(fā)展而不斷發(fā)展起來(lái)的光、機(jī)、電一體化設(shè)備。嵌入式系統(tǒng)的發(fā)展及研究風(fēng)頭正勁，其在數(shù)字機(jī)床、智能控制等方面的應(yīng)用正逐漸改變著傳統(tǒng)的工業(yè)生產(chǎn)和服務(wù)方
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基于DSP+CPLD 可重構(gòu)數(shù)控系統(tǒng)的設(shè)計(jì)與仿真

  • 　　1、前言　　隨著計(jì)算機(jī)技術(shù)的高速發(fā)展，各工業(yè)發(fā)達(dá)國(guó)家投入巨資，對(duì)現(xiàn)代制造技術(shù)進(jìn)行研究開(kāi)發(fā)，提出了全新的制造模式，其核心思想之一是柔性化制造，制造系統(tǒng)能夠隨著加工條件的變化動(dòng)態(tài)調(diào)整。目前，各類(lèi)MCU 快速
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芯片-封裝協(xié)同設(shè)計(jì)方法優(yōu)化SoC設(shè)計(jì)

  • 隨著工藝節(jié)點(diǎn)和裸片尺寸不斷縮小，采用倒裝芯片封裝IC器件的消費(fèi)電子產(chǎn)品的數(shù)量日益增加。但是，倒裝芯片封...
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用CPLD實(shí)現(xiàn)FIR數(shù)字濾波器的設(shè)計(jì)

  • 介紹了一種利用ALTERA公司的復(fù)雜可編程邏輯器件（CPLD）快速卷積法實(shí)現(xiàn)數(shù)字濾波器的設(shè)計(jì)。
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基于CPLD技術(shù)的PC104總線(xiàn)多功能擴(kuò)展卡設(shè)計(jì)

  • 介紹了一款PC104總線(xiàn)多功能擴(kuò)展卡設(shè)計(jì)。采用了復(fù)雜可編程邏輯器件（CPLD）技術(shù)，集成了多路模擬量輸入/輸出、帶光電隔離的開(kāi)關(guān)量輸入/輸出及一個(gè)正交解碼電路，接口協(xié)議與臺(tái)灣研華PC工控機(jī)ISA總線(xiàn)板卡兼容，滿(mǎn)足了嵌入式控制系統(tǒng)高集成度的設(shè)計(jì)要求，在實(shí)際應(yīng)用中獲得了良好的效果。
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FPGA相關(guān)技術(shù)助力高端存儲(chǔ)器接口設(shè)計(jì)

  • 高性能系統(tǒng)設(shè)計(jì)師在滿(mǎn)足關(guān)鍵時(shí)序余量的同時(shí)要力爭(zhēng)獲得更高性能，而存儲(chǔ)器>存儲(chǔ)器接口設(shè)計(jì)則是一項(xiàng)艱巨挑戰(zhàn)。雙倍數(shù)據(jù)速率SDRAM和4倍數(shù)據(jù)速率SDRAM都采用源同步接口來(lái)把數(shù)據(jù)和時(shí)鐘(或選通脈沖)由發(fā)射器
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級(jí)聯(lián)信號(hào)處理器的FPGA實(shí)現(xiàn)

  • 摘要：現(xiàn)代通信系統(tǒng)中，數(shù)字化已成為發(fā)展的必然趨勢(shì)，數(shù)字信號(hào)處理則是數(shù)字系統(tǒng)中的重要環(huán)節(jié)。在數(shù)字信號(hào)處理方面提出一種級(jí)聯(lián)信號(hào)處理器的FPGA實(shí)現(xiàn)方案，用以取代昂貴的專(zhuān)用數(shù)字處理芯片。首先對(duì)級(jí)聯(lián)信號(hào)處理器做了
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CPLD在射頻卡讀寫(xiě)器中的應(yīng)用

  • 提出了一種射頻卡讀寫(xiě)器數(shù)字處理模塊的設(shè)計(jì)方案，特點(diǎn)是利用單片CPLD器件實(shí)現(xiàn)了讀寫(xiě)器編碼、譯碼和差錯(cuò)處理功能，系統(tǒng)體積小，性能穩(wěn)定。該方案采用了原理圖和VHDL相結(jié)合的靈活設(shè)計(jì)，給出了一種快速CRC-CCITT并行實(shí)現(xiàn)的方法。
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新一代視頻編碼器分析介紹

  • 先進(jìn)的視頻編碼(AVC)正在慢慢地超越數(shù)字視頻的主要標(biāo)準(zhǔn)。也稱(chēng)之為H.264和MPEG-4part10，其AVC編碼在1Mbit/s~2...
  • 關(guān)鍵字： 視頻編碼器  AVC編碼  FPGA  

基于FPGA的多通道校準(zhǔn)算法的同步實(shí)現(xiàn)

  • 　　數(shù)字信號(hào)處理模塊是接收機(jī)系統(tǒng)的核心部分，系統(tǒng)要求數(shù)字信號(hào)處理模塊能實(shí)時(shí)處理ADC變換后的數(shù)字信號(hào)，并用軟件的方法來(lái)實(shí)現(xiàn)大量的無(wú)線(xiàn)電功能，這些功能包括：多通道校準(zhǔn)、編解碼、調(diào)制解調(diào)、濾波、同步、盲均衡、
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基于DSP和FPGA技術(shù)的低信噪比雷達(dá)信號(hào)檢測(cè)

  • 摘要：提出一種基于DSP和FPGA技術(shù)的低信噪比情況下雷達(dá)信號(hào)檢測(cè)技術(shù)的工作原理與硬件實(shí)現(xiàn)方法，采用數(shù)字化的處理方法處理信息，取代傳統(tǒng)使用的模擬檢測(cè)技術(shù)，并對(duì)實(shí)現(xiàn)的檢測(cè)方法和關(guān)鍵算法做了詳細(xì)介紹。
    關(guān)鍵詞：高
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基于FPGA IP核的FFT實(shí)現(xiàn)

  • 對(duì)于FFT而言，很多領(lǐng)域都提出了其高速實(shí)時(shí)運(yùn)算的要求。利用FFT IP核實(shí)現(xiàn)FFT算法，并在cycloneⅡ系列的EP2C70F896C8器件上設(shè)計(jì)出處理速度為69.58 MHz的24位512點(diǎn)復(fù)數(shù)FFT處理器需29.3 μs，該方法具有效率高、速度快、周期短、靈活性強(qiáng)等特點(diǎn)。仿真結(jié)果表明此方法具有良好性能。
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基于FPGA的多通道校準(zhǔn)算法同步實(shí)現(xiàn)

  • 本文主要研究了多通道校準(zhǔn)算法在FPGA上的同步實(shí)現(xiàn)問(wèn)題。介紹FPGA時(shí)鐘同步設(shè)計(jì)的基本原理以及用Xilinx公司的FPGA芯片Xc2v8000ff1152-5實(shí)現(xiàn)了多通道校準(zhǔn)的同步算法，極大提高了系統(tǒng)穩(wěn)定性。
  • 關(guān)鍵字： ADC  FPGA  多通道校準(zhǔn)  同步實(shí)現(xiàn)  200907  
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