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arm+fpga 文章 最新資訊

基于FPGA的高速數(shù)據(jù)中繼器設(shè)計的研究

  • 1 前言 高速以太網(wǎng)可以滿足新的容量需求，解決了低帶寬接入、高帶寬傳輸?shù)钠款i問題，擴(kuò)大了應(yīng)用范圍，并與以前的所有以太網(wǎng)兼容。全雙工的以太網(wǎng)協(xié)議并無傳輸距離的限制，只是在實際應(yīng)用中，物理層技術(shù)限制了最
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ARM上網(wǎng)本有望6月面世 采用手機(jī)芯片平臺

  • 　　來自上網(wǎng)本廠商的消息稱，飛思卡爾和高通都準(zhǔn)備在今年六月初的臺北Computex 2009大會上發(fā)布各自的ARM平臺上網(wǎng)本產(chǎn)品。
  • 關(guān)鍵字： 飛思卡爾  ARM  Snapdragon  

賽靈思25周年論行業(yè)短長新款FPGA重拳出擊

  •         近日，賽靈思公司在北京舉辦隆重的25周年慶典，并宣布推出全新一代旗艦產(chǎn)品系列——高性能Virtex? -6和低成本Spartan? -6 FPGA，同時提出了“目標(biāo)設(shè)計平臺”的新理念。         出席慶典和新聞發(fā)布會的有賽靈思公司產(chǎn)品營銷高級總監(jiān)Chuck Tralka，亞太區(qū)執(zhí)行總裁/質(zhì)量管理和
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基于FPGA的A/D轉(zhuǎn)換采樣控制模塊的設(shè)計

  • 摘要：本文采用FPGA器件EP1C6T144C8芯片代替單片機(jī)控制A/D轉(zhuǎn)換芯片ADC0809進(jìn)行采樣控制，整個設(shè)計用VHDL語言描述，在QuartusⅡ平臺下進(jìn)行軟件編程實現(xiàn)正確的A/D轉(zhuǎn)換的工作時序控制過程，并將采樣數(shù)據(jù)從二進(jìn)制轉(zhuǎn)化成B
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基于RFID 的監(jiān)管信息系統(tǒng)的設(shè)計與實現(xiàn)

  • 0 引言 無線射頻識別技術(shù)（Radio Frequency Identificati on，RFID）是一種非接觸式的自動識別技術(shù)，它通過射頻信號自動識別目標(biāo)對象并獲取數(shù)據(jù)信息，識別無須人工干預(yù)，可工作于各種惡劣環(huán)境，并可同時識別多個目標(biāo)
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用FPGA實現(xiàn)靈活的汽車電子設(shè)計

  • 引言 　　微控制器在汽車和消費類市場上得到了廣泛應(yīng)用，能夠以相對較低的成本實現(xiàn)系統(tǒng)高度集成。然而，這類產(chǎn)品也有潛在的成本問題。例如，如果元件功能不符合要求，就必須采用外部邏輯、軟件或者其他集成器件
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基于單片機(jī)和FPGA的頻率特,tt測試儀

  • 介紹基于89S51單片機(jī)和FPGA的頻率特性測試儀的設(shè)計。該系統(tǒng)設(shè)計利用DDS原理由FPGA經(jīng)D／A轉(zhuǎn)換產(chǎn)生掃頻信號，再經(jīng)待測網(wǎng)絡(luò)實現(xiàn)峰值檢測和相位檢測，從而完成了待測網(wǎng)絡(luò)幅頻和相頻特性曲線的測量和顯示。經(jīng)過調(diào)試，示波器顯示待測網(wǎng)絡(luò)頻率范圍100 Hz～100 kHz的幅頻和相頻特性曲線，該系統(tǒng)工作穩(wěn)定，操作方便。
  • 關(guān)鍵字： tt  測試儀  頻率  FPGA  單片機(jī)  基于  轉(zhuǎn)換器  

一種寬帶復(fù)接器的設(shè)計與實現(xiàn)

幾家公司聯(lián)合在亞洲啟動協(xié)處理研討會

  •         安富利公司 (NYSE: AVT) 旗下安富利電子元件部、The MathWorks、德州儀器(TI) 和賽靈思(Xilinx)宣布將舉辦為期2天的協(xié)處理SpeedWay設(shè)計研討會(Co-Processing SpeedWay Design Workshop™)。研討會將以最新推出的Spartan-3A DSP FPGA / DaVinci開發(fā)平臺為基礎(chǔ)，講解如何“用基于模型化的設(shè)計方法，進(jìn)行FP
  • 關(guān)鍵字： 安富利  德州儀器  FPGA  DSP  

英特爾牽手臺積電走代工模式宣告ARM模式的勝利

  • ??????? 英特爾已與臺積電宣布簽訂合作備忘錄，就聯(lián)合開發(fā)和制造低成本凌動處理器(Atom)展開合作，推動凌動處理器應(yīng)用到上網(wǎng)本之外的其它消費電子產(chǎn)品當(dāng)中。初看到這個消息，第一感覺是對英特爾這位芯片的巨頭的處境深表同情，看來英特爾深受成本壓力之痛，IDM模式確實走不下去了，芯片成本太高了。另外的感覺是這個消息實際上宣布了ARM模式的勝利。 ??????? 長期以
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基于FPGA 的簡化UART 電路設(shè)計

  • 摘要： 本文闡述了通用異步發(fā)生器UART 的功能特點，介紹了用硬件描述語言Verilog 來開發(fā)各個模塊，并給出仿真結(jié)果。本設(shè)計使用Altera 的FPGA 芯片，將UART 的核心功能嵌入到FPGA 內(nèi)部，能夠?qū)崿F(xiàn)異步通信的功能，可以
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基于FPGA的線陣CCD驅(qū)動時序及 模擬信號處理的設(shè)計

  • 為保證線陣CCD在圖像測量中正常、穩(wěn)定工作，必須設(shè)計出適合其工作的時序驅(qū)動電路。在分析TCDl501D線陣CCD驅(qū)動時序關(guān)系的基礎(chǔ)上，通過分析CCD輸出的圖像信號，給出了內(nèi)、外相關(guān)雙采樣的時序控制。最后，利用quanus7．2軟件平臺結(jié)合VHDL語言進(jìn)行開發(fā)，對所需驅(qū)動脈沖進(jìn)行仿真設(shè)計。仿真結(jié)果表明，該驅(qū)動電路簡單、功耗小、成本低、抗干擾能力強(qiáng)，適用于設(shè)備小型化的要求。
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基于FPGA的全數(shù)字鎖相環(huán)的設(shè)計

  • 簡單介紹了全數(shù)字鎖相環(huán)(ADPLL)的結(jié)構(gòu)和工作原理，提出一種在FPGA的基礎(chǔ)上可增大全數(shù)字鎖相環(huán)同步范圍的設(shè)計方法，并給出了部分verilog HDL設(shè)計程序的代碼和仿真波形。
  • 關(guān)鍵字： FPGA  全數(shù)字  鎖相環(huán)    
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