電阻電容　在線測試　單片機　電隔離文章最新資訊

盛群推出HT1656X系列數(shù)字時脈IC產(chǎn)品

盛群半導體(Holtek)推出HT1656X系列數(shù)字時脈IC，該系列IC工作電壓范圍廣(4V～18V)、產(chǎn)品種類多樣、功能齊全、外接電路少，可利用汽車上的電源直接驅(qū)動螢光顯示面板(VFD)。 HT1656X系列IC提供客戶多款選擇，依面板驅(qū)動方式分為靜態(tài)顯示型HT16561、HT16565及1/2Duty動態(tài)掃瞄型HT16562、HT16566，依時間顯示方式分為12小時制(HT16561、HT16562)及24小時制(HT16565、HT16566)，12小時制又可提供帶有AM/PM顯示功能(
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飛兆半導體推出無須外接電阻的數(shù)字晶體管

飛兆半導體推出無須外接電阻的高集成度數(shù)字晶體管，這兩種全新的200mW數(shù)字晶體管系列FJY30xx(NPN)和FJY40xx(PNP)專為開關(guān)、逆變器、接口及驅(qū)動電路而量身定做，在極小的封裝中集成了一個外接電阻偏置網(wǎng)絡(luò)，因此無須外接電阻。這種高集成度減少了元件數(shù)目，有助于設(shè)計人員節(jié)省板空間、降低設(shè)計成本、簡化電路設(shè)計并使到系統(tǒng)性能最大化。此外，線路板空間因采用了表面貼裝技術(shù)(SMT)進一步得以優(yōu)化。這些晶體管備有超小超薄(1.7mmx0.98mmx0.78mm)的SOT523F封裝，比較采用SOT523封
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飛思卡爾擴展ColdFire系列支持工業(yè)連接

飛思卡爾半導體公司擴展了其32位ColdFire® USB設(shè)備系列，以便為多種工業(yè)應(yīng)用提供靈活的USB連接。飛思卡爾ColdFire USB系列擴展包括帶有Full-Speed USB On-The-Go(OTG)的MCF5221x微控制器（MCU）系列和采用Hi-Speed USB OTG的嵌入式MCF5253處理器。利用專門為低運行電壓設(shè)計的優(yōu)化體系結(jié)構(gòu)，這些ColdFire器件的功耗非常低而且不會降低性能。這些器件帶有
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飛思卡爾降低聯(lián)網(wǎng)市場千兆以太網(wǎng)成本

近年來，隨著網(wǎng)絡(luò)技術(shù)的迅速發(fā)展，消費者對家庭網(wǎng)絡(luò)的興趣日益濃厚。據(jù)市場調(diào)研公司 iSupply 近期預(yù)計，目前全球 1.95 億用戶使用寬帶服務(wù)，在中國，采用寬帶接入的家庭數(shù)量將從 2005 年的7% 增長至 2010 年的 16%，家庭聯(lián)網(wǎng)中常見設(shè)備如數(shù)字媒體服務(wù)器將有爆發(fā)性的增長。據(jù)市場研究機構(gòu)ABI Research公布的最新研究報告稱，家用數(shù)字媒體服務(wù)器越來越流行，媒體服務(wù)器市場的規(guī)?？赡軙拿髂甑?7億美元增至2011年的440億美元，這主要得益于數(shù)字內(nèi)容的增多以及核心行業(yè)計劃的成熟。伴隨著家用
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基于CPCI總線架構(gòu)設(shè)計的實時圖像信號處理平臺

摘要: 本文主要介紹了基于CPCI 總線設(shè)計的實時信號處理業(yè)務(wù)所需的一種專用設(shè)備平臺。關(guān)鍵詞： CPCI BUS；平臺；實時信號處理；DSP+FPGA 系統(tǒng)設(shè)計DSP+FPGA混用設(shè)計為了提高算法效率，實時處理圖像信息，本處理系統(tǒng)是基于DSP+FPGA混用結(jié)構(gòu)設(shè)計的。業(yè)務(wù)板以FPGA為處理核心，實現(xiàn)數(shù)字視頻信號的實時圖像處理，DSP實現(xiàn)了部分的圖像處理算法和FPGA的控制邏輯，并響應(yīng)中斷，實現(xiàn)數(shù)據(jù)通信和存儲實時信號。首先，本系統(tǒng)要求DSP可以滿足算法控制結(jié)構(gòu)復雜、運算速度高、尋址靈
關(guān)鍵字： 0704_A BUS CPCI DSP+FPGA 單片機平臺嵌入式系統(tǒng) 實時信號處理雜志_設(shè)計天地

新時代安全高速傳輸控制器產(chǎn)品創(chuàng)新研討會

新時代安全高速傳輸控制器產(chǎn)品創(chuàng)新研討會日期 2007年5月17日（星期四）13:30-17:30 地點深圳博林諾富特酒店（深圳市南山區(qū)華僑城僑城東路（僑城東地鐵站Ａ出口），電話：0755-82829966）主辦單位福華先進微電子股份有限公司報名方式網(wǎng)上報名, 電話傳真報名在線報名 http://www.fameg.com/0417/01.asp 活動費用全程免費 (名額有限
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DSP程序構(gòu)造的加密體制

目前，DSP以其卓越的性能、獨有的特點，已經(jīng)成為通信、計算機、消費類電子產(chǎn)品等領(lǐng)域的基礎(chǔ)器件。同時，隨著對知識產(chǎn)權(quán)的重視，在利用DSP進行產(chǎn)品設(shè)計時，如何保護自己的成果，防止破譯者竊取，也成為設(shè)計者工作在一個重要方面[1,2]。如果產(chǎn)品大批量生產(chǎn)，那么可以利用掩膜技術(shù)等工藝將操作程序及數(shù)據(jù)寫入芯片，使它們不能被讀出，達到保護的效果。對于還沒有形成規(guī)模的產(chǎn)品，使用這樣的方法就會使成本大大增加。因此，本文提出一種方法，利用3DES、Geffe發(fā)生器和MD5等算法，構(gòu)造一種加密體制，來保護DSP程序。 1
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FPGA與DS18B20型溫度傳感器通信的實現(xiàn)

DS18B20是DALLAS公司生產(chǎn)的一線式數(shù)字溫度傳感器，采用3引腳TO-92型小體積封裝；溫度測量范圍為-55℃～+125℃，可編程為9位～12位A/D轉(zhuǎn)換精度，測溫分辨率可達0.0625℃，被測溫度用符號擴展的16位數(shù)字量方式串行輸出。一線式(1-WIRE)串行總線是利用1條信號線就可以與總線上若干器件進行通信。具體應(yīng)用中可以利用微處理器的I/O端口對DS18B20直接進行通信，也可以通過現(xiàn)場可編程門陣列(FPGA)等可編程邏輯器件(PLD)實現(xiàn)對1-WIRE器件的通信。
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基于FPGA 的高階全數(shù)字鎖相環(huán)的設(shè)計與實現(xiàn)

1 引言鎖相環(huán)在通信、雷達、測量和自動化控制等領(lǐng)域應(yīng)用極為廣泛，已經(jīng)成為各種電子設(shè)備中必不可少的基本部件。隨著電子技術(shù)向數(shù)字化方向發(fā)展，需要采用數(shù)字方式實現(xiàn)信號的鎖相處理。因此，對全數(shù)字鎖相環(huán)的研究和應(yīng)用得到了越來越多的關(guān)注。傳統(tǒng)的數(shù)字鎖相環(huán)系統(tǒng)是希望通過采用具有低通特性的環(huán)路濾波器，獲得穩(wěn)定的振蕩控制數(shù)據(jù)。對于高階全數(shù)字鎖相環(huán)，其數(shù)字濾波器常常采用基于DSP 的運算電路。這種結(jié)構(gòu)的鎖相環(huán)，當環(huán)路帶寬很窄時，環(huán)路濾波器的實現(xiàn)將需要很大的電路量，這給專用集成電路的應(yīng)用和片上系統(tǒng)SOC（system
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基于VHDL語言的IP核驗證

引言在IC(integrated circuit．集成電路)發(fā)展到超大規(guī)模階段的今天，基于IP(Intellectual Property，知識產(chǎn)權(quán))核的IC設(shè)計及其再利用是保證SoC(system onchip，片上系統(tǒng))開發(fā)效率和質(zhì)量的重要手段。如果能對IP核進行驗證、測試和集成．就可以加速SoC的設(shè)計，而這需要從以下5個方面進行考慮。代碼純化．指在代碼設(shè)計中及完成后進行自定義的、IEEE標準的、設(shè)計重用的、可綜合性和可測試性等方面的規(guī)則檢查；
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單片機開發(fā)中應(yīng)掌握的幾個基本技巧

一、如何提高C語言編程代碼的效率鄧宏杰指出，用C語言進行單片機程序設(shè)計是單片機開發(fā)與應(yīng)用的必然趨勢。他強調(diào)：“如果使用C編程時，要達到最高的效率，最好熟悉所使用的C編譯器。先試驗一下每條C語言編譯以后對應(yīng)的匯編語言的語句行數(shù)，這樣就可以很明確的知道效率。在今后編程的時候，使用編譯效率最高的語句?！? 他指出，各家的C編譯器都會有一定的差異，故編譯效率也會有所不同，優(yōu)秀的嵌入式系統(tǒng)C編譯器代碼長度和執(zhí)行時間僅比以匯編語言編寫的同樣功能程度長5-20％。他說：“對于復雜而開發(fā)時間
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現(xiàn)實標準和32位MCU

當為下一代控制應(yīng)用選擇32位MCU時，必須考慮一點，就是面對某一實際的應(yīng)用，不同供應(yīng)商的處理器雖然在數(shù)據(jù)手冊上看起來或多或少有些相似，但實際上是非常不同的。雖然數(shù)據(jù)手冊中的規(guī)范和Dhrystone（處理器整型數(shù)計算能力）MIPS處理能力給出了一個粗略的評估標準，但必須考慮得更深入以保證MCU有足夠的吞吐量和過載余量來滿足當前和未來的應(yīng)用需求。運行編譯EEMBC汽車標準代碼的測試結(jié)果顯示：看起來類似的三款MCU實際性能差別很大例如，價格低廉、基于ARM的MCU一
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基于IP核的FPGA設(shè)計方法

前　言幾年前設(shè)計專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實現(xiàn), 系統(tǒng)制造公司的設(shè)計人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級功能(System L evel In tegrete - SL I) , 或稱片上系統(tǒng)(System on a ch ip ) , 但ASIC 設(shè)計能力跟不上制造能力的矛盾也日益突出?，F(xiàn)在設(shè)計人員已不必全部用邏輯門去設(shè)計ASIC, 類似于用集成電路( IC) 芯片在印制板上的設(shè)計,ASIC 設(shè)計人員可以應(yīng)用等
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Montavista linux pro 4.0嵌入式方案

MontaVista 軟件公司是一個世界領(lǐng)先的智能設(shè)備和相應(yīng)基礎(chǔ)部件的系統(tǒng)軟件供應(yīng)商。MontaVista以提供基于GNU/linux的開放源碼軟件解決方案來推動嵌入式系統(tǒng)革命。它由實時操作系統(tǒng)（RTOS）的倡導者James Ready在1999年創(chuàng)立。MontaVista提供的MontaVista Linux家族系列產(chǎn)品滿足了廣泛的軟件開發(fā)商的需要，包含從通信基礎(chǔ)設(shè)施到消費電子的應(yīng)用。MontaVista發(fā)布的多種MontaVista Linux版本包括-專業(yè)版（Professional Edition
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基于并行流水線結(jié)構(gòu)的可重配FIR濾波器的FPGA實現(xiàn)

1 并行流水結(jié)構(gòu)FIR的原理在用FPGA或?qū)Ｓ眉呻娐穼崿F(xiàn)數(shù)字信號處理算法時，計算速度和芯片面積是兩個相互制約的主要問題。實際應(yīng)用FIR濾波器時，要獲得良好的濾波效果，濾波器的階數(shù)可能會顯著增加，有時可能會多達幾百階。因此，有必要在性能和實現(xiàn)復雜性之間做出選擇，也就是選擇不同的濾波器實現(xiàn)結(jié)構(gòu)。這里運用并行流水線結(jié)構(gòu)來實現(xiàn)速度和硬件面積之間的互換和折衷。在關(guān)鍵路徑插入寄存器的流水線結(jié)構(gòu)是提高系統(tǒng)吞吐率的一項強大的實現(xiàn)技術(shù)，并且不需要大量重復設(shè)置硬件。流水線的類型主要分為兩種：算術(shù)流水線和指令流水線
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